JAJSE88F November   2017  – February 2024 UCC21220 , UCC21220A

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 Device Comparison Table
  6. 5 Pin Configuration and Functions
  7. 6 Specifications
    1. 6.1  Absolute Maximum Ratings
    2. 6.2  ESD Ratings
    3. 6.3  Recommended Operating Conditions
    4. 6.4  Thermal Information
    5. 6.5  Power Ratings
    6. 6.6  Insulation Specifications
    7. 6.7  Safety-Related Certifications
    8. 6.8  Safety-Limiting Values
    9. 6.9  Electrical Characteristics
    10. 6.10 Switching Characteristics
    11. 6.11 Thermal Derating Curves
    12. 6.12 Typical Characteristics
  8. 7 Parameter Measurement Information
    1. 7.1 Minimum Pulses
    2. 7.2 Propagation Delay and Pulse Width Distortion
    3. 7.3 Rising and Falling Time
    4. 7.4 Input and Disable Response Time
    5. 7.5 Power-up UVLO Delay to OUTPUT
    6. 7.6 CMTI Testing
  9. 8 Detailed Description
    1. 8.1 Overview
    2. 8.2 Functional Block Diagram
    3. 8.3 Feature Description
      1. 8.3.1 VDD, VCCI, and Under Voltage Lock Out (UVLO)
      2. 8.3.2 Input and Output Logic Table
      3. 8.3.3 Input Stage
      4. 8.3.4 Output Stage
      5. 8.3.5 Diode Structure in UCC21220 and UCC21220A
    4. 8.4 Device Functional Modes
      1. 8.4.1 Disable Pin
  10. 9 Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Typical Application
      1. 9.2.1 Design Requirements
      2. 9.2.2 Detailed Design Procedure
        1. 9.2.2.1 Designing INA/INB Input Filter
        2. 9.2.2.2 Select External Bootstrap Diode and its Series Resistor
        3. 9.2.2.3 Gate Driver Output Resistor
        4. 9.2.2.4 Estimating Gate Driver Power Loss
        5. 9.2.2.5 Estimating Junction Temperature
        6. 9.2.2.6 Selecting VCCI, VDDA/B Capacitor
          1. 9.2.2.6.1 Selecting a VCCI Capacitor
          2. 9.2.2.6.2 Selecting a VDDA (Bootstrap) Capacitor
          3. 9.2.2.6.3 Select a VDDB Capacitor
        7. 9.2.2.7 Application Circuits with Output Stage Negative Bias
      3. 9.2.3 Application Curves
  11. 10Power Supply Recommendations
  12. 11Layout
    1. 11.1 Layout Guidelines
      1. 11.1.1 Component Placement Considerations
      2. 11.1.2 Grounding Considerations
      3. 11.1.3 High-Voltage Considerations
      4. 11.1.4 Thermal Considerations
    2. 11.2 Layout Example
  13. 12Device and Documentation Support
    1. 12.1 サード・パーティ製品に関する免責事項
    2. 12.2 Documentation Support
      1. 12.2.1 Related Documentation
    3. 12.3 Receiving Notification of Documentation Updates
    4. 12.4 サポート・リソース
    5. 12.5 Trademarks
    6. 12.6 静電気放電に関する注意事項
    7. 12.7 用語集
  14. 13Revision History
  15. 14Mechanical, Packaging, and Orderable Information

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
サーマルパッド・メカニカル・データ
発注情報

3 概要

UCC21220 および UCC21220A デバイスは、ピーク ソース電流が 4A 、ピーク シンク電流が 6A の基本および機能絶縁型デュアル チャネル ゲート ドライバです。これらのデバイスは、PFC、絶縁型 DC/DC、同期整流アプリケーションのパワー MOSFET および GaNFET を駆動するよう設計されており、高速なスイッチング性能と、100V/ns を超える同相過渡耐性 (CMTI) による堅牢なグランド バウンス保護機能を備えています。

これらのデバイスは、2 つのローサイド ドライバ、2 つのハイサイド ドライバ、ハーフブリッジ ドライバのいずれかとして構成できます。出力の遅延ばらつきが非常に小さいため、2 つの出力を並列接続することで、重負荷条件用に駆動能力を 2 倍にした 1 つのドライバを構成できます。

保護機能には、以下のものがあります。DIS ピンを High に設定すると 2 つの出力が同時にシャットダウンされます。INA/B ピンでは、5ns 未満の入力過渡が除去されます。入力と出力はどちらも -2V のスパイクに 200ns の間耐えます。全電源が低電圧誤動作防止 (UVLO) を備えています。電力が供給されていない場合またはフローティング状態の場合、アクティブ プルダウン保護により出力が 2.1V 未満にクランプされます。

これらの機能により、広範な電力アプリケーションにおいて高効率、高電力密度、高い堅牢性を実現します。

製品情報
部品番号(2) パッケージ(1) UVLO
UCC21220 D (SOIC 16) 8V
UCC21220A D (SOIC 16) 5V
(1) 供給されているすべてのパッケージについては、セクション 14 を参照してください。
(2) デバイスの詳細な比較については、セクション 4 を参照してください。
GUID-E0A86A36-9D6E-40B1-BEF0-5E263557D233-low.gif 代表的なアプリケーション