JAJSDT7B August 2017 – August 2017 UCC256301
PRODUCTION DATA.
回路のこの部分は、次の3つの要素で構成されています。
ピック・ロワー・ブロックには2つの入力があります。1つ目の入力はFBreplicaです。もう1つの入力はAVDDピンとSSピンの電圧から選択されます。その他の出力は、この2つの入力のうち低いほうになります。
MUXはSSとAVDDから選択します。この選択は、SS Ctrlブロックの出力であるSSEnd (ソフトスタート終了)信号に基づきます。SSがFBreplicaより高いとSSEndは高く、ソフトスタートがステートマシンによって起動されているため、ZCS状態はありません。ソフトスタートが終了した後AVDDにスイッチングすれば、ソフトスタートやZCS異常でない状態の間は、ピック・ロワー・ブロックから常にFBreplica信号が送信されていることを確認できます。また、SSピンを他の機能、すなわち軽負荷閾値の調整に使用することもできます。
SS制御ブロックは、ZCS異常発生時にSS容量の充電/放電を処理します。ZCSが発生するとSSEnd信号がリセットされるため、スイッチング周波数を上げるためのSSピンのプルダウン効果がピック・ロワー・ブロックを通過できます。SS制御ブロックの入力と出力の関係は次のとおりです。