JAJSPO2D June   2010  – October 2024 TLV320AIC3104-Q1

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 Device Comparison
  6. 5 Pin Configuration and Functions
  7. 6 Specifications
    1. 6.1  Absolute Maximum Ratings
    2. 6.2  ESD Ratings
    3. 6.3  Recommended Operating Conditions
    4. 6.4  Thermal Information
    5. 6.5  Electrical Characteristics
    6. 6.6  Switching Characteristics I2S/LJF/RJF Timing in Master Mode
    7. 6.7  Switching Characteristics I2S/LJF/RJF Timing in Slave Mode
    8. 6.8  Switching Characteristics DSP Timing in Master Mode
    9. 6.9  Switching Characteristics DSP Timing in Slave Mode
    10. 6.10 Typical Characteristics
  8. 7 Detailed Description
    1. 7.1 Overview
    2. 7.2 Functional Block Diagram
    3. 7.3 Feature Description
      1. 7.3.1  Audio Data Converters
      2. 7.3.2  Stereo Audio ADC
        1. 7.3.2.1 Stereo Audio ADC High-Pass Filter
      3. 7.3.3  Automatic Gain Control (AGC)
      4. 7.3.4  Stereo Audio DAC
      5. 7.3.5  Digital Audio Processing for Playback
      6. 7.3.6  Digital Interpolation Filter
      7. 7.3.7  Delta-Sigma Audio DAC
      8. 7.3.8  Audio DAC Digital Volume Control
      9. 7.3.9  Analog Output Common-mode Adjustment
      10. 7.3.10 Audio DAC Power Control
      11. 7.3.11 Audio Analog Inputs
      12. 7.3.12 Analog Input Bypass Path Functionality
      13. 7.3.13 ADC PGA Signal Bypass Path Functionality
      14. 7.3.14 Input Impedance and VCM Control
      15. 7.3.15 MICBIAS Generation
      16. 7.3.16 Analog Fully Differential Line Output Drivers
      17. 7.3.17 Analog High-Power Output Drivers
      18. 7.3.18 Short-Circuit Output Protection
      19. 7.3.19 Jack and Headset Detection
    4. 7.4 Device Functional Modes
      1. 7.4.1 Digital Audio Processing for Record Path
      2. 7.4.2 Increasing DAC Dynamic Range
      3. 7.4.3 Passive Analog Bypass During Power Down
      4. 7.4.4 Hardware Reset
    5. 7.5 Programming
      1. 7.5.1  Digital Control Serial Interface
      2. 7.5.2  I2C Control Interface
      3. 7.5.3  I2C Bus Debug in a Glitched System
      4. 7.5.4  Digital Audio Data Serial Interface
      5. 7.5.5  Right-Justified Mode
      6. 7.5.6  Left-Justified Mode
      7. 7.5.7  I2S Mode
      8. 7.5.8  DSP Mode
      9. 7.5.9  TDM Data Transfer
      10. 7.5.10 Audio Clock Generation
  9. 8 Register Maps
    1. 8.1 Output Stage Volume Controls
  10. 9 Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Typical Applications
      1. 9.2.1 External Speaker Driver in Infotainment and Cluster Applications
        1. 9.2.1.1 Design Requirements
        2. 9.2.1.2 Detailed Design Procedure
        3. 9.2.1.3 Application Curves
      2. 9.2.2 External Speaker Amplifier With Separate Line Outputs
        1. 9.2.2.1 Design Requirements
        2. 9.2.2.2 Detailed Design Procedure
    3. 9.3 Power Supply Recommendations
    4. 9.4 Layout
      1. 9.4.1 Layout Guidelines
      2. 9.4.2 Layout Example
  11. 10Device and Documentation Support
    1. 10.1 Device Support
      1. 10.1.1 Device Nomenclature
    2. 10.2 Documentation Support
      1. 10.2.1 Related Documentation
    3. 10.3 Receiving Notification of Documentation Updates
    4. 10.4 Community Resources
    5. 10.5 Trademarks
    6. 10.6 静電気放電に関する注意事項
  12. 11Revision History
  13. 12Mechanical, Packaging, and Orderable Information

3 概要

TLV320AIC3104-Q1 は、ステレオ ヘッドホン アンプを内蔵した低消費電力ステレオ オーディオ コーデックであり、シングル エンドまたは完全差動構成でプログラム可能な複数の入力と出力を備えています。レジスタ ベースの包括的な電源制御機能が搭載されており、3.3V のアナログ電源からわずか 14mW のステレオ 48kHz DAC 再生が可能なため、このデバイスはクラスタおよびヘッド ユニット システムの車載用オーディオ アプリケーションに最適な選択です。

TLV320AIC3104-Q1 の録音パスには、内蔵マイクロフォン バイアス、デジタル制御のステレオ マイク プリアンプ、自動ゲイン制御 (AGC) が含まれており、複数のアナログ入力の間に MIX および MUX 機能があります。録音時にプログラム可能なフィルタを使用でき、e-Call システムがアクティブになっているときなど、ノイズの多い予測不可能な環境で発生する可能性がある可聴ノイズを除去できます。再生パスには MIX および MUX 機能があり、ステレオ DAC および選択した入力から、プログラム可能なボリューム制御を介して各種の出力が可能です。

TLV320AIC3104-Q1 には、4 つの大電力出力ドライバと 2 つの完全差動出力ドライバが内蔵されています。大電力出力ドライバは、AC カップリング コンデンサを使用した最大 4 チャネルのシングルエンド 16Ω ヘッドホン、あるいはコンデンサレス出力構成のステレオ 16Ω ヘッドホンなど、さまざまな負荷構成を駆動できます。これらのパラメータにより、TLV320AIC3104-Q1 は、インフォテインメントおよびクラスタ分野のさまざまなオーディオ アプリケーションで、TPA3111D1-Q1 などの MCU とスピーカ アンプの間のインターフェイスとして動作できます。

ステレオ オーディオ DAC は 8kHz～96kHz のサンプリング レートをサポートし、DAC パスにプログラマブル デジタル フィルタを備えており、3D、バス、トレブル、ミッドレンジ エフェクト、スピーカ イコライゼーション、32kHz、44.1kHz、48kHz の各サンプリング レートのディエンファシスを実現します。ステレオ オーディオ ADC は、8kHz～96kHz のサンプリング レートをサポートし、前段に、低レベルのマイク入力に対して最大 59.5dB のアナログ ゲインを実現できるプログラマブル ゲイン アンプ (PGA) または自動ゲイン制御 (AGC) 回路が搭載されています。TLV320AIC3104-Q1 は、アタック (8ms～1,408ms) とディケイ (0.05 秒～22.4 秒) の両方に対して非常に広範囲にわたるプログラマビリティを実現します。AGC 範囲が広いので、AGC を多くの種類のアプリケーションに合わせてチューニングできます。

アナログ信号処理とデジタル信号処理のどちらも必要ない場合、デバイスを特別なアナログ信号パススルー モードに設定できます。このモードでは、パススルー動作中にほとんどのデバイスがパワーダウンするため、消費電力が大幅に削減されます。

シリアル制御バスは I2C プロトコルをサポートし、シリアル オーディオ データ バスは I2S、左 / 右揃えの DSP または TDM モードにプログラムできます。高度にプログラム可能な PLL が内蔵されており、柔軟なクロック生成ができ、512kHz～50MHz の広い範囲の MCLK から、標準的なオーディオ速度のすべてをサポートしています。これには最も一般的な 12MHz、13MHz、16MHz、19.2MHz、19.68MHz のシステム クロックが含まれるように特に注意を払っています。

TLV320AIC3104-Q1 は、2.7V～3.6V のアナログ電源、1.525V～1.95V のデジタル コア電源、1.1V～3.6V のデジタル入出力電源で動作します。

製品情報
部品番号 パッケージ (1) パッケージ サイズ(2)
TLV320AIC3104-Q1 VQFN (32) 5.00mm × 5.00mm
(1) 利用可能なすべてのパッケージについては、データシートの末尾にある注文情報を参照してください。
(2) パッケージ サイズ (長さ × 幅) は公称値であり、該当する場合はピンも含まれます。
TLV320AIC3104-Q1 簡略ブロック図簡略ブロック図