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  • TLV4062-Q1、TLV4082-Q1 リファレンス内蔵、デュアルチャネル、低電力コンパレータ

    • JAJSPA9 October   2020 TLV4062-Q1 , TLV4082-Q1

      PRODUCTION DATA  

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  • TLV4062-Q1、TLV4082-Q1 リファレンス内蔵、デュアルチャネル、低電力コンパレータ
  1. 1 特長
  2. 2 アプリケーション
  3. 3 概要
  4. 4 Revision History
  5. 5 Pin Configuration and Functions
  6. 6 Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Timing Requirements
    7. 6.7 Timing Diagrams
    8. 6.8 Typical Characteristics
  7. 7 Detailed Description
    1. 7.1 Overview
    2. 7.2 Functional Block Diagrams
    3. 7.3 Feature Description
    4. 7.4 Device Functional Modes
      1. 7.4.1 Inputs (IN1, IN2)
      2. 7.4.2 Outputs (OUT1, OUT2)
      3. 7.4.3 Switching Threshold and Hysteresis
  8. 8 Application and Implementation
    1. 8.1 Application Information
      1. 8.1.1 Threshold Overdrive
    2. 8.2 Typical Applications
      1. 8.2.1 Monitoring Two Separate Rails
        1. 8.2.1.1 Design Requirements
        2. 8.2.1.2 Detailed Design Procedure
        3. 8.2.1.3 Application Curve
      2. 8.2.2 Early Warning Detection
        1. 8.2.2.1 Design Requirements
        2. 8.2.2.2 Detailed Design Procedure
        3. 8.2.2.3 Application Curve
      3. 8.2.3 Additional Application Information
        1. 8.2.3.1 Pull-Up Resistor Selection
        2. 8.2.3.2 INx Capacitor
  9. 9 Power Supply Recommendations
  10. 10Layout
    1. 10.1 Layout Guidelines
    2. 10.2 Layout Example
  11. 11Device and Documentation Support
    1. 11.1 Documentation Support
      1. 11.1.1 Related Documentation
    2. 11.2 Receiving Notification of Documentation Updates
    3. 11.3 サポート・リソース
    4. 11.4 Trademarks
    5. 11.5 静電気放電に関する注意事項
    6. 11.6 用語集
      1.      Mechanical, Packaging, and Orderable Information
  12. 重要なお知らせ

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
  • DBV|6
    • MPDS026Q
サーマルパッド・メカニカル・データ
発注情報
  • jajspa9_oa
  • jajspa9_pm
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DATA SHEET

TLV4062-Q1、TLV4082-Q1 リファレンス内蔵、デュアルチャネル、低電力コンパレータ

このリソースの元の言語は英語です。 翻訳は概要を便宜的に提供するもので、自動化ツール (機械翻訳) を使用していることがあり、TI では翻訳の正確性および妥当性につきましては一切保証いたしません。 実際の設計などの前には、ti.com で必ず最新の英語版をご参照くださいますようお願いいたします。

1 特長

  • 車載アプリケーションに対応

  • 下記内容で AEC-Q100 認定済み：
    • デバイス温度グレード 1：-40℃～125℃の動作時周囲温度範囲
    • デバイス HBM ESD 分類レベル H1C
    • デバイス CDM ESD 分類レベル C4B
  • 広い電源電圧範囲：1.5V～5.5V
  • 小型パッケージの 2 チャネル検出器
  • 高いスレッショルド精度：温度範囲全体で 1%
  • 高精度ヒステリシス：60mV
  • 低い静止電流：2μA (標準値)
  • 温度範囲：-40℃～+125℃
  • プッシュプル (TLV4062-Q1) およびオープン・ドレイン (TLV4082-Q1) 出力オプション
  • SOT-23 パッケージで供給

2 アプリケーション

  • 緊急通話 (eCall)
  • 車載用ヘッド・ユニット
  • インストルメント・クラスタ
  • オンボード・チャージャ (OBC) / ワイヤレス・チャージャ

3 概要

TLV4062-Q1 および TLV4082-Q1 は高精度のデュアルチャネル・コンパレータ・ファミリで、低消費電力と小さなソリューション・サイズが特長です。IN1 および IN2 入力には、短時間のグリッチを除去するためのヒステリシスが含まれているため、誤ったトリガが発生せず出力動作が安定します。

TLV4062-Q1 および TLV4082-Q1 には可変の INx 入力があり、1 対の外付け分圧抵抗によって構成可能です。IN1 または IN2 入力の電圧が下降時のスレッショルドを下回ると、それぞれ OUT1 または OUT2 が LOW になります。IN1 または IN2 が上昇時のスレッショルドよりも高くなると、それぞれ OUT1 または OUT2 が HIGH になります。

これらのコンパレータは静止電流が 2μA (標準値) と非常に小さく、低消費電力で電圧を監視するための、高精度で省スペースのソリューションを実現します。TLV4062-Q1 および TLV4082-Q1 の動作電圧範囲は、-40℃～+125℃の温度範囲全体で 1.5V～5.5V です。

製品情報 (1)
部品番号パッケージ本体サイズ (公称)
TLV4062-Q1、TLV4082-Q1SOT-23 (6)2.90mm × 1.60mm
(1) 提供されているすべてのパッケージについては、巻末の注文情報を参照してください。





GUID-6532C254-5487-4630-BBDF-480E876E2FAB-low.gifTLV4062-Q1 のブロック図
GUID-0BB36B28-8611-4CDA-8360-71DF2ECCB501-low.gifTLV4082-Q1 のブロック図

4 Revision History

DATE REVISION NOTES
October 2020 * Initial release.

5 Pin Configuration and Functions

GUID-4DF305CA-B27C-4F5A-B3C4-5023845D4BFA-low.gifFigure 5-1 DBV Package, 6-Pin SOT-23
Table 5-1 Pin Functions
NAME NO. I/O DESCRIPTION
DBV
GND 5 — Ground
OUT1 2 O OUT1 is the output for IN1. OUT1 is asserted (driven low) when the voltage at IN1 falls below VIT–. OUT1 is deasserted (goes high) after IN1 rises higher than VIT+.
OUT1 is a push-pull output for the TLV4062 and an open-drain output for the TLV4082.
The open-drain device (TLV4082) can be pulled up to 5.5 V independent of V+; a pullup resistor is required for this device.
OUT2 3 O OUT2 is the output for IN2. OUT2 is asserted (driven low) when the voltage at IN2 falls below VIT–. OUT2 is deasserted (goes high) after IN2 rises higher than VIT+.
OUT2 is a push-pull output for the TLV4062 and an open-drain output for the TLV4082.
The open-drain device (TLV4082) can be pulled up to 5.5 V independent of V+; a pullup resistor is required for this device.
IN1 6 I This pin is connected to the voltage to be monitored with the use of an external resistor divider.
When the voltage at this pin drops below the threshold voltage (VIT–), OUT1 is asserted.
IN2 4 I This pin is connected to the voltage to be monitored with the use of an external resistor divider.
When the voltage at this pin drops below the threshold voltage (VIT–), OUT2 is asserted.
V+ 1 I Supply voltage input. Connect a 1.5-V to 5.5-V supply to V+ in order to power the device. Good analog design practice is to place a 0.1-µF ceramic capacitor close to this pin (required for V+ < 1.5 V).

 
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