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CD74AC251

AKTIV

Multiplexer, 8 Eingänge, mit Tri-State-Ausgängen

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Datenblatt

CD74AC251

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Produktdetails

Technology family AC Function Digital Multiplexer Configuration 8:1 Number of channels 1 Operating temperature range (°C) -55 to 125 Rating Catalog
Technology family AC Function Digital Multiplexer Configuration 8:1 Number of channels 1 Operating temperature range (°C) -55 to 125 Rating Catalog
SOIC (D) 16 59.4 mm² 9.9 x 6
  • Buffered inputs
  • Typical propagation delay
    • 6ns at VCC = 5V, TA = 25°C, CL = 50pF
  • Exceeds 2kV ESD protection MIL-STD-883, method 3015
  • SCR-latchup-resistant CMOS process and circuit design
  • Speed of bipolar FAST™/AS/S with significantly reduced power consumption
  • Balanced propagation delays
  • AC types feature 1.5V to 5.5V operation and balanced noise immunity at 30% of the supply
  • ±24mA output drive current
    • Fanout to 15 FAST™ ICs
    • Drives 50Ω transmission lines
  • Buffered inputs
  • Typical propagation delay
    • 6ns at VCC = 5V, TA = 25°C, CL = 50pF
  • Exceeds 2kV ESD protection MIL-STD-883, method 3015
  • SCR-latchup-resistant CMOS process and circuit design
  • Speed of bipolar FAST™/AS/S with significantly reduced power consumption
  • Balanced propagation delays
  • AC types feature 1.5V to 5.5V operation and balanced noise immunity at 30% of the supply
  • ±24mA output drive current
    • Fanout to 15 FAST™ ICs
    • Drives 50Ω transmission lines

The CD74AC251 8-input multiplexers that utilize the Harris Advanced CMOS Logic technology. This multiplexer features both true (Y) and complement (Y) outputs as well as an Output Enable (OE) input. The OE must be at a LOW logic level to enable this device. When the OE input is HIGH, both outputs are in the high-impedance state. When enabled, address information on the data select inputs determines which data input is routed to the Y and Y outputs.

The CD74AC251 8-input multiplexers that utilize the Harris Advanced CMOS Logic technology. This multiplexer features both true (Y) and complement (Y) outputs as well as an Output Enable (OE) input. The OE must be at a LOW logic level to enable this device. When the OE input is HIGH, both outputs are in the high-impedance state. When enabled, address information on the data select inputs determines which data input is routed to the Y and Y outputs.
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Technische Dokumentation

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Typ Titel Datum
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Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

14-24-LOGIC-EVM — Generisches Logikprodukt-Evaluierungsmodul für 14-polige bis 24-polige D-, DB-, DGV-, DW-, DYY-, NS-

Das 14-24-LOGIC-EVM-Evaluierungsmodul (EVM) ist für die Unterstützung aller Logikgeräte konzipiert, die sich in einem 14-Pin- bis 24-Pin-D-, DW-, DB-, NS-, PW-, DYY- oder DGV-Gehäuse befinden.

Benutzerhandbuch: PDF | HTML
Nicht verfügbar auf TI.com
Gehäuse Pins CAD-Symbole, Footprints und 3D-Modelle
SOIC (D) 16 Ultra Librarian
Es gelten die allgemeinen Geschäftsbedingungen von TI für Evaluierungsartikel.

Bestellen & Qualität

Beinhaltete Information:
  • RoHS
  • REACH
  • Bausteinkennzeichnung
  • Blei-Finish/Ball-Material
  • MSL-Rating / Spitzenrückfluss
  • MTBF-/FIT-Schätzungen
  • Materialinhalt
  • Qualifikationszusammenfassung
  • Kontinuierliches Zuverlässigkeitsmonitoring
Beinhaltete Information:
  • Werksstandort
  • Montagestandort

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