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SN74AHCT02

AKTIV

4-Kanal-NOR-Gates mit 2 Eingängen, 4,5 bis 5,5 V mit TTL-kompatiblen CMOS-Eingängen

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Datenblatt

SN74AHCT02

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Produktdetails

Technology family AHCT Number of channels 4 Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Inputs per channel 2 IOL (max) (mA) 8 IOH (max) (mA) -8 Output type Push-Pull Input type TTL-Compatible CMOS Features Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 70 Rating Catalog Operating temperature range (°C) -40 to 125
Technology family AHCT Number of channels 4 Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Inputs per channel 2 IOL (max) (mA) 8 IOH (max) (mA) -8 Output type Push-Pull Input type TTL-Compatible CMOS Features Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 70 Rating Catalog Operating temperature range (°C) -40 to 125
PDIP (N) 14 181.42 mm² 19.3 x 9.4 SOIC (D) 14 51.9 mm² 8.65 x 6 SOP (NS) 14 79.56 mm² 10.2 x 7.8 SSOP (DB) 14 48.36 mm² 6.2 x 7.8 TSSOP (PW) 14 32 mm² 5 x 6.4 TVSOP (DGV) 14 23.04 mm² 3.6 x 6.4 VQFN (RGY) 14 12.25 mm² 3.5 x 3.5 WQFN (BQA) 14 7.5 mm² 3 x 2.5
  • Operating range of 4.5V to 5.5V
  • Low power consumption, 10µA maximum ICC
  • ±8mA output drive at 5V
  • Inputs are TTL-voltage compatible
  • Latch-up performance exceeds 250mAper JESD 17
  • Operating range of 4.5V to 5.5V
  • Low power consumption, 10µA maximum ICC
  • ±8mA output drive at 5V
  • Inputs are TTL-voltage compatible
  • Latch-up performance exceeds 250mAper JESD 17

These devices contain four independent 2-input NOR gates that perform the Boolean function Y = A × B or Y = A + B in positive logic.

These devices contain four independent 2-input NOR gates that perform the Boolean function Y = A × B or Y = A + B in positive logic.
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Technische Dokumentation

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Typ Titel Datum
* Data sheet SNx4AHCT02 Quadruple 2-Input Positive-NOR Gates datasheet (Rev. N) PDF | HTML 20 Feb 2024
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Application note CMOS Power Consumption and CPD Calculation (Rev. B) 01 Jun 1997
Application note Live Insertion 01 Okt 1996

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

14-24-LOGIC-EVM — Generisches Logikprodukt-Evaluierungsmodul für 14-polige bis 24-polige D-, DB-, DGV-, DW-, DYY-, NS-

Das 14-24-LOGIC-EVM-Evaluierungsmodul (EVM) ist für die Unterstützung aller Logikgeräte konzipiert, die sich in einem 14-Pin- bis 24-Pin-D-, DW-, DB-, NS-, PW-, DYY- oder DGV-Gehäuse befinden.

Benutzerhandbuch: PDF | HTML
Nicht verfügbar auf TI.com
Evaluierungsplatine

14-24-NL-LOGIC-EVM — Generisches Logikprodukt-Evaluierungsmodul für 14- bis 24-polige bleifreie Gehäuse

14-24-NL-LOGIC-EVM ist ein flexibles Evaluierungsmodul (EVM), das alle Logik- oder Übersetzungsbausteine mit einem 14- bis 24-poligen BQA-, BQB-, RGY-, RSV-, RJW- oder RHL-Gehäuse unterstützt.

Benutzerhandbuch: PDF | HTML
Nicht verfügbar auf TI.com
Simulationsmodell

SN74AHCT02 Behavioral SPICE Model

SCLM260.ZIP (7 KB) - PSpice Model
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Simulationsmodell

SN74AHCT02 IBIS Model

SCLM068.ZIP (13 KB) - IBIS Model
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Gehäuse Pins CAD-Symbole, Footprints und 3D-Modelle
PDIP (N) 14 Ultra Librarian
SOIC (D) 14 Ultra Librarian
SOP (NS) 14 Ultra Librarian
SSOP (DB) 14 Ultra Librarian
TSSOP (PW) 14 Ultra Librarian
TVSOP (DGV) 14 Ultra Librarian
VQFN (RGY) 14 Ultra Librarian
WQFN (BQA) 14 Ultra Librarian
Es gelten die allgemeinen Geschäftsbedingungen von TI für Evaluierungsartikel.

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