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SN74AHCT1G02

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Einfaches NOR-Gatter, 2 Eingänge, 4,5 V bis 5,5 V, mit TTL-kompatiblen CMOS-Eingängen

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Datenblatt

SN74AHCT1G02

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Produktdetails

Technology family AHCT Number of channels 1 Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Inputs per channel 2 IOL (max) (mA) 8 IOH (max) (mA) -8 Output type Push-Pull Input type TTL-Compatible CMOS Features Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 70 Rating Catalog Operating temperature range (°C) -40 to 85
Technology family AHCT Number of channels 1 Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Inputs per channel 2 IOL (max) (mA) 8 IOH (max) (mA) -8 Output type Push-Pull Input type TTL-Compatible CMOS Features Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 70 Rating Catalog Operating temperature range (°C) -40 to 85
SOT-23 (DBV) 5 8.12 mm² 2.9 x 2.8 SOT-SC70 (DCK) 5 4.2 mm² 2 x 2.1
  • Operating range of 4.5 V to 5.5 V
  • eMax tpd of 6.5 ns at 5 V
  • Low power consumption, 10-µA max ICC
  • ± 8-mA output drive at 5 V
  • Inputs are TTL-voltage compatible
  • Latch-up performance exceeds 250 mA per JESD 17
  • Operating range of 4.5 V to 5.5 V
  • eMax tpd of 6.5 ns at 5 V
  • Low power consumption, 10-µA max ICC
  • ± 8-mA output drive at 5 V
  • Inputs are TTL-voltage compatible
  • Latch-up performance exceeds 250 mA per JESD 17

This device contains a single 2-input NOR gate that performs the Boolean function Y = A × B or Y = A + B positive logic.

This device contains a single 2-input NOR gate that performs the Boolean function Y = A × B or Y = A + B positive logic.
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Technische Dokumentation

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Typ Titel Datum
* Data sheet SN74AHCT1G02 Single 2-Input Positive-NOR Gate datasheet (Rev. M) PDF | HTML 01 Feb 2024
Application note Implications of Slow or Floating CMOS Inputs (Rev. E) 26 Jul 2021
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Application note TI IBIS File Creation, Validation, and Distribution Processes 29 Aug 2002
Design guide AHC/AHCT Designer's Guide February 2000 (Rev. D) 24 Feb 2000
Product overview Military Advanced High-Speed CMOS Logic (AHC/AHCT) (Rev. C) 01 Apr 1998
Application note Migration From 3.3-V To 2.5-V Power Supplies For Logic Devices 01 Dez 1997
Application note Bus-Interface Devices With Output-Damping Resistors Or Reduced-Drive Outputs (Rev. A) 01 Aug 1997
Application note CMOS Power Consumption and CPD Calculation (Rev. B) 01 Jun 1997
Application note Live Insertion 01 Okt 1996

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

5-8-LOGIC-EVM — Generisches Logik-Evaluierungsmodul für 5- bis 8-polige DCK-, DCT-, DCU-, DRL- und DBV-Gehäuse

Flexibles EVM zur Unterstützung aller Geräte mit 5- bis 8-poligem DCK-, DCT-, DCU-, DRL- oder DBV-Gehäuse.
Benutzerhandbuch: PDF
Nicht verfügbar auf TI.com
Simulationsmodell

SN74AHCT1G02 Behavioral SPICE Model

SCLM247.ZIP (7 KB) - PSpice Model
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Simulationsmodell

SN74AHCT1G02 IBIS Model

SCLM012.ZIP (7 KB) - IBIS Model
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Gehäuse Pins CAD-Symbole, Footprints und 3D-Modelle
SOT-23 (DBV) 5 Ultra Librarian
SOT-SC70 (DCK) 5 Ultra Librarian
Es gelten die allgemeinen Geschäftsbedingungen von TI für Evaluierungsartikel.

Bestellen & Qualität

Beinhaltete Information:
  • RoHS
  • REACH
  • Bausteinkennzeichnung
  • Blei-Finish/Ball-Material
  • MSL-Rating / Spitzenrückfluss
  • MTBF-/FIT-Schätzungen
  • Materialinhalt
  • Qualifikationszusammenfassung
  • Kontinuierliches Zuverlässigkeitsmonitoring
Beinhaltete Information:
  • Werksstandort
  • Montagestandort

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Bei Fragen zu den Themen Qualität, Gehäuse oder Bestellung von TI-Produkten siehe TI-Support. ​​​​​​​​​​​​​​

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