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CD74AC14

ACTIVO

Inversores de 6 canales, 1,5 V a 5,5 V con entradas de disparador Schmitt

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CD74AC14

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Detalles del producto

Technology family AC Supply voltage (min) (V) 1.5 Supply voltage (max) (V) 5.5 Number of channels 6 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (µA) 80 Input type Schmitt-Trigger Output type Push-Pull Features Balanced outputs, Input clamp diode, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -55 to 125
Technology family AC Supply voltage (min) (V) 1.5 Supply voltage (max) (V) 5.5 Number of channels 6 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (µA) 80 Input type Schmitt-Trigger Output type Push-Pull Features Balanced outputs, Input clamp diode, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -55 to 125
PDIP (N) 14 181.42 mm² 19.3 x 9.4 SOIC (D) 14 51.9 mm² 8.65 x 6
  • 1.5V to 5.5V operation and balanced noise immunity at 30% of the supply voltage
  • Speed of bipolar F, AS, and S, with significantly reduced power consumption
  • Greater noise immunity than standard inverters
  • Operates with much slower than standard input rise and fall slew rates
  • Balanced propagation delays
  • ±24mA output drive current − fanout to 15 F devices
  • SCR latchup-resistant CMOS process and circuit design
  • 1.5V to 5.5V operation and balanced noise immunity at 30% of the supply voltage
  • Speed of bipolar F, AS, and S, with significantly reduced power consumption
  • Greater noise immunity than standard inverters
  • Operates with much slower than standard input rise and fall slew rates
  • Balanced propagation delays
  • ±24mA output drive current − fanout to 15 F devices
  • SCR latchup-resistant CMOS process and circuit design

The CD74AC14 contains six independent inverters.

The CD74AC14 contains six independent inverters.

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Documentación técnica

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Tipo Título Fecha
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Diseño y desarrollo

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Placa de evaluación

14-24-LOGIC-EVM — Módulo de evaluación genérico de productos lógicos para encapsulados D, DB, DGV, DW, DYY, NS y PW de

El módulo de evaluación 14-24-LOGIC-EVM (EVM) está diseñado para admitir cualquier dispositivo lógico que esté en un encapsulado D, DW, DB, NS, PW, DYY o DGV de 14 a 24 pines.

Guía del usuario: PDF | HTML
No disponible en TI.com
Modelo de simulación

CD74AC14 Behavioral SPICE Model

SCHM039.ZIP (7 KB) - PSpice Model
Descargar
Encapsulado Pines Símbolos CAD, huellas y modelos 3D
PDIP (N) 14 Ultra Librarian
SOIC (D) 14 Ultra Librarian
Se aplican los Términos y condiciones estándar de TI para los elementos de evaluación.

Pedidos y calidad

Información incluida:
  • RoHS
  • REACH
  • Marcado del dispositivo
  • Acabado de plomo/material de la bola
  • Clasificación de nivel de sensibilidad a la humedad (MSL) / reflujo máximo
  • Estimaciones de tiempo medio entre fallas (MTBF)/fallas en el tiempo (FIT)
  • Contenido del material
  • Resumen de calificaciones
  • Monitoreo continuo de confiabilidad
Información incluida:
  • Lugar de fabricación
  • Lugar de ensamblaje

Soporte y capacitación

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