DSLVDS1048
- 最大400Mbpsの信号速度用に設計
- フロースルーのピン配置によりPCBレイアウトを簡素化
- チャネル間スキュー: 150ps (標準値)
- 差動スキュー: 100ps (標準値)
- 最大伝搬遅延: 2.7ns
- 3.3V電源の設計
- 電源オフ時にLVDS入力が高インピーダンス
- 低消費電力の設計(3.3V静的で40mW)
- 既存の5V LVDSドライバと相互運用可能
- 小振幅(標準値350mV)の差動信号レベルを許容
- 入力フェイルセーフのサポート
- オープン、短絡、および終端
- 0V～−100mVのスレッショルド領域
- 動作温度範囲: -40°C～+85°C
- ANSI/TIA/EIA-644規格を満たすか上回る
- TSSOPパッケージで供給
DSLVDS1048デバイスは、クワッドCMOSフロースルー差動ライン・レシーバで、非常に低い消費電力と高いデータ速度を必要とするアプリケーション用に設計されています。このデバイスは、低電圧差動信号(LVDS)テクノロジを活用し、400Mbps (200MHz)を超えるデータ転送速度をサポートするよう設計されています。
DSLVDS1048は低電圧（標準値350mV）の差動入力信号を受け付け、3V CMOS出力レベルに変換します。レシーバはTRI-STATE機能をサポートしており、出力の多重化に使用できます。また、レシーバはオープン、短絡、終端(100Ω)の入力フェイルセーフもサポートします。すべてのフェイルセーフ条件において、レシーバの出力はHIGHになります。DSLVDS1048はフロースルーのピン配置を採用しているため、PCBレイアウトが簡単になります。
ENおよびEN*入力は互いにAND接続され、TRI-STATE出力を制御します。イネーブルは4つのレシーバすべてに共通です。DSLVDS1048およびコンパニオンLVDSライン・ドライバ（例: DSLVDS1047）は、大電力のPECL/ECLデバイスの新しい代替品として、高速のポイント・ツー・ポイント・インターフェイス・アプリケーションに使用できます。
技術資料
| 種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
|---|---|---|---|---|---|---|
| * | データシート | DSLVDS1048 3.3V LVDSクワッド・チャネル高速差分ライン・レシーバ データシート | PDF | HTML | 英語版 | PDF | HTML | 2018年 10月 1日 |
| アプリケーション・ノート | Applications of Low-Voltage Differential Signaling (LVDS) in LED Walls | 2020年 10月 29日 | ||||
| アプリケーション・ノート | Applications of Low-Voltage Differential Signaling (LVDS) in Ultrasound Scanners | 2019年 6月 29日 | ||||
| アプリケーション概要 | LVDS to Improve EMC in Motor Drives | 2018年 9月 27日 | ||||
| アプリケーション概要 | How Far, How Fast Can You Operate LVDS Drivers and Receivers? | 2018年 8月 3日 | ||||
| アプリケーション概要 | How to Terminate LVDS Connections with DC and AC Coupling | 2018年 5月 16日 |
設計および開発
その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。
DSLVDS1047-1048EVM — クワッド・チャネル LVDS ドライバ / レシーバの評価モジュール
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| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| TSSOP (PW) | 16 | Ultra Librarian |
購入と品質
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用原材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
- ファブの拠点
- 組み立てを実施した拠点
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。