CDCBT1001

Name: CDCBT1001
Brand: TI
SKU: CDCBT1001
Price: 0.5 USD

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1.2V~1.8V 클록 버퍼 및 레벨 변환기

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CDCBT1001

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제품 상세 정보

Function

Level translator, Single-ended

Output frequency (max) (MHz)

Number of outputs

Output supply voltage (V)

1.8

Core supply voltage (V)

1.2

Features

1.2V to 1.8V Clock Buffer and Level Translator

Operating temperature range (°C)

-40 to 85

Rating

Catalog

Output type

LVCMOS

Input type

LVCMOS

Function

Level translator, Single-ended

Output frequency (max) (MHz)

Number of outputs

Output supply voltage (V)

1.8

Core supply voltage (V)

1.2

Features

1.2V to 1.8V Clock Buffer and Level Translator

Operating temperature range (°C)

-40 to 85

Rating

Catalog

Output type

LVCMOS

Input type

LVCMOS

X2SON (DPW)

0.64 mm² 0.8 x 0.8

Clock frequency range: DC to 24 MHz
1.2-V to 1.8-V LVCMOS clock level translation:
- VDD_IN = 1.2 V ± 10%
- VDD_OUT = 1.8 V ± 10%
Low additive jitter and phase noise:
- 0.8-ps maximum 12-kHz to 5-MHz additive RMS jitter (f_out = 24 MHz)
- –120-dBc/Hz maximum phase noise at 1-kHz offset (f_out = 24 MHz)
- –148-dBc/Hz maximum phase noise floor (f_out = 24 MHz, f_offset ≥ 1 MHz)
5-ns 20% to 80% rise/fall time
10-ns propagation delay
Low current consumption
–40°C to 85°C operating temperature range

Clock frequency range: DC to 24 MHz
1.2-V to 1.8-V LVCMOS clock level translation:
- VDD_IN = 1.2 V ± 10%
- VDD_OUT = 1.8 V ± 10%
Low additive jitter and phase noise:
- 0.8-ps maximum 12-kHz to 5-MHz additive RMS jitter (f_out = 24 MHz)
- –120-dBc/Hz maximum phase noise at 1-kHz offset (f_out = 24 MHz)
- –148-dBc/Hz maximum phase noise floor (f_out = 24 MHz, f_offset ≥ 1 MHz)
5-ns 20% to 80% rise/fall time
10-ns propagation delay
Low current consumption
–40°C to 85°C operating temperature range

The CDCBT1001 is a 1.2-V to 1.8-V clock buffer and level translator. The VDD_IN pin supply voltage defines the input LVCMOS clock level. The VDD_OUT pin supply voltage defines the output LVCMOS clock level. VDD_IN = 1.2 V ± 10%. VDD_OUT = 1.8 V ± 10%

The 12-kHz to 5-MHz additive RMS jitter at 24 MHz is less than 0.8 ps.

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기술 자료

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3개 모두 보기

	유형	직함		날짜
*	Data sheet	CDCBT1001 1.2-V to 1.8-V Clock Buffer and Level Translator datasheet	PDF \| HTML	2022/05/20
	EVM User's guide	CDCBT1001EVM Evaluation Instructions	PDF \| HTML	2022/05/16
	Certificate	CDCBT1001EVM EU RoHS Declaration of Conformity (DoC)		2022/03/25

설계 및 개발

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시뮬레이션 모델

CDCBT1001 IBIS model

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시뮬레이션 툴

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TI용 PSpice®는 아날로그 회로의 기능을 평가하는 데 사용되는 설계 및 시뮬레이션 환경입니다. 완전한 기능을 갖춘 이 설계 및 시뮬레이션 제품군은 Cadence®의 아날로그 분석 엔진을 사용합니다. 무료로 제공되는 TI용 PSpice에는 아날로그 및 전력 포트폴리오뿐 아니라 아날로그 행동 모델에 이르기까지 업계에서 가장 방대한 모델 라이브러리 중 하나가 포함되어 있습니다.

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