SN74LV125A
- 2-V to 5.5-V VCC Operation
- Max tpd of 6 ns at 5 V
- Typical VOLP (Output Ground Bounce) < 0.8 V at VCC = 3.3 V, TA = 25°C
- Typical VOHV (Output VOH Undershoot) > 2.3 V at VCC = 3.3 V, TA = 25°C
- Support Mixed-Mode Voltage Operation on All Ports
- Ioff Supports Partial-Power-Down Mode Operation
- Latch-Up Performance Exceeds 250 mA Per JESD 17
- ESD Protection Exceeds JESD 22
- 4000-V Human-Body Model
- 200-V Machine Model
- 2000-V Charged-Device Model
The SN74LV125A quadruple bus buffer gate is designed for 2-V to 5.5-V VCC operation.
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|---|---|---|---|---|
| * | Data sheet | SN74LV125A Quadruple Bus Buffer Gates With 3-State Outputs datasheet (Rev. O) | PDF | HTML | 2022年 5月 4日 |
設計與開發
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開發板
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訂購與品質
內含資訊：
- RoHS
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- 產品標記
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- MSL 等級/回焊峰值
- MTBF/FIT 估算值
- 材料內容
- 認證摘要
- 進行中持續性的可靠性監測
內含資訊：
- 晶圓廠位置
- 組裝地點