JAJSPU0B February   2023  – December 2023 TPS7H3302-SEP , TPS7H3302-SP

PRODUCTION DATA  

  1.   1
  2. 1 特長
  3. 2 アプリケーション
  4. 3 概要
  5. 4 Device Options
  6. 5 Pin Configuration and Functions
  7. 6 Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Typical Characteristics
  8. 7 Detailed Description
    1. 7.1 Overview
    2. 7.2 Functional Block Diagram
    3. 7.3 Feature Description
      1. 7.3.1 VTT Sink and Source Regulator
      2. 7.3.2 Reference Input (VDDQSNS)
      3. 7.3.3 Reference Output (VTTREF)
      4. 7.3.4 EN Control (EN)
      5. 7.3.5 Power-Good Function (PGOOD)
      6. 7.3.6 VTT Current Protection
      7. 7.3.7 VIN UVLO Protection
      8. 7.3.8 Thermal Shutdown
    4. 7.4 Device Functional Modes
  9. 8 Application and Implementation
    1. 8.1 Application Information
    2. 8.2 Typical Application
      1. 8.2.1 Design Requirements
      2. 8.2.2 Detailed Design Procedure
        1. 8.2.2.1 VDD Capacitor
        2. 8.2.2.2 VLDO Input Capacitor
        3. 8.2.2.3 VTT Output Capacitor
        4. 8.2.2.4 VTTSNS Connection
        5. 8.2.2.5 Low VDD Applications
        6. 8.2.2.6 S3 and Pseudo-S5 Support
        7. 8.2.2.7 Tracking Startup and Shutdown
        8. 8.2.2.8 Output Tolerance Consideration for VTT DIMM or Module Applications
        9. 8.2.2.9 LDO Design Guidelines
      3. 8.2.3 Application Curve
    3. 8.3 Power Supply Recommendations
    4. 8.4 Layout
      1. 8.4.1 Layout Guidelines
      2. 8.4.2 Layout Example
      3. 8.4.3 Thermal Considerations
  10. 9 Device and Documentation Support
    1. 9.1 Documentation Support
      1. 9.1.1 Related Documentation
    2. 9.2 Receiving Notification of Documentation Updates
    3. 9.3 サポート・リソース
    4. 9.4 Trademarks
    5. 9.5 静電気放電に関する注意事項
    6. 9.6 用語集
  11. 10Revision History
  12. 11Mechanical, Packaging, and Orderable Information

パッケージ・オプション

デバイスごとのパッケージ図は、PDF版データシートをご参照ください。

メカニカル・データ（パッケージ｜ピン）
  • DAP|32
サーマルパッド・メカニカル・データ
発注情報

3 概要

TPS7H3302 は、耐放射線性のダブル データ レート (DDR) 3A ターミネーション レギュレータで、VTTREF バッファが内蔵されています。このレギュレータは、シングル ボード コンピュータ、ソリッド ステート レコーダ、ペイロード処理などの宇宙向け DDR 終端アプリケーション用に、包括的でコンパクトな低ノイズ ソリューションを提供するように特化して設計されています。

TPS7H3302 は DDR、DDR2、DDR3、DDR3L、DDR4 を使用する DDR VTT 終端アプリケーションをサポートしています。TPS7H3302 VTT レギュレータの高速過度応答により、読み取り / 書き込み状況で非常に安定した電源を実現できます。また、TPS7H3302 には、VTT をトラッキングしてソリューション サイズをさらに縮小する VTTREF 電源も内蔵されています。シンプルな電源シーケンスを実現するために、TPS7H3302 にはイネーブル入力とパワー グッド出力 (PGOOD) の両方が内蔵されています。イネーブル信号を使用して、Suspend to RAM (S3) パワーダウン モードで VTT を放電することもできます。

製品情報
部品番号 (1) グレード パッケージ (2)
5962R1422802PYE QMLP-RHA HTSSOP (32)
6.10mm × 11.00mm
質量 = 0.184g
TPS7H3302MDAPTSEP SEP
TPS7H3302EVM 評価ボード EVM
(1) 追加情報は、Device Options の表をご覧ください。
(2) 寸法と質量の値は公称値です。
GUID-20230315-SS0I-33TC-J05B-LGSB3J6XT0GL-low.svgDDR アプリケーションの簡略回路図