Produktdetails

Package name SOT-5X3 Peak pulse power (8/20 μs) (max) (W) 25 Vrwm (V) 5 Bi-/uni-directional Uni-Directional Number of channels 4 IO capacitance (typ) (pF) 11 IEC 61000-4-2 contact (±V) 15000 IEC 61000-4-5 (A) 2.5 Clamping voltage (V) 30 Dynamic resistance (typ) 2 Interface type GPIO, General purpose Breakdown voltage (min) (V) 6.1 IO leakage current (max) (nA) 100 Rating Catalog Operating temperature range (°C) -40 to 125
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SOT-5X3 (DRL) 5 2.56 mm² 1.6 x 1.6
  • IEC 61000-4-2 ESD Protection
    • ±15-kV IEC 61000-4-2 Contact Discharge
  • IEC 61000-4-5 Surge Protection
    • 2.5-A Peak Pulse Current (8/20-µs Pulse)
  • ANSI/ESDA/JEDEC JS-001
    • ±15-kV Human Body Model (HBM)
  • Four Unidirectional Voltage Suppression Diodes for use in ESD Protection
  • I/O Breakdown Voltage, VBR = 6.1 V (Minimum)
  • I/O Capacitance 11 pF (Typical)
  • Low Leakage Current < 100 nA
  • Very Small Printed-Circuit Board (PCB) Area < 2.6 mm2
  • High Integration
  • Suitable for High-Density Boards
  • IEC 61000-4-2 ESD Protection
    • ±15-kV IEC 61000-4-2 Contact Discharge
  • IEC 61000-4-5 Surge Protection
    • 2.5-A Peak Pulse Current (8/20-µs Pulse)
  • ANSI/ESDA/JEDEC JS-001
    • ±15-kV Human Body Model (HBM)
  • Four Unidirectional Voltage Suppression Diodes for use in ESD Protection
  • I/O Breakdown Voltage, VBR = 6.1 V (Minimum)
  • I/O Capacitance 11 pF (Typical)
  • Low Leakage Current < 100 nA
  • Very Small Printed-Circuit Board (PCB) Area < 2.6 mm2
  • High Integration
  • Suitable for High-Density Boards

The TPD4E002 device is a transient voltage suppressor (TVS) designed to protect up to four lines against electrostatic discharge (ESD) transients. The monolithic circuit design allows superior capacitance matching between the channels and reduced crosstalk. This device is ideal for applications where both reduced line capacitance and board space-saving are required.

The TPD4E002 device is a transient voltage suppressor (TVS) designed to protect up to four lines against electrostatic discharge (ESD) transients. The monolithic circuit design allows superior capacitance matching between the channels and reduced crosstalk. This device is ideal for applications where both reduced line capacitance and board space-saving are required.

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Typ Titel Datum
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Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

ESDEVM — ESD-Evaluierungsmodul

Das Evaluierungsmodul für elektrostatisch empfindliche Bausteine (ESD) ist eine Entwicklungsplattform für die meisten unserer ESD-Produkte. Die Platine wird mit allen herkömmlichen ESD-Footprints geliefert, um eine beliebige Anzahl von Bausteinen zu testen. Bukönnen auf ihre jeweiligen Abmessung (...)
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PMP40280 — Bi-direktionale Batterie-Initialisierungssystem-Steuerplatine – Referenzdesign

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Test report: PDF
Schaltplan: PDF
Gehäuse Pins CAD-Symbole, Footprints und 3D-Modelle
SOT-5X3 (DRL) 5 Ultra Librarian

Bestellen & Qualität

Beinhaltete Information:
  • RoHS
  • REACH
  • Bausteinkennzeichnung
  • Blei-Finish/Ball-Material
  • MSL-Rating / Spitzenrückfluss
  • MTBF-/FIT-Schätzungen
  • Materialinhalt
  • Qualifikationszusammenfassung
  • Kontinuierliches Zuverlässigkeitsmonitoring
Beinhaltete Information:
  • Werksstandort
  • Montagestandort

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