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TPL7407LA

ACTIVO

Controlador de lado bajo de matriz NMOS de 30 V y 7 canales

Detalles del producto

Rating Catalog Operating temperature range (°C) -40 to 125 Drivers per package 7 Switching voltage (max) (V) 32 Output voltage (max) (V) 30 Peak output current (A) 0.5 Delay time (typ) (ns) 250 Input compatibility CMOS, TTL Vol at lowest spec current (typ) (mV) 210 Iout/ch (max) (mA) 600 Iout_off (typ) (µA) 0.01
Rating Catalog Operating temperature range (°C) -40 to 125 Drivers per package 7 Switching voltage (max) (V) 32 Output voltage (max) (V) 30 Peak output current (A) 0.5 Delay time (typ) (ns) 250 Input compatibility CMOS, TTL Vol at lowest spec current (typ) (mV) 210 Iout/ch (max) (mA) 600 Iout_off (typ) (µA) 0.01
SOIC (D) 16 59.4 mm² 9.9 x 6 TSSOP (PW) 16 32 mm² 5 x 6.4
  • 600-mA Rated Drain Current (Per Channel)
  • CMOS Pin-to-Pin Improvement of 7-channel Darlington Array (For example: ULN2003A)
  • Power Efficient (Very low VOL)
    • Less Than 4 Times Lower VOL at 100 mA Than Darlington Array
  • Very Low Output Leakage < 10 nA Per Channel
  • Extended Ambient Temperature Range:
    TA = –40°C to +125°C
  • High-Voltage Outputs 30 V
  • Compatible with 1.8-V to 5-V Microcontroller and Logic Interface
  • Internal Free-wheeling Diodes for Inductive Kick-back Protection
  • Input Pull-down Resistors Allows Tri-stating the Input Driver
  • Input RC-Snubber to Eliminate Spurious Operation in Noisy Environment
  • Inductive Load Driver Applications
  • ESD Protection Exceeds JESD 22
    • 2-kV HBM, 500-V CDM
  • Available in 16-pin SOIC and TSSOP packages
  • 600-mA Rated Drain Current (Per Channel)
  • CMOS Pin-to-Pin Improvement of 7-channel Darlington Array (For example: ULN2003A)
  • Power Efficient (Very low VOL)
    • Less Than 4 Times Lower VOL at 100 mA Than Darlington Array
  • Very Low Output Leakage < 10 nA Per Channel
  • Extended Ambient Temperature Range:
    TA = –40°C to +125°C
  • High-Voltage Outputs 30 V
  • Compatible with 1.8-V to 5-V Microcontroller and Logic Interface
  • Internal Free-wheeling Diodes for Inductive Kick-back Protection
  • Input Pull-down Resistors Allows Tri-stating the Input Driver
  • Input RC-Snubber to Eliminate Spurious Operation in Noisy Environment
  • Inductive Load Driver Applications
  • ESD Protection Exceeds JESD 22
    • 2-kV HBM, 500-V CDM
  • Available in 16-pin SOIC and TSSOP packages

The TPL7407LA is a high-voltage, high-current NMOS transistor array. This device consists of seven NMOS transistors that feature high-voltage outputs with common-cathode clamp diodes for switching inductive loads. The maximum drain-current rating of a single NMOS channel is 600 mA. New regulation and drive circuitry added to give maximum drive strength across all GPIO ranges (1.8 V–5 V).The transistors can be paralleled for higher current capability.

The TPL7407LA key benefit is its improved power efficiency and lower leakage than a Bipolar Darlington Implementation. With the lower VOL the user is dissipating less than half the power than traditional relay drivers with currents less than 250 mA per channel.

The TPL7407LA is a high-voltage, high-current NMOS transistor array. This device consists of seven NMOS transistors that feature high-voltage outputs with common-cathode clamp diodes for switching inductive loads. The maximum drain-current rating of a single NMOS channel is 600 mA. New regulation and drive circuitry added to give maximum drive strength across all GPIO ranges (1.8 V–5 V).The transistors can be paralleled for higher current capability.

The TPL7407LA key benefit is its improved power efficiency and lower leakage than a Bipolar Darlington Implementation. With the lower VOL the user is dissipating less than half the power than traditional relay drivers with currents less than 250 mA per channel.

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Documentación técnica

star =Principal documentación para este producto seleccionada por TI
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Tipo Título Fecha
* Data sheet TPL7407LA 30-V 7-Channel Low Side Driver datasheet (Rev. A) PDF | HTML 28 mar 2018
E-book 11 Ways to Protect Your Power Path 03 jul 2019
Application note Basics of Power Switches (Rev. A) PDF | HTML 26 abr 2019

Diseño y desarrollo

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Placa de evaluación

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Esquema: PDF
Encapsulado Pines Símbolos CAD, huellas y modelos 3D
SOIC (D) 16 Ultra Librarian
TSSOP (PW) 16 Ultra Librarian

Pedidos y calidad

Información incluida:
  • RoHS
  • REACH
  • Marcado del dispositivo
  • Acabado de plomo/material de la bola
  • Clasificación de nivel de sensibilidad a la humedad (MSL) / reflujo máximo
  • Estimaciones de tiempo medio entre fallas (MTBF)/fallas en el tiempo (FIT)
  • Contenido del material
  • Resumen de calificaciones
  • Monitoreo continuo de confiabilidad
Información incluida:
  • Lugar de fabricación
  • Lugar de ensamblaje

Los productos recomendados pueden tener parámetros, módulos de evaluación o diseños de referencia relacionados con este producto de TI.

Soporte y capacitación

Foros de TI E2E™ con asistencia técnica de los ingenieros de TI

El contenido lo proporcionan “tal como está” TI y los colaboradores de la comunidad y no constituye especificaciones de TI. Consulte los términos de uso.

Si tiene preguntas sobre la calidad, el paquete o el pedido de productos de TI, consulte el soporte de TI. ​​​​​​​​​​​​​​

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