TIDA-00074

高帯域、RF-ディジタル・コンプレックス・レシーバ・フィードバック信号チェーン

TIDA-00074

設計ファイル

概要

This is a wideband complex-receiver reference design and evaluation platform that is ideally suited for use as a feedback receiver for transmitter digital predistortion. The EVM signal chain is ideal for high intermediate-frequency (IF) complex-feedback applications and contains a complex demodulator, TI’s LMH6521 dual-channel DVGA and ADS5402 12-bit 800-MSPS dual-channel ADC. By modifying the onboard filter components, the signal chain is configurable for a variety of frequency plans. The EVM also includes TI’s LMK04808 dual-PLL clock jitter cleaner and generator to provide an onboard low-noise clocking solution. The LMH6521 DVGA gain is controlled through the GUI or alternatively through the high speed connector with an FPGA.

特長
  • Complete RF to digital complex wideband receiver solution
  • Up to 800MHz of contiguous spectrum can be sampled
  • Default configuration of RF input from 1800M to 2400M, options for 700M to 3GHz
  • Onboard DVGA for gain control
  • Easy evaluation platform with TSW1400 and HSDC Pro analysis software
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組み立てられたボードは、テストと性能検証のみの目的で開発されたものであり、販売していません。

設計ファイルと製品

設計ファイル

すぐに使用できるシステム・ファイルをダウンロードすると、設計プロセスを迅速化できます。

TIDU127.PDF (351 K)

リファレンス・デザインの概要と検証済みの性能テスト・データ

TIDR578.PDF (118 K)

設計レイアウトとコンポーネントを示した詳細な回路図

SLAR071.ZIP (5031 K)

設計レイアウトとコンポーネントを示した詳細な回路図

TIDR579.PDF (137 K)

設計に使用したコンポーネント、参照指定子、メーカー名や型番などを記入した詳細なリスト

TIDR581.ZIP (2754 K)

コンポーネントの配置を明示する詳細な設計レイアウト

TIDC404.ZIP (849 K)

PCB 設計の基板層に関する情報を記載した設計ファイル

TIDR580.ZIP (2975 K)

PCB 設計レイアウトを生成するための PCB 基板層のプロット・ファイル

製品

設計や代替製品候補に TI 製品を含めます。

高速 ADC(≧10 MSPS)

ADS5402デュアル・チャネル、12 ビット、800MSPS AD コンバータ(ADC)

データシート: PDF
LVDS、M-LVDS、PECL の各 IC

SN65LVDS1002-Gbps、LVDS と LVPECL と CML から LVDS への変換バッファ / リピータ / レベル・シフタ

データシート: PDF | HTML
MOSFET

CSD17313Q22mm x 2mm の SON 封止、シングル、32mΩ、30V、N チャネル NexFET™ パワー MOSFET

データシート: PDF | HTML
RF VGA

LMH6521高性能、2 回路、DVGA

データシート: PDF | HTML
eFuse とホット・スワップ・コントローラ

TPS2400100V の入力過渡保護機能搭載、5.5V の過電圧保護コントローラ

データシート: PDF | HTML
クロック ジッタ クリーナ

LMK04803デュアル・カスケード接続 PLL と 1.9GHz VCO 内蔵、低ノイズのクロック・ジッタ・クリーナ

データシート: PDF | HTML
リニア・レギュレータと低ドロップアウト (LDO) レギュレータ

TPS767イネーブルとリセットとディレイ機能搭載、1A、10V、低ドロップアウト電圧レギュレータ

データシート: PDF | HTML
リニア・レギュレータと低ドロップアウト (LDO) レギュレータ

TPS7A80低静止電流 (IQ)、イネーブル搭載、1A、高 PSRR、超低ドロップアウト電圧レギュレータ

データシート: PDF | HTML

技術資料

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種類 タイトル 英語版のダウンロード 日付
設計ガイド TSW1266 Wideband RF-to-Digital Complex Receiver-Feedback Signal Chain 2013年 9月 3日

サポートとトレーニング

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