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SN74LV1T125

ACTIVO

PUERTA DE BÚFER única con salida de 3 estados (activación baja activa) y fuente de alimentación únic

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SN74LV1T125

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Detalles del producto

Technology family LV1T Applications GPIO, I2S, UART Bits (#) 1 Configuration 1 Ch A to B 0 Ch B to A High input voltage (min) (V) 1 High input voltage (max) (V) 5.5 Vout (min) (V) 0 Vout (max) (V) 5.5 Data rate (max) (Mbps) 100 IOH (max) (mA) -8 IOL (max) (mA) -8 Supply current (max) (µA) 5.5 Features 4.2, 4.64 Input type TTL-Compatible CMOS Output type 3-State, Balanced CMOS Rating Catalog Operating temperature range (°C) -40 to 125
Technology family LV1T Applications GPIO, I2S, UART Bits (#) 1 Configuration 1 Ch A to B 0 Ch B to A High input voltage (min) (V) 1 High input voltage (max) (V) 5.5 Vout (min) (V) 0 Vout (max) (V) 5.5 Data rate (max) (Mbps) 100 IOH (max) (mA) -8 IOL (max) (mA) -8 Supply current (max) (µA) 5.5 Features 4.2, 4.64 Input type TTL-Compatible CMOS Output type 3-State, Balanced CMOS Rating Catalog Operating temperature range (°C) -40 to 125
SOT-23 (DBV) 5 8.12 mm² 2.9 x 2.8 SOT-SC70 (DCK) 5 4.2 mm² 2 x 2.1
  • Single-supply voltage translator at 5V, 3.3V, 2.5V, and 1.8V VCC
  • Operating range of 1.8V to 5.5V
  • Up translation:
    • 1.2V(1) to 1.8V at 1.8V VCC
    • 1.5V(1) to 2.5V at 2.5V VCC
    • 1.8V(1) to 3.3V at 3.3V VCC
    • 3.3V to 5.0V at 5.0V VCC
  • Down translation:
    • 3.3V to 1.8V at 1.8V VCC
    • 3.3V to 2.5V at 2.5V VCC
    • 5.0V to 3.3V at 3.3V VCC
  • Logic output is referenced to VCC
  • Output drive:
    • 8.0mA output drive at 5V
    • 7.0mA output drive at 3.3V
    • 3.0mA output drive at 1.8V
  • Characterized up to 50MHz at 3.3V VCC
  • 5.0V tolerance on input pins
  • –40°C to 125°C operating temperature range
  • Latch-up performance exceeds 250mA per JESD 17
  • Supports standard logic pinouts
  • CMOS output B compatible with AUP1G and LVC1G families (1)

(1)Refer to the VIH/VIL and output drive for lower VCC condition.
  • Single-supply voltage translator at 5V, 3.3V, 2.5V, and 1.8V VCC
  • Operating range of 1.8V to 5.5V
  • Up translation:
    • 1.2V(1) to 1.8V at 1.8V VCC
    • 1.5V(1) to 2.5V at 2.5V VCC
    • 1.8V(1) to 3.3V at 3.3V VCC
    • 3.3V to 5.0V at 5.0V VCC
  • Down translation:
    • 3.3V to 1.8V at 1.8V VCC
    • 3.3V to 2.5V at 2.5V VCC
    • 5.0V to 3.3V at 3.3V VCC
  • Logic output is referenced to VCC
  • Output drive:
    • 8.0mA output drive at 5V
    • 7.0mA output drive at 3.3V
    • 3.0mA output drive at 1.8V
  • Characterized up to 50MHz at 3.3V VCC
  • 5.0V tolerance on input pins
  • –40°C to 125°C operating temperature range
  • Latch-up performance exceeds 250mA per JESD 17
  • Supports standard logic pinouts
  • CMOS output B compatible with AUP1G and LVC1G families (1)

(1)Refer to the VIH/VIL and output drive for lower VCC condition.

The SN74LV1T125 is a single buffer gate with reduced input thresholds to support voltage translation applications.

The SN74LV1T125 is a single buffer gate with reduced input thresholds to support voltage translation applications.
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Documentación técnica

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Tipo Título Fecha
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Diseño y desarrollo

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Placa de evaluación

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Guía del usuario: PDF
No disponible en TI.com
Modelo de simulación

SN74LV1T125 Behavioral SPICE Model

SCLM183.ZIP (7 KB) - PSpice Model
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Modelo de simulación

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SCLM109.ZIP (49 KB) - IBIS Model
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Design guide: PDF
Esquema: PDF
Encapsulado Pines Símbolos CAD, huellas y modelos 3D
SOT-23 (DBV) 5 Ultra Librarian
SOT-SC70 (DCK) 5 Ultra Librarian
Se aplican los Términos y condiciones estándar de TI para los elementos de evaluación.

Pedidos y calidad

Información incluida:
  • RoHS
  • REACH
  • Marcado del dispositivo
  • Acabado de plomo/material de la bola
  • Clasificación de nivel de sensibilidad a la humedad (MSL) / reflujo máximo
  • Estimaciones de tiempo medio entre fallas (MTBF)/fallas en el tiempo (FIT)
  • Contenido del material
  • Resumen de calificaciones
  • Monitoreo continuo de confiabilidad
Información incluida:
  • Lugar de fabricación
  • Lugar de ensamblaje

Soporte y capacitación

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