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SN74AHC139

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Dual 2-line to 4-line demultiplexer and decoder

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製品詳細

Technology family AHC Number of channels 2 Operating temperature range (°C) -40 to 125 Rating Catalog Supply current (max) (µA) 40
Technology family AHC Number of channels 2 Operating temperature range (°C) -40 to 125 Rating Catalog Supply current (max) (µA) 40
PDIP (N) 16 181.42 mm² 19.3 x 9.4 SOIC (D) 16 59.4 mm² 9.9 x 6 SOP (NS) 16 79.56 mm² 10.2 x 7.8 SSOP (DB) 16 48.36 mm² 6.2 x 7.8 TSSOP (PW) 16 32 mm² 5 x 6.4 TVSOP (DGV) 16 23.04 mm² 3.6 x 6.4 VQFN (RGY) 16 14 mm² 4 x 3.5
  • 動作範囲：2V～5.5V
  • 高速メモリ デコーダおよびデータ伝送システム専用に設計
  • 2 つのイネーブル入力を備え、カスケード接続やデータ受信を簡素化
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • JESD 22 を上回る ESD 保護：
    • 2000V、人体モデル (A114-A)
    • 1000V、デバイス帯電モデル (C101)
  • 動作範囲：2V～5.5V
  • 高速メモリ デコーダおよびデータ伝送システム専用に設計
  • 2 つのイネーブル入力を備え、カスケード接続やデータ受信を簡素化
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • JESD 22 を上回る ESD 保護：
    • 2000V、人体モデル (A114-A)
    • 1000V、デバイス帯電モデル (C101)

SN74AHC139 は、2V～5.5V の VCC で動作するよう設計されたデュアル 2 ライン入力 4 ライン出力のデコーダ / デマルチプレクサです。これらのデバイスは、伝搬遅延時間を極めて短くする必要がある、高性能メモリ デコーディングやデータ ルーティングの用途に適しています。高性能メモリ システムでは、このデコーダを使用することにより、システム デコードの影響を最小限にとどめられます。高速イネーブル回路を利用して高速メモリと組み合わせて使う場合、これらのデコーダの遅延時間とメモリのイネーブル時間は、通例、メモリの標準的なアクセス時間を下回ります。すなわち、このデコーダによる実質的なシステム遅延時間は無視できるということです。

SN74AHC139 は、2V～5.5V の VCC で動作するよう設計されたデュアル 2 ライン入力 4 ライン出力のデコーダ / デマルチプレクサです。これらのデバイスは、伝搬遅延時間を極めて短くする必要がある、高性能メモリ デコーディングやデータ ルーティングの用途に適しています。高性能メモリ システムでは、このデコーダを使用することにより、システム デコードの影響を最小限にとどめられます。高速イネーブル回路を利用して高速メモリと組み合わせて使う場合、これらのデコーダの遅延時間とメモリのイネーブル時間は、通例、メモリの標準的なアクセス時間を下回ります。すなわち、このデコーダによる実質的なシステム遅延時間は無視できるということです。
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技術資料

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設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板

14-24-logic-EVM 評価基板は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。

ユーザー ガイド: PDF | HTML
TI.com で取り扱いなし
評価ボード

14-24-NL-LOGIC-EVM — 14 ピンから 24 ピンのリードなしパッケージ向け、ロジック製品の汎用評価基板

14-24-NL-LOGIC-EVM は、14 ピンから24 ピンの BQA、BQB、RGY、RSV、RJW、RHL の各パッケージに封止した各種ロジック デバイスや変換デバイスをサポートする設計を採用したフレキシブルな評価基板 (EVM) です。

ユーザー ガイド: PDF | HTML
TI.com で取り扱いなし
シミュレーション・モデル

HSPICE MODEL OF SN74AHC139

SCEJ188.ZIP (114 KB) - HSpice Model
ダウンロード
シミュレーション・モデル

SN74AHC139 IBIS Model

SCEM488.ZIP (26 KB) - IBIS Model
ダウンロード
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
PDIP (N) 16 Ultra Librarian
SOIC (D) 16 Ultra Librarian
SOP (NS) 16 Ultra Librarian
SSOP (DB) 16 Ultra Librarian
TSSOP (PW) 16 Ultra Librarian
TVSOP (DGV) 16 Ultra Librarian
VQFN (RGY) 16 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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