DS90LVRA2
- 600 Mbps (300 MHz) switching rates
- 50 ps differential skew (typical)
- 0.1 ns channel-to-channel skew (typical)
- 1.8 V power supply
- Flow-through pinout
- Power down high impedance on LVDS inputs
- Output slew rate control
- LVDS inputs accept LVDS/CML/LVPECL signals
- Conforms to ANSI/TIA/EIA-644 standard
- Pin compatible with DS90LV028A-Q1
- OPN variants
- Standard: 0°C to 70°C
- Industrial: -40°C to +85°C
The DS90LVRA2 is a dual CMOS differential line receiver designed for applications requiring high input common mode range, high data rates and CMOS output with slew rate control. The device is designed to support data rates of 600 Mbps (300 MHz) utilizing Low Voltage Differential Signaling (LVDS) technology.
The DS90LVRA2 accepts low voltage (350 mV typical) differential input signals and translates them to 1.8 V CMOS output levels depending on power supply voltage. The DS90LVRA2 has a flow-through design for easy PCB layout.
The DS90LVRA2 and companion LVDS line driver DS90LV027AQ provide a new alternative to high power PECL/ECL devices for high speed point-to-point interface applications.
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기술 자료
| 유형 | 직함 | 날짜 | ||
|---|---|---|---|---|
| * | Data sheet | DS90LVRA2 LVDS Dual Differential Line Receiver datasheet | PDF | HTML | 2022/12/19 |
| Application brief | Level Shift No More: Support Low Voltage I/O Signals into a FPGA, Processor, or ASIC (Rev. A) | PDF | HTML | 2024/08/15 | |
| Application brief | Enabling LVDS Links for Low Power FPGAs, Processors, and ASIC Implementations (Rev. A) | PDF | HTML | 2024/03/25 | |
| EVM User's guide | DS90LVRA2 EVM User's Guide | PDF | HTML | 2022/11/22 | |
| Certificate | DS90LVRA2EVM EU RoHS Declaration of Conformity (DoC) | 2022/11/17 |
설계 및 개발
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| 패키지 | 핀 | CAD 기호, 풋프린트 및 3D 모델 |
|---|---|---|
| WSON (DEM) | 8 | Ultra Librarian |
주문 및 품질
- RoHS
- REACH
- 디바이스 마킹
- 납 마감/볼 재질
- MSL 등급/피크 리플로우
- MTBF/FIT 예측
- 물질 성분
- 인증 요약
- 지속적인 신뢰성 모니터링
- 팹 위치
- 조립 위치
권장 제품에는 본 TI 제품과 관련된 매개 변수, 평가 모듈 또는 레퍼런스 디자인이 있을 수 있습니다.