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SN74LVC1G139

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2 ライン入力 4 ライン出力デコーダ

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SN74LVC1G139

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製品詳細

Technology family LVC Number of channels 1 Operating temperature range (°C) -40 to 85 Rating Catalog Supply current (max) (µA) 10
Technology family LVC Number of channels 1 Operating temperature range (°C) -40 to 85 Rating Catalog Supply current (max) (µA) 10
DSBGA (YZP) 8 2.8125 mm² 2.25 x 1.25 SSOP (DCT) 8 11.8 mm² 2.95 x 4 VSSOP (DCU) 8 6.2 mm² 2 x 3.1
  • テキサス・インスツルメンツの
    NanoStar™および NanoFree™パッケージで供給
  • 5V VCC動作をサポート
  • 5.5Vまでの入力電圧に対応
  • VCCへの降圧変換をサポート
  • 3.3Vおよび15pFで最大tpdが4.9ns
  • 低消費電力、最大ICC 10µA
  • 3.3Vにおいて±24mAの出力駆動能力
  • Ioffにより活線挿抜、部分的パワーダウン・モード、バック・ドライブ保護をサポート
  • JESD 78, Class II準拠で100mA超のラッチアップ性能
  • JESD22を超えるESD保護
    • 2000V、人体モデル(A114-A)
    • 200V、マシン・モデル(A115-A)
    • 1000V、荷電デバイス・モデル(C101)
  • テキサス・インスツルメンツの
    NanoStar™および NanoFree™パッケージで供給
  • 5V VCC動作をサポート
  • 5.5Vまでの入力電圧に対応
  • VCCへの降圧変換をサポート
  • 3.3Vおよび15pFで最大tpdが4.9ns
  • 低消費電力、最大ICC 10µA
  • 3.3Vにおいて±24mAの出力駆動能力
  • Ioffにより活線挿抜、部分的パワーダウン・モード、バック・ドライブ保護をサポート
  • JESD 78, Class II準拠で100mA超のラッチアップ性能
  • JESD22を超えるESD保護
    • 2000V、人体モデル(A114-A)
    • 200V、マシン・モデル(A115-A)
    • 1000V、荷電デバイス・モデル(C101)

SN74LVC1G139 2-to-4ライン・デコーダは、1.65V～5.5VのVCCで動作するように設計されています。

SN74LVC1G139 2-to-4ライン・デコーダは、伝搬遅延時間を極めて短くする必要がある、高速メモリ・デコーディングやデータ・ルーティングといった用途に適しています。高性能メモリ・システムでは、このデコーダを使用することにより、システム・デコードの影響を最小限に抑制できます。高速イネーブル回路を使用する高速メモリと組み合わせた場合、このデコーダの遅延時間とメモリのイネーブル時間は通例、メモリの標準的なアクセス時間を下回ります。これは、SN74LVC1G139による実効的なシステム遅延時間は極めて短いということを意味しています。

NanoStarおよびNanoFreeパッケージは、デバイス・パッケージの概念を大きく変える技術であり、ダイをパッケージとして使用します。

このデバイスは、Ioffを使用する部分的パワーダウン・アプリケーション用に完全に動作が規定されています。Ioff回路が出力をディスエーブルにするため、電源切断時にデバイスに電流が逆流して損傷に至ることを回避できます。

SN74LVC1G139 2-to-4ライン・デコーダは、1.65V～5.5VのVCCで動作するように設計されています。

SN74LVC1G139 2-to-4ライン・デコーダは、伝搬遅延時間を極めて短くする必要がある、高速メモリ・デコーディングやデータ・ルーティングといった用途に適しています。高性能メモリ・システムでは、このデコーダを使用することにより、システム・デコードの影響を最小限に抑制できます。高速イネーブル回路を使用する高速メモリと組み合わせた場合、このデコーダの遅延時間とメモリのイネーブル時間は通例、メモリの標準的なアクセス時間を下回ります。これは、SN74LVC1G139による実効的なシステム遅延時間は極めて短いということを意味しています。

NanoStarおよびNanoFreeパッケージは、デバイス・パッケージの概念を大きく変える技術であり、ダイをパッケージとして使用します。

このデバイスは、Ioffを使用する部分的パワーダウン・アプリケーション用に完全に動作が規定されています。Ioff回路が出力をディスエーブルにするため、電源切断時にデバイスに電流が逆流して損傷に至ることを回避できます。
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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
* データシート SN74LVC1G139 2-to-4ライン・デコーダ データシート (Rev. E 翻訳版) PDF | HTML 英語版 (Rev.E) PDF | HTML 2018年 3月 8日
アプリケーション・ノート Implications of Slow or Floating CMOS Inputs (Rev. E) 2021年 7月 26日
セレクション・ガイド Little Logic Guide 2018 (Rev. G) 2018年 7月 6日
セレクション・ガイド Logic Guide (Rev. AB) 2017年 6月 12日
アプリケーション・ノート How to Select Little Logic (Rev. A) 2016年 7月 26日
アプリケーション・ノート Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) 2015年 12月 2日
セレクション・ガイド ロジック・ガイド (Rev. AA 翻訳版) 最新英語版 (Rev.AB) 2014年 11月 6日
ユーザー・ガイド LOGIC Pocket Data Book (Rev. B) 2007年 1月 16日
製品概要 Design Summary for WCSP Little Logic (Rev. B) 2004年 11月 4日
アプリケーション・ノート Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
アプリケーション・ノート Selecting the Right Level Translation Solution (Rev. A) 2004年 6月 22日
ユーザー・ガイド Signal Switch Data Book (Rev. A) 2003年 11月 14日
アプリケーション・ノート Use of the CMOS Unbuffered Inverter in Oscillator Circuits 2003年 11月 6日
ユーザー・ガイド LVC and LV Low-Voltage CMOS Logic Data Book (Rev. B) 2002年 12月 18日
アプリケーション・ノート Texas Instruments Little Logic Application Report 2002年 11月 1日
アプリケーション・ノート TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
その他の技術資料 Standard Linear & Logic for PCs, Servers & Motherboards 2002年 6月 13日
アプリケーション・ノート 16-Bit Widebus Logic Families in 56-Ball, 0.65-mm Pitch Very Thin Fine-Pitch BGA (Rev. B) 2002年 5月 22日
アプリケーション・ノート Power-Up 3-State (PU3S) Circuits in TI Standard Logic Devices 2002年 5月 10日
その他の技術資料 STANDARD LINEAR AND LOGIC FOR DVD/VCD PLAYERS 2002年 3月 27日
アプリケーション・ノート Migration From 3.3-V To 2.5-V Power Supplies For Logic Devices 1997年 12月 1日
アプリケーション・ノート Bus-Interface Devices With Output-Damping Resistors Or Reduced-Drive Outputs (Rev. A) 1997年 8月 1日
アプリケーション・ノート CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
アプリケーション・ノート LVC Characterization Information 1996年 12月 1日
アプリケーション・ノート Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日
設計ガイド Low-Voltage Logic (LVC) Designer's Guide 1996年 9月 1日
アプリケーション・ノート Understanding Advanced Bus-Interface Products Design Guide 1996年 5月 1日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

5-8-LOGIC-EVM — 5 ～ 8 ピンの DCK、DCT、DCU、DRL、DBV の各パッケージをサポートする汎用ロジックの評価基板 (EVM)

5 ～ 8 ピンで DCK、DCT、DCU、DRL、DBV の各パッケージを使用する多様なデバイスをサポートできる設計のフレキシブルな評価基板です。
ユーザー ガイド: PDF
TI.com で取り扱いなし
シミュレーション・モデル

SN74LVC1G139 IBIS Model (Rev. A)

SCEM449A.ZIP (44 KB) - IBIS Model
ダウンロード
リファレンス・デザイン

TIDA-01565 — 有線 OR MUX / PGA のリファレンス・デザイン

This board demonstrates a wired-OR multiplexer (MUX) and a programmable gain amplifier (PGA) application of the OPA837 operational amplifier. These applications are made possible with the high-impedance output of the amplifier and the high-impedance inverting input while in power-down (PD) mode. It (...)
設計ガイド: PDF
回路図: PDF
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
DSBGA (YZP) 8 Ultra Librarian
SSOP (DCT) 8 Ultra Librarian
VSSOP (DCU) 8 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

投稿されたすべてのフォーラムトピック (英語) を表示

コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください。

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