TPS650250
- システム電圧(VDCDC1)用の1.6A、97%効率の降圧コンバータ
- 3.3V、2.8V、または可変
- メモリ電圧用の0.8A、最高95%効率の降圧コンバータ(VDCDC2)
- 1.8V、2.5V、または可変
- プロセッサ・コア用の0.8A、90%効率の降圧コンバータ(VDCDC3)
- VDCDC3の出力電圧は可変
- Vdd_alive用の30mA LDO
- 2×200mAの汎用LDO (LDO1およびLDO2)
- プロセッサ・コア用の動的電圧管理
- LDO1とLDO2の電圧は外部から変更可能
- 誘導性コンバータ用の独立したイネーブル・ピン
- スイッチング周波数: 2.25MHz
- 85µAの静止電流
- サーマル・シャットダウン保護機能
TPS650250デバイスは、複数の電源レールを必要とするアプリケーション向けの統合型電源管理ICです。TPS650250には、プロセッサ・ベースのシステムにおいてコア電圧、ペリフェラル、I/O、およびメモリ・レールを提供するため、3つの高効率な降圧コンバータが搭載されています。3つの降圧コンバータはすべてMODEピンにより制御され、軽負荷時には低消費電力モードに移行して最大の効率を維持するか、または強制的に固定周波数のPWMモードで動作します。
TPS650250デバイスには、2つの汎用200mA LDO電圧レギュレータが内蔵されています。どちらのLDOも1.5V～6.5Vの入力電圧範囲で動作し、降圧コンバータの1つから給電できます。すべてのレールの出力電圧は、外付けの分圧抵抗により設定でき、入力ピンによりイネーブルされます。さらに、常時オンのレールに電力を供給するため、一般に30mAのLDOが使用されます。
技術資料
| 種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
|---|---|---|---|---|---|---|
| * | データシート | TPS650250 SoCおよびマルチレール・サブシステム用の電力管理IC (PMIC) データシート (Rev. B 翻訳版) | PDF | HTML | 英語版 (Rev.B) | PDF | HTML | 2018年 9月 14日 |
| アプリケーション・ノート | Optimizing Resistor Dividers at a Comparator (Rev. B) | PDF | HTML | 2021年 4月 30日 | |||
| アプリケーション・ノート | How to Design Flexible Processor Power Systems Using PMICs (Rev. B) | 2020年 1月 27日 | ||||
| アプリケーション・ノート | AM335x PMIC Selection Guide (Rev. A) | 2019年 9月 19日 | ||||
| セレクション・ガイド | 電源 IC セレクション・ガイド 2018 (Rev. R 翻訳版) | 英語版 (Rev.R) | 2018年 9月 13日 | |||
| ユーザー・ガイド | Powering the AM335x With the TPS650250 (Rev. B) | 2018年 3月 14日 | ||||
| アプリケーション・ノート | Understanding the Absolute Maximum Ratings of the SW Node (Rev. A) | 2012年 1月 13日 | ||||
| アプリケーション・ノート | Power supply reference design for Samsung™ s3c2416 using TPS650250 (Rev. A) | 2011年 1月 12日 | ||||
| EVM ユーザー ガイド (英語) | TPS650250EVM | 2008年 7月 1日 |
設計および開発
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TIDA-010011 — 保護リレー プロセッサ モジュール向け高効率電源アーキテクチャのリファレンス デザイン
TIDEP-0105 — AMIC110 上の DDR レス EtherCAT® スレーブのリファレンス・デザイン
TIDA-00716 — Xilinx Spartan 6 FPGA 電源リファレンス・デザイン、TPS650250 付
| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| VQFN (RHB) | 32 | Ultra Librarian |
購入と品質
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