ADC14L020
- Single +3.3V supply operation
- Internal sample-and-hold
- Internal reference
- Outputs 2.4V to 3.6V compatible
- Duty Cycle Stabilizer
- Power down mode
Key Specifications
Resolution | 14 Bits |
DNL | ±0.5 LSB (typ) |
SNR (fIN = 10 MHz) | 74 dB (typ) |
SFDR (fIN = 10 MHz) | 93 dB (typ) |
Data Latency | 7 Clock Cycles |
Power Consumption | |
-- Operating | 150 mW (typ) |
-- Power Down Mode | 15 mW (typ) |
The ADC14L020 is a low power monolithic CMOS analog-to-digital converter capable of converting analog input signals into 14-bit digital words at 20 Megasamples per second (MSPS). This converter uses a differential, pipeline architecture with digital error correction and an on-chip sample-and-hold circuit to minimize power consumption while providing excellent dynamic performance and a 150 MHz Full Power Bandwidth. Operating on a single +3.3V power supply, the ADC14L020 achieves 12.0 effective bits at nyquist and consumes just 150 mW at 20 MSPS . The Power Down feature reduces power consumption to 15 mW.
The differential inputs provide a full scale differential input swing equal to 2 times VREF with the possibility of a single-ended input. Full use of the differential input is recommended for optimum performance. Duty cycle stabilization and output data format are selectable using a quad state function pin. The output data can be set for offset binary or two's complement.
To ease interfacing to lower voltage systems, the digital output driver power pins of the ADC14L020 can be connected to a separate supply voltage in the range of 2.4V to the analog supply voltage.
This device is available in the 32-lead LQFP package and will operate over the industrial temperature range of -40°C to +85°C. An evaluation board is available to ease the evaluation process.
技術資料
種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
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* | データシート | ADC14L020 14-Bit, 20 MSPS, 150 mW A/D Converter (jp) データシート (Rev. C 翻訳版) | 最新英語版 (Rev.D) | PDF | HTML | 2006年 3月 30日 | |
ユーザー・ガイド | ADC14L020/ADC14L040 14-Bit, 20/40 Msps, 3.3V, 150/235 mW ADC User Guide | 2012年 2月 21日 | ||||
ホワイト・ペーパー | Intermediate Frequency (IF) Sampling Receiver Concepts | 2006年 5月 31日 |
設計および開発
その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。
PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®
設計とシミュレーション向けの環境である PSpice for TI (...)
パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
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LQFP (NEY) | 32 | Ultra Librarian |
購入と品質
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用原材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
- ファブの拠点
- 組み立てを実施した拠点
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。