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SN74AHCT125

アクティブ

TTL 互換 CMOS 入力、3 ステート出力、4 チャネル、4.5V ～ 5.5V バッファ

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SN74AHCT125

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製品詳細

Technology family AHCT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Number of channels 4 IOL (max) (mA) 8 Supply current (max) (µA) 20 IOH (max) (mA) -8 Input type TTL-Compatible CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 125
Technology family AHCT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Number of channels 4 IOL (max) (mA) 8 Supply current (max) (µA) 20 IOH (max) (mA) -8 Input type TTL-Compatible CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 125
PDIP (N) 14 181.42 mm² 19.3 x 9.4 SOIC (D) 14 51.9 mm² 8.65 x 6 SOP (NS) 14 79.56 mm² 10.2 x 7.8 SSOP (DB) 14 48.36 mm² 6.2 x 7.8 TSSOP (PW) 14 32 mm² 5 x 6.4 TVSOP (DGV) 14 23.04 mm² 3.6 x 6.4 VQFN (RGY) 14 12.25 mm² 3.5 x 3.5 WQFN (BQA) 14 7.5 mm² 3 x 2.5
  • 入力は TTL 電圧互換
  • JESD 17 準拠250mA 超のラッチアップ性能
  • 入力は TTL 電圧互換
  • JESD 17 準拠250mA 超のラッチアップ性能

’AHCT125 デバイスはクワッド バス バッファ ゲートで、3 ステート出力の独立したライン ドライバを備えています。各出力は、対応する出力イネーブル (OE) 入力が HIGH になると、出力はディセーブルされます。ここで、OEが Low の場合、該当するゲートは A 入力からのデータをその Y 出力に渡します。

電源オンまたは電源オフ中、高インピーダンス状態になるため、OEは、プルアップ抵抗経由で VCC に結線する必要があります。その抵抗の最小値はドライバの電流シンク能力で決まります。

’AHCT125 デバイスはクワッド バス バッファ ゲートで、3 ステート出力の独立したライン ドライバを備えています。各出力は、対応する出力イネーブル (OE) 入力が HIGH になると、出力はディセーブルされます。ここで、OEが Low の場合、該当するゲートは A 入力からのデータをその Y 出力に渡します。

電源オンまたは電源オフ中、高インピーダンス状態になるため、OEは、プルアップ抵抗経由で VCC に結線する必要があります。その抵抗の最小値はドライバの電流シンク能力で決まります。
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CD74HCT125 アクティブ TTL 互換 CMOS 入力、3 ステート出力、4 チャネル、4.5V ～ 5.5V バッファ Smaller voltage range (4.5V to 5.5V), longer average propagation delay (22ns), lower average drive strength (4mA)

技術資料

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設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板

14-24-logic-EVM 評価基板は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。

ユーザー ガイド: PDF | HTML
TI.com で取り扱いなし
評価ボード

14-24-NL-LOGIC-EVM — 14 ピンから 24 ピンのリードなしパッケージ向け、ロジック製品の汎用評価基板

14-24-NL-LOGIC-EVM は、14 ピンから24 ピンの BQA、BQB、RGY、RSV、RJW、RHL の各パッケージに封止した各種ロジック デバイスや変換デバイスをサポートする設計を採用したフレキシブルな評価基板 (EVM) です。

ユーザー ガイド: PDF | HTML
TI.com で取り扱いなし
シミュレーション・モデル

HSPICE MODEL OF SN74AHCT125

SCEJ219.ZIP (99 KB) - HSpice Model
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シミュレーション・モデル

SN74AHCT125 Behavioral SPICE Model

SCLM256.ZIP (7 KB) - PSpice Model
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シミュレーション・モデル

SN74AHCT125 IBIS Model

SCLM099.ZIP (18 KB) - IBIS Model
ダウンロード
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
PDIP (N) 14 Ultra Librarian
SOIC (D) 14 Ultra Librarian
SOP (NS) 14 Ultra Librarian
SSOP (DB) 14 Ultra Librarian
TSSOP (PW) 14 Ultra Librarian
TVSOP (DGV) 14 Ultra Librarian
VQFN (RGY) 14 Ultra Librarian
WQFN (BQA) 14 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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