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SN74HC165B-EP

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エンハンスド製品、8 ビット、パラレル ロード (並列読み込み) シフト レジスタ

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SN74HC165B-EP

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製品詳細

Configuration Parallel-in Bits (#) 8 Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Input type Standard CMOS Output type Push-Pull Clock frequency (MHz) 25 IOL (max) (mA) 5.2 IOH (max) (mA) -5.2 Supply current (max) (µA) 160 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -55 to 125 Rating HiRel Enhanced Product
Configuration Parallel-in Bits (#) 8 Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Input type Standard CMOS Output type Push-Pull Clock frequency (MHz) 25 IOL (max) (mA) 5.2 IOH (max) (mA) -5.2 Supply current (max) (µA) 160 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -55 to 125 Rating HiRel Enhanced Product
TSSOP (PW) 16 32 mm² 5 x 6.4
  • 2V～6V の V CC で動作
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • 動作時周囲温度：-55℃～+125℃
  • 防衛、航空宇宙、医療アプリケーションをサポート：
    • 管理されたベースライン
    • 単一のアセンブリおよびテスト施設
    • 単一の製造施設
    • 製品ライフ・サイクルの長期化
    • 製品のトレーサビリティ
  • 2V～6V の V CC で動作
  • JESD 17 準拠で 250mA 超のラッチアップ性能
  • 動作時周囲温度：-55℃～+125℃
  • 防衛、航空宇宙、医療アプリケーションをサポート：
    • 管理されたベースライン
    • 単一のアセンブリおよびテスト施設
    • 単一の製造施設
    • 製品ライフ・サイクルの長期化
    • 製品のトレーサビリティ

SN74HC165B-EP デバイスは、2V～6V の V CC で動作するように設計された、パラレルロード (並列読み込み) 8 ビット・シフト・レジスタです。

デバイスにクロックが供給されると、データはシリアル出力 Q H にシフトされます。各段のパラレル入力へのアクセスは、8 つの個別の直接データ入力によって提供されます。これらのデータ入力は、シフト / ロード (SH/ LD) 入力が Low レベルのときイネーブルになります。 SN74HC165B-EP デバイスは、クロック禁止機能と、反転したシリアル出力 Q H を備えています。

SN74HC165B-EP デバイスは、2V～6V の V CC で動作するように設計された、パラレルロード (並列読み込み) 8 ビット・シフト・レジスタです。

デバイスにクロックが供給されると、データはシリアル出力 Q H にシフトされます。各段のパラレル入力へのアクセスは、8 つの個別の直接データ入力によって提供されます。これらのデータ入力は、シフト / ロード (SH/ LD) 入力が Low レベルのときイネーブルになります。 SN74HC165B-EP デバイスは、クロック禁止機能と、反転したシリアル出力 Q H を備えています。
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技術資料

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* データシート SN74HC165B-EPエンハンスド製品、5V、パラレル・ロード 8 ビット・シフト・レジスタ データシート PDF | HTML 英語版 PDF | HTML 2023年 8月 23日
アプリケーション・ノート Implications of Slow or Floating CMOS Inputs (Rev. E) 2021年 7月 26日
セレクション・ガイド Logic Guide (Rev. AB) 2017年 6月 12日
アプリケーション・ノート Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) 2015年 12月 2日
セレクション・ガイド ロジック・ガイド (Rev. AA 翻訳版) 最新英語版 (Rev.AB) 2014年 11月 6日
ユーザー・ガイド LOGIC Pocket Data Book (Rev. B) 2007年 1月 16日
アプリケーション・ノート Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
ユーザー・ガイド Signal Switch Data Book (Rev. A) 2003年 11月 14日
アプリケーション・ノート TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
アプリケーション・ノート CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
アプリケーション・ノート Designing With Logic (Rev. C) 1997年 6月 1日
アプリケーション・ノート Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
アプリケーション・ノート Live Insertion 1996年 10月 1日
アプリケーション・ノート SN54/74HCT CMOS Logic Family Applications and Restrictions 1996年 5月 1日
アプリケーション・ノート Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板

14-24-LOGIC-EVM 評価基板 (EVM) は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。

ユーザー ガイド: PDF | HTML
TI.com で取り扱いなし
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
TSSOP (PW) 16 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

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コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください。

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