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SN74LV1T04

現行

單電源供應逆變器閘邏輯電平移位器

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SN74LV1T04

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產品詳細資料

Technology family LV1T Applications GPIO, I2S, UART Bits (#) 1 Configuration 1 Ch A to B 0 Ch B to A High input voltage (min) (V) 1 High input voltage (max) (V) 5.5 Vout (min) (V) 339559 Vout (max) (V) 5.5 Data rate (max) (Mbps) 100 IOH (max) (mA) -8 IOL (max) (mA) -8 Supply current (max) (µA) 5.5 Features 4.2, 4.64 Input type TTL-Compatible CMOS Output type Balanced CMOS, Push-Pull Rating Catalog Operating temperature range (°C) -40 to 125
Technology family LV1T Applications GPIO, I2S, UART Bits (#) 1 Configuration 1 Ch A to B 0 Ch B to A High input voltage (min) (V) 1 High input voltage (max) (V) 5.5 Vout (min) (V) 339559 Vout (max) (V) 5.5 Data rate (max) (Mbps) 100 IOH (max) (mA) -8 IOL (max) (mA) -8 Supply current (max) (µA) 5.5 Features 4.2, 4.64 Input type TTL-Compatible CMOS Output type Balanced CMOS, Push-Pull Rating Catalog Operating temperature range (°C) -40 to 125
SOT-23 (DBV) 5 8.12 mm² 2.9 x 2.8 SOT-SC70 (DCK) 5 4.2 mm² 2 x 2.1
  • Single-supply voltage translator at 5.0V, 3.3V, 2.5V, and 1.8V VCC
  • Operating range of 1.8V to 5.5V
  • Up translation:
    • 1.2V(1) to 1.8V at 1.8V VCC
    • 1.5V(1) to 2.5V at 2.5V VCC
    • 1.8V(1) to 3.3V at 3.3V VCC
    • 3.3V to 5.0V at 5.0V VCC
  • Down translation:
    • 3.3V to 1.8V at 1.8V VCC
    • 3.3V to 2.5V at 2.5V VCC
    • 5.0V to 3.3V at 3.3V VCC
  • Logic output is referenced to VCC
  • Output drive:
    • 8mA output drive at 5V
    • 7mA output drive at 3.3V
    • 3mA output drive at 1.8V
  • Characterized up to 50MHz at 3.3V VCC
  • 5V tolerance on input pins
  • –40°C to +125°C operating temperature range
  • Pb-free packages available: SC-70 (DCK)
    • 2 × 2.1 × 0.65mm (Height 1.10mm)
  • Latch-up performance exceeds 250mA per JESD 17
  • Supports standard logic pinouts
  • CMOS output B compatible with AUP1G and LVC1G families (1)

(1)See the VIH/VIL and output drive for lower VCC condition.
  • Single-supply voltage translator at 5.0V, 3.3V, 2.5V, and 1.8V VCC
  • Operating range of 1.8V to 5.5V
  • Up translation:
    • 1.2V(1) to 1.8V at 1.8V VCC
    • 1.5V(1) to 2.5V at 2.5V VCC
    • 1.8V(1) to 3.3V at 3.3V VCC
    • 3.3V to 5.0V at 5.0V VCC
  • Down translation:
    • 3.3V to 1.8V at 1.8V VCC
    • 3.3V to 2.5V at 2.5V VCC
    • 5.0V to 3.3V at 3.3V VCC
  • Logic output is referenced to VCC
  • Output drive:
    • 8mA output drive at 5V
    • 7mA output drive at 3.3V
    • 3mA output drive at 1.8V
  • Characterized up to 50MHz at 3.3V VCC
  • 5V tolerance on input pins
  • –40°C to +125°C operating temperature range
  • Pb-free packages available: SC-70 (DCK)
    • 2 × 2.1 × 0.65mm (Height 1.10mm)
  • Latch-up performance exceeds 250mA per JESD 17
  • Supports standard logic pinouts
  • CMOS output B compatible with AUP1G and LVC1G families (1)

(1)See the VIH/VIL and output drive for lower VCC condition.

The SN74LV1T04 is a single NOT gate with reduced input thresholds to support voltage translation applications.

The SN74LV1T04 is a single NOT gate with reduced input thresholds to support voltage translation applications.

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設計與開發

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開發板

5-8-LOGIC-EVM — 適用於 5 針腳至 8 針腳 DCK、DCT、DCU、DRL 和 DBV 封裝的通用邏輯評估模組

靈活的 EVM 旨在支援任何針腳數為 5 至 8 支且採用 DCK、DCT、DCU、DRL 或 DBV 封裝的裝置。
使用指南: PDF
TI.com 無法提供
模擬型號

SN74LV1T04 Behavioral SPICE Model

SCLM186.ZIP (7 KB) - PSpice Model
下載
模擬型號

SN74LV1T04 IBIS Model (Rev. A)

SCLM104A.ZIP (43 KB) - IBIS Model
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參考設計

TIDA-01555 — 彈性介面 (PRU-ICSS) 參考設計，適用於使用多個 ADC 的同步、同調的 DAQ

此參考設計展示了連接多個高電壓雙極輸入、8 通道、多工輸入 SAR ADC (6) 與 Sitara Arm 處理器的介面實作，以使用程式化即時單元 (PRU-ICSS) 擴充輸入通道數量。ADC 配置為在所有 ADC 中同時取樣相同通道。此設計透過每個線路週期取樣 640 個樣本，強調 PRU-ICSS 處理 1536ksps (每個取樣 = 16 位元) 資料率的能力。在 50Hz 週期中，同步對應 6 個 ADC 中每通道 32ksps (每週期 640 個取樣*50Hz*6 個 ADC*8 通道 = 1536 ksps)。此外，第二個 PRU 用於對資料進行後處理，以實現一致的取樣。
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SOT-23 (DBV) 5 Ultra Librarian
SOT-SC70 (DCK) 5 Ultra Librarian
適用 TI 的評估品項標準條款與條件。

訂購與品質

內含資訊：
  • RoHS
  • REACH
  • 產品標記
  • 鉛塗層/球物料
  • MSL 等級/回焊峰值
  • MTBF/FIT 估算值
  • 材料內容
  • 認證摘要
  • 進行中持續性的可靠性監測
內含資訊：
  • 晶圓廠位置
  • 組裝地點

支援與培訓

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