データシート
TPD4E002
- IEC 61000-4-2 ESD Protection
- ±15-kV IEC 61000-4-2 Contact Discharge
- IEC 61000-4-5 Surge Protection
- 2.5-A Peak Pulse Current (8/20-µs Pulse)
- ANSI/ESDA/JEDEC JS-001
- ±15-kV Human Body Model (HBM)
- Four Unidirectional Voltage Suppression Diodes for use in ESD Protection
- I/O Breakdown Voltage, VBR = 6.1 V (Minimum)
- I/O Capacitance 11 pF (Typical)
- Low Leakage Current < 100 nA
- Very Small Printed-Circuit Board (PCB) Area < 2.6 mm2
- High Integration
- Suitable for High-Density Boards
The TPD4E002 device is a transient voltage suppressor (TVS) designed to protect up to four lines against electrostatic discharge (ESD) transients. The monolithic circuit design allows superior capacitance matching between the channels and reduced crosstalk. This device is ideal for applications where both reduced line capacitance and board space-saving are required.
技術資料
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|---|---|---|---|---|---|---|
| * | データシート | TPD4E002 Quad Low-Capacitance Array with ±15-kV ESD Protection データシート (Rev. F) | PDF | HTML | 2016年 11月 18日 | ||
| アプリケーション概要 | ESD Protection for GPIO | PDF | HTML | 2024年 1月 8日 | |||
| セレクション・ガイド | System-Level ESD Protection Guide (Rev. D) | 2022年 9月 7日 | ||||
| アプリケーション・ノート | ESD Packaging and Layout Guide (Rev. B) | PDF | HTML | 2022年 8月 18日 | |||
| ホワイト・ペーパー | Designing USB for short-to-battery tolerance in automotive environments | 2016年 2月 10日 | ||||
| Analog Design Journal | Design Considerations for System-Level ESD Circuit Protection | 2012年 9月 25日 |
設計および開発
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評価ボード
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| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| SOT-5X3 (DRL) | 5 | Ultra Librarian |
購入と品質
記載されている情報：
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用原材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
記載されている情報：
- ファブの拠点
- 組み立てを実施した拠点
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。