AFE7906
6-Kanal-HF-Abtastempfänger, 5 MHz bis 12 GHz, max. 1200 MHz IBW
AFE7906
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- Six RF sampling 14 bit, 3 GSPS ADCs
- Maximum RF signal bandwidth:
- 4 ADCs: 1200 MHz per ADC
- 6 ADCs: 600 MHz per ADC
- RF frequency range: 5 MHz - 12 GHz
- Digital step attenuators (DSA): 25 dB range, 0.5-dB steps
- Single DDC (on 6 channels) or dual-band DDCs (on 4 channels)
- 16x NCOs per DDC channel
- Optional Internal PLL/VCO for ADC clocks or external clock at ADC sample rate
- Sysref alignment detector
- SerDes data interface:
- JESD204B and JESD204C compatible
- 8 SerDes transmitters up to 29.5 Gbps
- Subclass 1 multi-device synchronization
- Package: 17-mm × 17-mm FCBGA, 0.8-mm pitch
The AFE7906 is a high performance, wide bandwidth multi-channel receiver, integrating six RF Sampling ADCs. With operation up to 12 GHz, this device enables direct RF sampling in the L, S, C and X-band frequency ranges without the need for additional frequency conversions stages. This improvement in density and flexibility enables high-channel-count, multi-mission systems.
Each receiver chain includes a 25-dB range DSA (Digital Step Attenuator), followed by a 3-GSPS ADC (analog-to-digital converter). Four receiver channels have an analog peak power detector and various digital power detectors to assist an external or internal autonomous automatic gain controller, and RF overload detectors for device reliability protection. Flexible decimation options provide optimization of data bandwidth up to 1200 MHz for four RX or 600 MHz.
The device contains a SYSREF timing detector to allow optimization of the SYSREF input timing relative to the device clock.
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Each receiver chain includes a 25-dB range DSA (Digital Step Attenuator), followed by a 3-GSPS ADC (analog-to-digital converter). Each receiver channel has an analog peak power detector and various digital power detectors to assist an external or internal autonomous automatic gain controller, and RF overload detectors for device reliability protection. Flexible decimation options provide optimization of data bandwidth up to 1200 MHz for four RX without FB paths or 600 MHz with two FB paths (1200 MHz BW each).
The device contains a SYSREF timing detector to allow optimization of the SYSREF input timing relative to the device clock.
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Technische Dokumentation
Typ | Titel | Datum | ||
---|---|---|---|---|
* | Data sheet | AFE7906 6-Channel, 5-MHz to 12-GHz RF Sampling Receiver with 3-GSPS ADCs datasheet (Rev. C) | PDF | HTML | 31 Mai 2023 |
User guide | AFE79xx SPI Bringup Guide With Xilinx FPGAs (Rev. A) | PDF | HTML | 05 Mai 2024 |
Design und Entwicklung
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Gehäuse | Pins | CAD-Symbole, Footprints und 3D-Modelle |
---|---|---|
FCBGA (ABJ) | 400 | Ultra Librarian |
FCBGA (ALK) | 400 | Ultra Librarian |
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