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TMS320C6743

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DSP de punto flotante C674x de 375 MHz y baja potencia

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TMS320C6743

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Detalles del producto

DSP type 1 C674x DSP (max) (MHz) 375 CPU 32-/64-bit Operating system TI-RTOS Ethernet MAC 10/100 Rating Catalog Operating temperature range (°C) -40 to 125
DSP type 1 C674x DSP (max) (MHz) 375 CPU 32-/64-bit Operating system TI-RTOS Ethernet MAC 10/100 Rating Catalog Operating temperature range (°C) -40 to 125
HLQFP (PTP) 176 676 mm² 26 x 26 PBGA (ZKB) 256 289 mm² 17 x 17
  • Applications
    • Networking
    • High-Speed Encoding
    • Professional Audio™
  • Software Support
    • TI DSP/BIOS™
    • Chip Support Library and DSP Library
  • 375-MHz TMS320C674x Fixed- and Floating-Point VLIW DSP Core
    • Load-Store Architecture with Nonaligned Support
    • 64 General-Purpose Registers (32-Bit)
    • Six ALU (32- and 40-Bit) Functional Units
      • Supports 32-Bit Integer, SP (IEEE Single Precision/32-Bit) and DP (IEEE Double Precision/64-Bit) Floating Point
      • Supports up to Four SP Additions Per Clock, Four DP Additions Every 2 Clocks
      • Supports up to Two Floating Point (SP or DP) Reciprocal Approximation (RCPxP) and Square-Root Reciprocal Approximation (RSQRxP) Operations Per Cycle
    • Two Multiply Functional Units
      • Mixed-Precision IEEE Floating Point Multiply Supported up to:
        • 2 SP x SP -> SP Per Clock
        • 2 SP x SP -> DP Every Two Clocks
        • 2 SP x DP -> DP Every Three Clocks
        • 2 DP x DP -> DP Every Four Clocks
      • Fixed-Point Multiply Supports Two 32 x 32-Bit Multiplies, Four 16 x 16-Bit Multiplies, or Eight 8 x 8-Bit Multiplies per Clock Cycle, and Complex Multiples
    • Instruction Packing Reduces Code Size
    • All Instructions Conditional
    • Hardware Support for Modulo Loop
      Operation
    • Protected Mode Operation
    • Exceptions Support for Error Detection and Program Redirection
  • C674x Instruction Set Features
    • Superset of the C67x+ and C64x+ ISAs
    • 3000 MIPS and 2250 MFLOPS C674x
    • Byte-Addressable (8-, 16-, 32-, and 64-Bit Data)
    • 8-Bit Overflow Protection
    • Bit-Field Extract, Set, Clear
    • Normalization, Saturation, Bit-Counting
    • Compact 16-Bit Instructions
  • C674x Two-Level Cache Memory Architecture
    • 32KB of L1P Program RAM/Cache
    • 32KB of L1D Data RAM/Cache
    • 128KB of L2 Unified Mapped RAM/Cache
    • Flexible RAM/Cache Partition (L1 and L2)
  • Enhanced Direct Memory Access Controller 3 (EDMA3):
    • 2 Transfer Controllers
    • 32 Independent DMA Channels
    • 8 Quick DMA Channels
    • Programmable Transfer Burst Size
  • 3.3-V LVCMOS I/Os
  • Two External Memory Interfaces:
    • EMIFA
      • NOR (8-Bit-Wide Data)
      • NAND (8-Bit-Wide Data)
    • EMIFB
      • 16-bit SDRAM, up to 128MB
  • Two Configurable 16550-Type UART Modules:
    • UART0 with Modem Control Signals
    • 16-Byte FIFO
    • 16x or 13x Oversampling Option
  • One Serial Peripheral Interface (SPI) with One Chip Select
  • Multimedia Card (MMC)/Secure Digital (SD)
  • Two Master and Slave Inter-Integrated Circuit (I2C Bus™)
  • Programmable Real-Time Unit Subsystem (PRUSS)
    • Two Independent Programmable Real-Time Unit (PRU) Cores
      • 32-Bit Load-Store RISC Architecture
      • 4KB of Instruction RAM per Core
      • 512 Bytes of Data RAM per Core
      • PRUSS can be Disabled Through Software to Save Power
      • Register 30 of each PRU is Exported from the Subsystem in Addition to the Normal R31 Output of the PRU Cores
    • Standard Power-Management Mechanism
      • Clock Gating
      • Entire Subsystem Under a Single PSC Clock Gating Domain
    • Dedicated Interrupt Controller
    • Dedicated Switched Central Resource
  • Two Multichannel Audio Serial Ports (McASPs):
    • Supports TDM, I2S, and Similar Formats
    • FIFO Buffers for Transmit and Receive
  • 10/100 Mbps RMII Ethernet Media Access Controller (EMAC):
    • IEEE 802.3 Compliant (3.3-V I/O Only)
    • RMII Media-Independent Interface
    • Management Data I/O (MDIO) Module
  • One 64-Bit General-Purpose Timer (Configurable as Two 32-Bit Timers)
  • One 64-Bit General-Purpose Watchdog Timer (Configurable as Two 32-Bit Timers)
  • Three Enhanced Pulse Width Modulators (eHRPWMs):
    • Dedicated 16-Bit Time-Base Counter with Period and Frequency Control
    • 6 Single Edge, 6 Dual Edge Symmetric, or 3 Dual Edge Asymmetric Outputs
    • Dead-Band Generation
    • PWM Chopping by High-Frequency Carrier
    • Trip Zone Input
  • Three 32-Bit Event Capture (eCAP) Modules:
    • Configurable as 3 Capture Inputs or 3 Auxiliary Pulse Width Modulator (APWM) Outputs
    • Single-Shot Capture of up to Four Event Time-Stamps
  • Two 32-Bit Enhanced Quadrature Encoder Pulse (eQEP) Modules
  • 256-Ball Pb-Free Plastic Ball Grid Array (PBGA) [ZKB Suffix], 1.0-mm Ball Pitch
  • 176-Pin Thin Quad Flat Pack (TQFP) [PTP Suffix], 0.5-mm Pin Pitch
  • Commercial or Automotive Temperature
  • Applications
    • Networking
    • High-Speed Encoding
    • Professional Audio™
  • Software Support
    • TI DSP/BIOS™
    • Chip Support Library and DSP Library
  • 375-MHz TMS320C674x Fixed- and Floating-Point VLIW DSP Core
    • Load-Store Architecture with Nonaligned Support
    • 64 General-Purpose Registers (32-Bit)
    • Six ALU (32- and 40-Bit) Functional Units
      • Supports 32-Bit Integer, SP (IEEE Single Precision/32-Bit) and DP (IEEE Double Precision/64-Bit) Floating Point
      • Supports up to Four SP Additions Per Clock, Four DP Additions Every 2 Clocks
      • Supports up to Two Floating Point (SP or DP) Reciprocal Approximation (RCPxP) and Square-Root Reciprocal Approximation (RSQRxP) Operations Per Cycle
    • Two Multiply Functional Units
      • Mixed-Precision IEEE Floating Point Multiply Supported up to:
        • 2 SP x SP -> SP Per Clock
        • 2 SP x SP -> DP Every Two Clocks
        • 2 SP x DP -> DP Every Three Clocks
        • 2 DP x DP -> DP Every Four Clocks
      • Fixed-Point Multiply Supports Two 32 x 32-Bit Multiplies, Four 16 x 16-Bit Multiplies, or Eight 8 x 8-Bit Multiplies per Clock Cycle, and Complex Multiples
    • Instruction Packing Reduces Code Size
    • All Instructions Conditional
    • Hardware Support for Modulo Loop
      Operation
    • Protected Mode Operation
    • Exceptions Support for Error Detection and Program Redirection
  • C674x Instruction Set Features
    • Superset of the C67x+ and C64x+ ISAs
    • 3000 MIPS and 2250 MFLOPS C674x
    • Byte-Addressable (8-, 16-, 32-, and 64-Bit Data)
    • 8-Bit Overflow Protection
    • Bit-Field Extract, Set, Clear
    • Normalization, Saturation, Bit-Counting
    • Compact 16-Bit Instructions
  • C674x Two-Level Cache Memory Architecture
    • 32KB of L1P Program RAM/Cache
    • 32KB of L1D Data RAM/Cache
    • 128KB of L2 Unified Mapped RAM/Cache
    • Flexible RAM/Cache Partition (L1 and L2)
  • Enhanced Direct Memory Access Controller 3 (EDMA3):
    • 2 Transfer Controllers
    • 32 Independent DMA Channels
    • 8 Quick DMA Channels
    • Programmable Transfer Burst Size
  • 3.3-V LVCMOS I/Os
  • Two External Memory Interfaces:
    • EMIFA
      • NOR (8-Bit-Wide Data)
      • NAND (8-Bit-Wide Data)
    • EMIFB
      • 16-bit SDRAM, up to 128MB
  • Two Configurable 16550-Type UART Modules:
    • UART0 with Modem Control Signals
    • 16-Byte FIFO
    • 16x or 13x Oversampling Option
  • One Serial Peripheral Interface (SPI) with One Chip Select
  • Multimedia Card (MMC)/Secure Digital (SD)
  • Two Master and Slave Inter-Integrated Circuit (I2C Bus™)
  • Programmable Real-Time Unit Subsystem (PRUSS)
    • Two Independent Programmable Real-Time Unit (PRU) Cores
      • 32-Bit Load-Store RISC Architecture
      • 4KB of Instruction RAM per Core
      • 512 Bytes of Data RAM per Core
      • PRUSS can be Disabled Through Software to Save Power
      • Register 30 of each PRU is Exported from the Subsystem in Addition to the Normal R31 Output of the PRU Cores
    • Standard Power-Management Mechanism
      • Clock Gating
      • Entire Subsystem Under a Single PSC Clock Gating Domain
    • Dedicated Interrupt Controller
    • Dedicated Switched Central Resource
  • Two Multichannel Audio Serial Ports (McASPs):
    • Supports TDM, I2S, and Similar Formats
    • FIFO Buffers for Transmit and Receive
  • 10/100 Mbps RMII Ethernet Media Access Controller (EMAC):
    • IEEE 802.3 Compliant (3.3-V I/O Only)
    • RMII Media-Independent Interface
    • Management Data I/O (MDIO) Module
  • One 64-Bit General-Purpose Timer (Configurable as Two 32-Bit Timers)
  • One 64-Bit General-Purpose Watchdog Timer (Configurable as Two 32-Bit Timers)
  • Three Enhanced Pulse Width Modulators (eHRPWMs):
    • Dedicated 16-Bit Time-Base Counter with Period and Frequency Control
    • 6 Single Edge, 6 Dual Edge Symmetric, or 3 Dual Edge Asymmetric Outputs
    • Dead-Band Generation
    • PWM Chopping by High-Frequency Carrier
    • Trip Zone Input
  • Three 32-Bit Event Capture (eCAP) Modules:
    • Configurable as 3 Capture Inputs or 3 Auxiliary Pulse Width Modulator (APWM) Outputs
    • Single-Shot Capture of up to Four Event Time-Stamps
  • Two 32-Bit Enhanced Quadrature Encoder Pulse (eQEP) Modules
  • 256-Ball Pb-Free Plastic Ball Grid Array (PBGA) [ZKB Suffix], 1.0-mm Ball Pitch
  • 176-Pin Thin Quad Flat Pack (TQFP) [PTP Suffix], 0.5-mm Pin Pitch
  • Commercial or Automotive Temperature

The C6743 device is a low-power digital signal processor based on C674x DSP core. The device consumes significantly lower power than other members of the TMS320C6000™ platform of DSPs.

The C6743 device enables original-equipment manufacturers (OEMs) and original-design manufacturers (ODMs) to quickly bring to market devices featuring high processing performance.

The C6743 DSP core uses a two-level cache-based architecture. The Level 1 program cache (L1P) is a 32-KB direct mapped cache and the Level 1 data cache (L1D) is a 32-KB 2-way set-associative cache. The Level 2 program cache (L2P) consists of a 128-KB of memory space that is shared between program and data space. L2 memory can be configured as mapped memory, cache, or combinations of the two.

The peripheral set includes: a 10/100 Mbps Ethernet MAC (EMAC) with a management data input/output (MDIO) module; two I2C Bus interfaces; two multichannel audio serial ports (McASPs) with 14/9 serializers and FIFO buffers; two 64-bit general-purpose timers each configurable (one configurable as watchdog); up to 8 banks of 16 pins of general-purpose input/output (GPIO) with programmable interrupt/event generation modes, multiplexed with other peripherals; two UART interfaces (one with both RTS and CTS); three enhanced high-resolution pulse width modulator (eHRPWM) peripherals; three 32-bit enhanced capture (eCAP) module peripherals which can be configured as 3 capture inputs or 3 auxiliary pulse width modulator (APWM) outputs; two 32-bit enhanced quadrature encoded pulse (eQEP) peripherals; and 2 external memory interfaces (EMIFs): an asynchronous external memory interface (EMIFA) for slower memories or peripherals, and a higher speed memory interface (EMIFB) for SDRAM.

The Ethernet Media Access Controller (EMAC) provides an efficient interface between the C6743 and the network. The EMAC supports both 10Base-T and 100Base-TX, or 10 Mbps and 100 Mbps in either half- or full-duplex mode. Additionally, an MDIO interface is available for PHY configuration.

The rich peripheral set provides the ability to control external peripheral devices and communicate with external processors. For details on each of the peripherals, see the related sections later in this document and the associated peripheral reference guides.

The C6743 device is a low-power digital signal processor based on C674x DSP core. The device consumes significantly lower power than other members of the TMS320C6000™ platform of DSPs.

The C6743 device enables original-equipment manufacturers (OEMs) and original-design manufacturers (ODMs) to quickly bring to market devices featuring high processing performance.

The C6743 DSP core uses a two-level cache-based architecture. The Level 1 program cache (L1P) is a 32-KB direct mapped cache and the Level 1 data cache (L1D) is a 32-KB 2-way set-associative cache. The Level 2 program cache (L2P) consists of a 128-KB of memory space that is shared between program and data space. L2 memory can be configured as mapped memory, cache, or combinations of the two.

The peripheral set includes: a 10/100 Mbps Ethernet MAC (EMAC) with a management data input/output (MDIO) module; two I2C Bus interfaces; two multichannel audio serial ports (McASPs) with 14/9 serializers and FIFO buffers; two 64-bit general-purpose timers each configurable (one configurable as watchdog); up to 8 banks of 16 pins of general-purpose input/output (GPIO) with programmable interrupt/event generation modes, multiplexed with other peripherals; two UART interfaces (one with both RTS and CTS); three enhanced high-resolution pulse width modulator (eHRPWM) peripherals; three 32-bit enhanced capture (eCAP) module peripherals which can be configured as 3 capture inputs or 3 auxiliary pulse width modulator (APWM) outputs; two 32-bit enhanced quadrature encoded pulse (eQEP) peripherals; and 2 external memory interfaces (EMIFs): an asynchronous external memory interface (EMIFA) for slower memories or peripherals, and a higher speed memory interface (EMIFB) for SDRAM.

The Ethernet Media Access Controller (EMAC) provides an efficient interface between the C6743 and the network. The EMAC supports both 10Base-T and 100Base-TX, or 10 Mbps and 100 Mbps in either half- or full-duplex mode. Additionally, an MDIO interface is available for PHY configuration.

The rich peripheral set provides the ability to control external peripheral devices and communicate with external processors. For details on each of the peripherals, see the related sections later in this document and the associated peripheral reference guides.
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Tipo Título Fecha
* Data sheet TMS320C6743 Fixed- and Floating-Point Digital Signal Processor datasheet (Rev. D) PDF | HTML 17 jun 2014
* Errata TMS320C6743 Fixed/Floating-Point DSP SE (Silicon Revs 3.0, 2.1, 2.0, 1.1, & 1.0) (Rev. G) 17 jun 2014
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User guide System Analyzer User's Guide (Rev. F) 18 nov 2013
User guide TMS320C6000 Assembly Language Tools v 7.4 User's Guide (Rev. W) 21 ago 2012
User guide TMS320C6000 Optimizing Compiler v 7.4 User's Guide (Rev. U) 21 ago 2012
Application note Using the OMAP-L1x7 Bootloader (Rev. G) 01 jun 2012
Application note Using the TMS320C6747/45/43 Bootloader (Rev. C) 01 jun 2012
Application note Introduction to TMS320C6000 DSP Optimization 06 oct 2011
User guide TMS320C674x/OMAP-L1x Processor Peripherals Overview Reference Guide (Rev. F) 14 sep 2011
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User guide TMS320C674x DSP Megamodule Reference Guide (Rev. A) 03 ago 2010
User guide TMS320C674x DSP CPU and Instruction Set User's Guide (Rev. B) 30 jul 2010
User guide TMS320C6000 Assembly Language Tools v 7.0 User's Guide (Rev. S) 18 mar 2010
User guide TMS320C6000 Optimizing Compiler v 7.0 User's Guide (Rev. Q) 18 mar 2010
Application note OMAP-L137 TMS320C6747/6745/6743 Pin Multiplexing Utility (Rev. A) 26 sep 2009
Application note TMS320C6747/45/43 Complementary Products 23 sep 2009
White paper Efficient Fixed- and Floating-Point Code Execution on the TMS320C674x Core 24 jun 2009
Application note TMS320C6747/45/43 & OMAP-L1x7 USB Downstream Host Compliance Testing 12 mar 2009
Application note TMS320C6747/45/43 & OMAP-L1x7 USB Upstream Device Compliance Testing 12 mar 2009
Application note TMS320C674x/OMAP-L1x USB Compliance Checklist 12 mar 2009
User guide TMS320C674x DSP Cache User's Guide (Rev. A) 11 feb 2009
User guide TMS320C6000 Assembly Language Tools v 6.1 User's Guide (Rev. Q) 15 may 2008
User guide TMS320C6000 Optimizing Compiler v 6.1 User's Guide (Rev. O) 15 may 2008
User guide TMS320C6000 Assembly Language Tools v 6.0 Beta User's Guide (Rev. P) 31 oct 2006
User guide TMS320C6000 Optimizing Compiler v 6.0 Beta User's Guide (Rev. N) 29 jul 2005

Diseño y desarrollo

Para conocer los términos adicionales o los recursos necesarios, haga clic en cualquier título de abajo para ver la página de detalles cuando esté disponible.

Placa de evaluación

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No disponible en TI.com
Sonda de depuración

TMDSEMU200-U — Sonda de depuración XDS200 USB

El XDS200 es una sonda de depuración (emulador) que se utiliza para depurar dispositivos integrados de TI. El XDS200 presenta un equilibrio de bajo costo con buen rendimiento en comparación con el XDS110 de bajo costo y el XDS560v2 de alto rendimiento. Es compatible con una amplia (...)

No disponible en TI.com
Sonda de depuración

TMDSEMU560V2STM-U — Sonda de depuración USB de seguimiento del sistema XDS560v2

The XDS560v2 is the highest performance of the XDS560™ family of debug probes and supports both the traditional JTAG standard (IEEE1149.1) and cJTAG (IEEE1149.7).  Note that it does not support serial wire debug (SWD).

All XDS debug probes support Core and System Trace in all ARM and DSP processors (...)

No disponible en TI.com
Sonda de depuración

TMDSEMU560V2STM-UE — Sonda de depuración USB y ethernet de seguimiento del sistema XDS560v2

The XDS560v2 is the highest performance of the XDS560™ family of debug probes and supports both the traditional JTAG standard (IEEE1149.1) and cJTAG (IEEE1149.7). Note that it does not support serial wire debug (SWD).

All XDS debug probes support Core and System Trace in all ARM and DSP processors (...)

No disponible en TI.com
Kit de desarrollo de software (SDK)

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Processor SDK (Software Development Kit) is a unified software platform for TI embedded processors providing easy setup and fast out-of-the-box access to benchmarks and demos.  All releases of Processor SDK are consistent across TI’s broad portfolio, allowing developers to seamlessly (...)
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Controlador o biblioteca

AEC-AER — Acoustic echo cancellation/removal for TI C64x+, C674x, C55x and Cortex®-A8 processors

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66AK2G12 — DSP+Arm multinúcleo de alto rendimiento: 1x Arm, núcleos A15, 1x C66x DSP núcleo
Procesadores digitales de señales (DSP)
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C64X-DSPLIB — Download TMS320C64x DSP Library

TMS320C6000 Digital Signal Processor Library (DSPLIB) is a platform-optimized DSP function library for C programmers. It includes C-callable, general-purpose signal-processing routines that are typically used in computationally intensive real-time applications. With these routines, higher (...)

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OMAPL137-HT — DSP de punto flotante C674x de alta temperatura y baja potencia + procesador Arm - hasta 456 MHz OMAPL138B-EP — Producto mejorado, DSP de punto flotante C674x, de baja potencia + procesador Arm9 - 345 MHz TMS320DM8127 — Procesador de medios digitales DaVinci
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C67X-DSPLIB — Download TMS320C67x DSP Library

TMS320C6000 Digital Signal Processor Library (DSPLIB) is a platform-optimized DSP function library for C programmers. It includes C-callable, general-purpose signal-processing routines that are typically used in computationally intensive real-time applications. With these routines, higher (...)

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C67X-MATHLIB — DSP Math Library for C67x Floating Point Devices

The Texas Instruments math library is an optimized floating-point math function library for C programmers using TI floating point devices. These routines are typically used in computationally intensive real-time applications where optimal execution speed is critical. By using these routines instead (...)
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FAXLIB — FAX library (FAXLIB) for C66x, C64x+ and C55x processors

Voice Library - VoLIB provides components that, together, facilitate the development of the signal processing chain for Voice over IP applications such as infrastructure, enterprise, residential gateways and IP phones. Together with optimized implementations of ITU-T voice codecs, that can be (...)

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SPRC264 — TMS320C5000/6000 Biblioteca de imágenes (IMGLIB)

C5000/6000 Image Processing Library (IMGLIB) is an optimized image/video processing function library for C programmers. It includes C-callable general-purpose image/video processing routines that are typically used in computationally intensive real-time applications. With these routines, higher (...)
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VOLIB — Voice library (VoLIB) for C66x, C64x+ and C55x processors

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66AK2G12 — DSP+Arm multinúcleo de alto rendimiento: 1x Arm, núcleos A15, 1x C66x DSP núcleo
Procesadores digitales de señales (DSP)
DM505 — SoC para Vision Analytics, encapsulado de 15 mm SM320C6201-EP — DSP de punto fijo C6201 de producto mejorado SM320C6415-EP — DSP de punto fijo C6415 de producto mejorado SM320C6424-EP — DSP de punto fijo C6424 de producto mejorado SM320C6455-EP — DSP de punto fijo C6455 de producto mejorado SM320C6472-HIREL — DSP de punto fijo C6472 de 6 núcleos de producto de alta confiabilidad SM320C6678-HIREL — DSP de punto flotante y fijo C6678 de 8 núcleos de alto rendimiento y de producto de alta confiabili SM320C6701 — DSP de punto flotante C67x de núcleo único para aplicaciones militares, de hasta 167 MHz SM320C6701-EP — DSP de punto flotante C6701 de producto mejorado SM320C6711D-EP — DSP de punto flotante C6711D de producto mejorado SM320C6712D-EP — DSP C6712D de producto mejorado SM320C6713B-EP — DSP de punto flotante C6713 de producto mejorado SM320C6727B — DSP de punto flotante C6727B de calidad militar SM320C6727B-EP — DSP de punto flotante C6727 de producto mejorado SMJ320C6201B — Procesador de señal digital de punto fijo, de calidad militar SMJ320C6203 — DSP de punto fijo de calidad militar C62x: encapsulado cerámico SMJ320C6701 — DSP de punto flotante de calidad militar C67x: encapsulado cerámico SMJ320C6701-SP — DSP de punto flotante de calidad espacial C6701: clase V tolerante a radiación con encapsulado cerám SMV320C6727B-SP — DSP de punto flotante de nivel espacial C6727B de clase V tolerante a la radiación con encapsulado c TMS320C5517 — DSP de punto fijo C55x de baja potencia y hasta 200 MHz, con USB, interfaz LCD, FFT HWA y SAR ADC TMS320C5532 — DSP de punto fijo C55x de baja potencia y hasta 100 MHz TMS320C5533 — DSP de punto fijo C55x de baja potencia y hasta 100 MHz, con USB TMS320C5534 — DSP de punto fijo C55x de baja potencia y hasta 100 MHz, con interfaz LCD TMS320C5535 — DSP de punto fijo C55x de baja potencia y hasta 100MHz, con USB, interfaz LCD, FFT HWA y SAR ADC TMS320C6202B — DSP de punto fijo C62x de hasta 300 MHz y 384 KB TMS320C6203B — DSP de punto fijo C62x de hasta 300 MHz y 896 KB TMS320C6204 — Procesador de señal digital de punto fijo TMS320C6205 — Procesador de señal digital de punto fijo TMS320C6211B — DSP de punto fijo C62x de hasta 167 MHz TMS320C6414 — DSP de punto fijo C64x de hasta 720 MHz, McBSP TMS320C6415 — DSP de punto fijo C64x de hasta 720 MHz, con McBSP y PCI TMS320C6416 — DSP de punto fijo C64x de hasta 720 MHz, con McBSP, PCI y VCP/TCP TMS320C6421Q — DSP de punto fijo C64x+ de hasta 600 MHz, EMIFA de 8 bits y DDR2 de 16 bits TMS320C6424Q — DSP de punto fijo C64x+ de hasta 600 MHz, EMIFA de 16/8 bits y DDR2 de 32/16 bits TMS320C6454 — DSP de punto fijo C64x+ de hasta 1 GHz, con EMIFA de 64 bits, DDR2 de 32/16 bits y Ethernet de 1 Gbp TMS320C6457 — Procesador de señal digital de infraestructura de comunicaciones TMS320C6701 — DSP de punto flotante C67x de hasta 167 MHz, con McBSP TMS320C6711D — DSP de punto flotante C67x de hasta 250MHz, con McBSP y EMIFA de 32 bits TMS320C6712D — DSP de punto flotante C67x de hasta 150 MHz, McBSP y EMIFA de 16 bits TMS320C6720 — DSP de punto flotante C67x de hasta 200 MHz, McASP y EMIFA de 16 bits TMS320C6722B — DSP de punto flotante C67x de hasta 250 MHz, McASP y EMIFA de 16 bits TMS320C6726B — DSP de punto flotante C67x de hasta 266 MHz, McASP y EMIFA de 16 bits TMS320C6727 — DSP de punto flotante C67x de hasta 250 MHz, McASP y EMIFA de 32 bits TMS320C6727B — DSP de punto flotante C67x de hasta 350 MHz, McASP y EMIFA de 32 bits TMS320C6743 — DSP de punto flotante C674x de 375 MHz y baja potencia TMS320C6745 — DSP de punto flotante C674x de 456 MHz y baja potencia, con QFP TMS320C6747 — DSP de punto flotante C674x de 456 MHz y baja potencia, con PBGA TMS320DM642Q — Procesador de señal digital de punto fijo de imágenes y video TMS320DM6431Q — Procesador de medios digitales de hasta 2,400 MIPS y velocidad de reloj de 300 MHz TMS320DM6435Q — Procesador de medios digitales de hasta 4.800 MIPS y velocidad de reloj de 600 MHz, 1 McASP y 1 McBS TMS320DM6437Q — Procesador de medios digitales de hasta 4800 MIPS y velocidad de reloj de 600 MHz con 1 McASP y 2 Mc TMS320DM6441 — Sistema en chip de medios digitales DaVinci TMS320DM6467T — Sistema de medios digitales en chip TMS320DM647 — Procesador de medios digitales
Opciones de descarga
IDE, configuración, compilador o depurador

CCSTUDIO — Code Composer Studio™ integrated development environment (IDE)

Code Composer Studio is an integrated development environment (IDE) for TI's microcontrollers and processors. It is comprised of a rich suite of tools used to build, debug, analyze and optimize embedded applications. Code Composer Studio is available across Windows®, Linux® and macOS® platforms.

(...)

Productos y hardware compatibles

Productos y hardware compatibles

Este recurso de diseño es compatible con la mayoría de los productos de estas categorías.

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Códec de software

ADT-3P-DSPVOIPCODECS — Tecnologías digitales adaptables DSP VOIP, códecs de voz y audio

Adaptive Digital is a developer of voice quality enhancement algorithms, and best-in-class acoustic echo cancellation software that work with TI DSPs. Adaptive Digital has extensive experience in the algorithm development, implementation, optimization and configuration tuning. They provide (...)
Desde: Adaptive Digital Technologies, Inc.
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Códec de software

VOCAL-3P-DSPVOIPCODECS — Códecs de tecnologías vocales DSP VoIP

With over 25 years of assembly and C code development, VOCAL modular software suite is available for a wide variety of TI DSPs. Products include ATAs, VoIP servers and gateways, HPNA-based IPBXs, video surveillance, voice and video conferencing, voice and data RF devices, RoIP gateways, secure (...)
Desde: VOCAL Technologies, Ltd.
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Modelo de simulación

C6743 PTP BSDL Model (Rev. B)

SPRM385B.ZIP (16 KB) - BSDL Model
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Modelo de simulación

C6743 PTP IBIS Model (Rev. B)

SPRM388B.ZIP (109 KB) - IBIS Model
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Modelo de simulación

C6743 ZKB BSDL Model (Rev. B)

SPRM386B.ZIP (17 KB) - BSDL Model
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Modelo de simulación

C6743 ZKB IBIS Model (Rev. B)

SPRM387B.ZIP (176 KB) - IBIS Model
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Esquema

TMS320C6743 PTP Allegro Footprint (Rev. A)

SPRR122A.ZIP (54 KB)
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Esquema

TMS320C6743 PTP OrCAD Symbol

SPRR123.ZIP (4 KB)
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Esquema

TMS320C6743 ZKB Allegro Footprint (Rev. A)

SPRR124A.ZIP (36 KB)
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Esquema

TMS320C6743 ZKB OrCAD Symbol

SPRR125.ZIP (5 KB)
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Encapsulado Pines Símbolos CAD, huellas y modelos 3D
HLQFP (PTP) 176 Ultra Librarian
PBGA (ZKB) 256 Ultra Librarian
Se aplican los Términos y condiciones estándar de TI para los elementos de evaluación.

Pedidos y calidad

Información incluida:
  • RoHS
  • REACH
  • Marcado del dispositivo
  • Acabado de plomo/material de la bola
  • Clasificación de nivel de sensibilidad a la humedad (MSL) / reflujo máximo
  • Estimaciones de tiempo medio entre fallas (MTBF)/fallas en el tiempo (FIT)
  • Contenido del material
  • Resumen de calificaciones
  • Monitoreo continuo de confiabilidad
Información incluida:
  • Lugar de fabricación
  • Lugar de ensamblaje

Soporte y capacitación

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