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Procesadores digitales de señales (DSP)

TMS320C5517

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DSP de punto fijo C55x de baja potencia y hasta 200 MHz, con USB, interfaz LCD, FFT HWA y SAR ADC

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TMS320C5517

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Detalles del producto

DSP type 1 C55x DSP (max) (MHz) 75, 200 CPU 16-bit Operating system DSP/BIOS, VLX Rating Catalog Operating temperature range (°C) -40 to 85
DSP type 1 C55x DSP (max) (MHz) 75, 200 CPU 16-bit Operating system DSP/BIOS, VLX Rating Catalog Operating temperature range (°C) -40 to 85
NFBGA (ZCH) 196 100 mm² 10 x 10
  • CORE:
    • High-Performance, Low-Power, TMS320C55x Fixed-Point Digital Signal Processor
      • 13.33- to 5-ns Instruction Cycle Time
      • 75- to 200-MHz Clock Rate
      • One or Two Instructions Executed per Cycle
      • Dual Multiply-and-Accumulate Units (Up to 450 Million Multiply-Accumulates per Second [MMACS])
      • Two Arithmetic and Logic Units (ALUs)
      • Three Internal Data or Operand Read Buses and Two Write Buses
      • Software-Compatible with C55x Devices
      • Industrial Temperature Devices Available
    • 320KB of Zero-Wait State On-Chip RAM:
      • 64KB of Dual-Access RAM (DARAM),
        8 Blocks of 4K x 16-Bit
      • 256KB of Single-Access RAM (SARAM),
        32 Blocks of 4K x 16-Bit
    • 128KB of Zero Wait-State On-Chip ROM
      (4 Blocks of 16K x 16-Bit)
    • Tightly Coupled FFT Hardware Accelerator
  • PERIPHERAL:
    • One Universal Host-Port Interface (UHPI) with 16-Bit Muxed Address or Data Bus
    • Master and Slave Multichannel Serial Ports Interface (McSPI) with Three Chip Selects
    • Master and Slave Multichannel Buffered Serial Ports Interface (McBSP)
    • 16- and 8-Bit External Memory Interface (EMIF) with Glueless Interface to:
      • 8- or 16-Bit NAND Flash, 1- or 4-Bit ECC
      • 8- and 16-Bit NOR Flash
      • Asynchronous Static RAM (SRAM)
      • SDRAM or mSDRAM (1.8, 2.75, and 3.3 V)
    • 3.84375M x 16-Bit Maximum Addressable External Memory Space (SDRAM or mSDRAM)
    • Universal Asynchronous Receiver/Transmitter (UART)
    • Device USB Port with Integrated 2.0 High-Speed PHY that Supports:
      • USB 2.0 Full- and High-Speed Devices
    • Direct Memory Access (DMA) Controller
      • Four DMA with Four Channels Each
    • Three 32-Bit General-Purpose (GP) Timers
      • One Selectable as a Watchdog or GP
      • Clocking Options, Including External General-Purpose I/O (GPIO) Clock Input
    • Two MultiMedia Card and Secure Digital (eMMC, MMC, and SD) Interfaces
    • Serial Port Interface (SPI) with Four Chip Selects
    • Master and Slave Inter-Integrated Circuit (I2C Bus)
    • Three Inter-IC Sound (I2S Bus) Modules for Data Transport
    • 10-Bit 4-Input Successive Approximation (SAR) ADC
    • IEEE-1149.1 (JTAG)
      Boundary-Scan-Compatible
    • Up to 26 GPIO Pins (Multiplexed with Other Functions)
  • POWER:
    • Four Core Isolated Power Supply Domains: Analog, RTC, CPU and Peripherals, and USB
    • Four I/O Isolated Power Supply Domains: RTC I/O, EMIF I/O, USB PHY, and DVDDIO
    • 1.05-V Core, 1.8-, 2.75-, or 3.3-V I/Os
    • 1.3-V Core, 1.8-, 2.75-, or 3.3-V I/Os
    • 1.4-V Core, 1.8-, 2.75-, or 3.3-V I/Os
  • CLOCK:
    • Real-Time Clock (RTC) with Crystal Input, Separate Clock Domain, and Power Supply
    • Software-Programmable Phase-Locked Loop (PLL) Clock Generator
  • BOOTLOADER:
    • On-Chip ROM Bootloader
      • Each Peripheral Supports Unencrypted Booting
  • PACKAGE:
    • 196-Terminal Pb-Free Plastic BGA (Ball Grid Array) (ZCH Suffix), 0.65-mm Pitch

All trademarks are the property of their respective owners. All trademarks are the property of their respective owners.

  • CORE:
    • High-Performance, Low-Power, TMS320C55x Fixed-Point Digital Signal Processor
      • 13.33- to 5-ns Instruction Cycle Time
      • 75- to 200-MHz Clock Rate
      • One or Two Instructions Executed per Cycle
      • Dual Multiply-and-Accumulate Units (Up to 450 Million Multiply-Accumulates per Second [MMACS])
      • Two Arithmetic and Logic Units (ALUs)
      • Three Internal Data or Operand Read Buses and Two Write Buses
      • Software-Compatible with C55x Devices
      • Industrial Temperature Devices Available
    • 320KB of Zero-Wait State On-Chip RAM:
      • 64KB of Dual-Access RAM (DARAM),
        8 Blocks of 4K x 16-Bit
      • 256KB of Single-Access RAM (SARAM),
        32 Blocks of 4K x 16-Bit
    • 128KB of Zero Wait-State On-Chip ROM
      (4 Blocks of 16K x 16-Bit)
    • Tightly Coupled FFT Hardware Accelerator
  • PERIPHERAL:
    • One Universal Host-Port Interface (UHPI) with 16-Bit Muxed Address or Data Bus
    • Master and Slave Multichannel Serial Ports Interface (McSPI) with Three Chip Selects
    • Master and Slave Multichannel Buffered Serial Ports Interface (McBSP)
    • 16- and 8-Bit External Memory Interface (EMIF) with Glueless Interface to:
      • 8- or 16-Bit NAND Flash, 1- or 4-Bit ECC
      • 8- and 16-Bit NOR Flash
      • Asynchronous Static RAM (SRAM)
      • SDRAM or mSDRAM (1.8, 2.75, and 3.3 V)
    • 3.84375M x 16-Bit Maximum Addressable External Memory Space (SDRAM or mSDRAM)
    • Universal Asynchronous Receiver/Transmitter (UART)
    • Device USB Port with Integrated 2.0 High-Speed PHY that Supports:
      • USB 2.0 Full- and High-Speed Devices
    • Direct Memory Access (DMA) Controller
      • Four DMA with Four Channels Each
    • Three 32-Bit General-Purpose (GP) Timers
      • One Selectable as a Watchdog or GP
      • Clocking Options, Including External General-Purpose I/O (GPIO) Clock Input
    • Two MultiMedia Card and Secure Digital (eMMC, MMC, and SD) Interfaces
    • Serial Port Interface (SPI) with Four Chip Selects
    • Master and Slave Inter-Integrated Circuit (I2C Bus)
    • Three Inter-IC Sound (I2S Bus) Modules for Data Transport
    • 10-Bit 4-Input Successive Approximation (SAR) ADC
    • IEEE-1149.1 (JTAG)
      Boundary-Scan-Compatible
    • Up to 26 GPIO Pins (Multiplexed with Other Functions)
  • POWER:
    • Four Core Isolated Power Supply Domains: Analog, RTC, CPU and Peripherals, and USB
    • Four I/O Isolated Power Supply Domains: RTC I/O, EMIF I/O, USB PHY, and DVDDIO
    • 1.05-V Core, 1.8-, 2.75-, or 3.3-V I/Os
    • 1.3-V Core, 1.8-, 2.75-, or 3.3-V I/Os
    • 1.4-V Core, 1.8-, 2.75-, or 3.3-V I/Os
  • CLOCK:
    • Real-Time Clock (RTC) with Crystal Input, Separate Clock Domain, and Power Supply
    • Software-Programmable Phase-Locked Loop (PLL) Clock Generator
  • BOOTLOADER:
    • On-Chip ROM Bootloader
      • Each Peripheral Supports Unencrypted Booting
  • PACKAGE:
    • 196-Terminal Pb-Free Plastic BGA (Ball Grid Array) (ZCH Suffix), 0.65-mm Pitch

All trademarks are the property of their respective owners. All trademarks are the property of their respective owners.

This device is a member of TI's C5000 fixed-point Digital Signal Processor (DSP) product family and is designed for low active and standby power consumption.

The device is based on the TMS320C55x DSP generation CPU processor core. The C55x DSP architecture achieves high performance and low power through increased parallelism and total focus on power savings. The CPU supports an internal bus structure that is composed of one program bus, one 32-bit data read bus and two 16-bit data read buses, two 16-bit data write buses, and additional buses dedicated to peripheral and DMA activity. These buses provide the ability to perform up to four 16-bit data reads and two 16-bit data writes in a single cycle. The device also includes four DMA controllers, each with 4 channels, providing data movement for 16 independent channel contexts without CPU intervention. Each DMA controller can perform one 32-bit data transfer per cycle, in parallel and independent of the CPU activity.

The C55x CPU provides two multiply-accumulate (MAC) units, each capable of 17-bit x 17-bit multiplication and a 32-bit add in a single cycle. A central 40-bit arithmetic and logic unit (ALU) is supported by an additional 16-bit ALU. Use of the ALUs is under instruction set control, providing the ability to optimize parallel activity and power consumption. These resources are managed in the Address Unit (AU) and Data Unit (DU) of the C55x CPU.

The C55x CPU supports a variable byte width instruction set for improved code density. The Instruction Unit (IU) performs 32-bit program fetches from internal or external memory and queues instructions for the Program Unit (PU). The PU decodes the instructions, directs tasks to the AU and DU resources, and manages the fully protected pipeline. Predictive branching capability avoids pipeline flushes on execution of conditional instructions.

The GPIO functions along with the 10-bit SAR ADC to provide sufficient pins for status, interrupts, and bit I/O for keyboards, and media interfaces.

Serial media is supported through two multimedia card and secure digital (MMC and SD) peripherals, three Inter-IC Sound (I2S Bus) modules, one serial port interface (SPI) with up to four chip selects, one master and slave multichannel serial port interface (McSPI) with up to three chip selects, one multichannel serial port (McBSP), one I2C multimaster and slave interface, and a universal asynchronous receiver/transmitter (UART) interface

The device peripheral set includes an external memory interface (EMIF) that provides glueless access to asynchronous memories, such as EPROM, NOR, NAND, and SRAM, as well as to high-speed, high-density memories such as synchronous DRAM (SDRAM) and mobile SDRAM (mSDRAM).

Additional peripherals include a configurable 16-bit universal host-port interface (UHPI), a high-speed universal serial bus (USB2.0) device mode only, a real-time clock (RTC), three general-purpose timers with one configurable as a watchdog timer, and an analog phase-locked loop (APLL) clock generator.

The device also includes a tightly coupled FFT hardware accelerate that supports 8- to 1024-point (by power of 2) real- and complex-valued FFTs and three integrated LDOs to power different sections of the device, except CVDDRTC which requires an external power source: ANA_LDO to provide 1.3 V to the SAR and power-management circuits (VDDA_ANA), DSP_LDO to provide 1.3 or 1.05 V to the DSP core (CVDD), selectable on-the-fly by software as long as operating frequency ranges are observed, and USB_LDO to provide 1.3 V to the USB core digital (USB_VDD1P3) and PHY circuits (USB_VDDA1P3).

The device is supported by the industry’s award-winning eXpressDSP, Code Composer Studio Integrated Development Environment (IDE), DSP/BIOS, Texas Instruments’ algorithm standard, and a large third-party network. Code Composer Studio IDE features code generation tools including a C Compiler and Linker, RTDX, XDS100, XDS510, XDS560 emulation device drivers, and evaluation modules. The device is also supported by the C55x DSP library which features more than 50 foundational software kernels (FIR filters, IIR filters, FFTs, and various math functions) as well as chip support libraries.

This device is a member of TI's C5000 fixed-point Digital Signal Processor (DSP) product family and is designed for low active and standby power consumption.

The device is based on the TMS320C55x DSP generation CPU processor core. The C55x DSP architecture achieves high performance and low power through increased parallelism and total focus on power savings. The CPU supports an internal bus structure that is composed of one program bus, one 32-bit data read bus and two 16-bit data read buses, two 16-bit data write buses, and additional buses dedicated to peripheral and DMA activity. These buses provide the ability to perform up to four 16-bit data reads and two 16-bit data writes in a single cycle. The device also includes four DMA controllers, each with 4 channels, providing data movement for 16 independent channel contexts without CPU intervention. Each DMA controller can perform one 32-bit data transfer per cycle, in parallel and independent of the CPU activity.

The C55x CPU provides two multiply-accumulate (MAC) units, each capable of 17-bit x 17-bit multiplication and a 32-bit add in a single cycle. A central 40-bit arithmetic and logic unit (ALU) is supported by an additional 16-bit ALU. Use of the ALUs is under instruction set control, providing the ability to optimize parallel activity and power consumption. These resources are managed in the Address Unit (AU) and Data Unit (DU) of the C55x CPU.

The C55x CPU supports a variable byte width instruction set for improved code density. The Instruction Unit (IU) performs 32-bit program fetches from internal or external memory and queues instructions for the Program Unit (PU). The PU decodes the instructions, directs tasks to the AU and DU resources, and manages the fully protected pipeline. Predictive branching capability avoids pipeline flushes on execution of conditional instructions.

The GPIO functions along with the 10-bit SAR ADC to provide sufficient pins for status, interrupts, and bit I/O for keyboards, and media interfaces.

Serial media is supported through two multimedia card and secure digital (MMC and SD) peripherals, three Inter-IC Sound (I2S Bus) modules, one serial port interface (SPI) with up to four chip selects, one master and slave multichannel serial port interface (McSPI) with up to three chip selects, one multichannel serial port (McBSP), one I2C multimaster and slave interface, and a universal asynchronous receiver/transmitter (UART) interface

The device peripheral set includes an external memory interface (EMIF) that provides glueless access to asynchronous memories, such as EPROM, NOR, NAND, and SRAM, as well as to high-speed, high-density memories such as synchronous DRAM (SDRAM) and mobile SDRAM (mSDRAM).

Additional peripherals include a configurable 16-bit universal host-port interface (UHPI), a high-speed universal serial bus (USB2.0) device mode only, a real-time clock (RTC), three general-purpose timers with one configurable as a watchdog timer, and an analog phase-locked loop (APLL) clock generator.

The device also includes a tightly coupled FFT hardware accelerate that supports 8- to 1024-point (by power of 2) real- and complex-valued FFTs and three integrated LDOs to power different sections of the device, except CVDDRTC which requires an external power source: ANA_LDO to provide 1.3 V to the SAR and power-management circuits (VDDA_ANA), DSP_LDO to provide 1.3 or 1.05 V to the DSP core (CVDD), selectable on-the-fly by software as long as operating frequency ranges are observed, and USB_LDO to provide 1.3 V to the USB core digital (USB_VDD1P3) and PHY circuits (USB_VDDA1P3).

The device is supported by the industry’s award-winning eXpressDSP, Code Composer Studio Integrated Development Environment (IDE), DSP/BIOS, Texas Instruments’ algorithm standard, and a large third-party network. Code Composer Studio IDE features code generation tools including a C Compiler and Linker, RTDX, XDS100, XDS510, XDS560 emulation device drivers, and evaluation modules. The device is also supported by the C55x DSP library which features more than 50 foundational software kernels (FIR filters, IIR filters, FFTs, and various math functions) as well as chip support libraries.
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Documentación técnica

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Tipo Título Fecha
* Data sheet TMS320C5517 Fixed-Point Digital Signal Processor datasheet (Rev. C) PDF | HTML 23 abr 2014
* Errata TMS320C5517 Fixed-Point DSP Silicon Errata (Rev. B) 07 sep 2017
* User guide TMS320C5517 Digital Signal Processor Technical Reference Manual (Rev. B) 01 oct 2015
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Application note Instructions to Benchmark C55 DSP Library 01 abr 2016
Application note C5000 DSP-Based Low-Power System Design 30 nov 2015
Application note Power Estimation and Power Consumption summary for TMS320C5517 Device 06 oct 2015
Application note Estimating Power Consumption on the TMS320C5517 02 abr 2014
Application note Migrating from TMS320C5515 to 5517 02 abr 2014
Application note Validating High- and Full-Speed USB on TMS320C5517 02 abr 2014
User guide TMS320C55x Assembly Language Tools User's Guide (Rev. I) 09 nov 2011
User guide TMS320C55x Optimizing C/C++ Compiler User's Guide (Rev. G) 09 nov 2011
User guide TMS320C55x v3.x DSP Algebraic Instruction Set Reference Guide (Rev. E) 24 jun 2009
User guide TMS320C55x v3.x DSP Mnemonic Instruction Set Reference Guide (Rev. E) 24 jun 2009
User guide TMS320C55x DSP v3.x CPU Reference Guide (Rev. E) 17 jun 2009

Diseño y desarrollo

Para conocer los términos adicionales o los recursos necesarios, haga clic en cualquier título de abajo para ver la página de detalles cuando esté disponible.

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TMDSEMU200-U — Sonda de depuración XDS200 USB

El XDS200 es una sonda de depuración (emulador) que se utiliza para depurar dispositivos integrados de TI. El XDS200 presenta un equilibrio de bajo costo con buen rendimiento en comparación con el XDS110 de bajo costo y el XDS560v2 de alto rendimiento. Es compatible con una amplia (...)

No disponible en TI.com
Sonda de depuración

TMDSEMU560V2STM-U — Sonda de depuración USB de seguimiento del sistema XDS560v2

The XDS560v2 is the highest performance of the XDS560™ family of debug probes and supports both the traditional JTAG standard (IEEE1149.1) and cJTAG (IEEE1149.7).  Note that it does not support serial wire debug (SWD).

All XDS debug probes support Core and System Trace in all ARM and DSP processors (...)

No disponible en TI.com
Sonda de depuración

TMDSEMU560V2STM-UE — Sonda de depuración USB y ethernet de seguimiento del sistema XDS560v2

The XDS560v2 is the highest performance of the XDS560™ family of debug probes and supports both the traditional JTAG standard (IEEE1149.1) and cJTAG (IEEE1149.7). Note that it does not support serial wire debug (SWD).

All XDS debug probes support Core and System Trace in all ARM and DSP processors (...)

No disponible en TI.com
Controlador o biblioteca

AEC-AER — Acoustic echo cancellation/removal for TI C64x+, C674x, C55x and Cortex®-A8 processors

Voice Library - VoLIB provides components that, together, facilitate the development of the signal processing chain for Voice over IP applications such as infrastructure, enterprise, residential gateways and IP phones. Together with optimized implementations of ITU-T voice codecs, that can be (...)

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Controlador o biblioteca

FAXLIB — FAX library (FAXLIB) for C66x, C64x+ and C55x processors

Voice Library - VoLIB provides components that, together, facilitate the development of the signal processing chain for Voice over IP applications such as infrastructure, enterprise, residential gateways and IP phones. Together with optimized implementations of ITU-T voice codecs, that can be (...)

Productos y hardware compatibles

Productos y hardware compatibles

Productos
Procesadores basados en Arm
66AK2G12 — DSP+Arm multinúcleo de alto rendimiento: 1x Arm, núcleos A15, 1x C66x DSP núcleo
Procesadores digitales de señales (DSP)
DM505 — SoC para Vision Analytics, encapsulado de 15 mm SM320C6201-EP — DSP de punto fijo C6201 de producto mejorado SM320C6415-EP — DSP de punto fijo C6415 de producto mejorado SM320C6424-EP — DSP de punto fijo C6424 de producto mejorado SM320C6455-EP — DSP de punto fijo C6455 de producto mejorado SM320C6472-HIREL — DSP de punto fijo C6472 de 6 núcleos de producto de alta confiabilidad SM320C6678-HIREL — DSP de punto flotante y fijo C6678 de 8 núcleos de alto rendimiento y de producto de alta confiabili SM320C6701 — DSP de punto flotante C67x de núcleo único para aplicaciones militares, de hasta 167 MHz SM320C6701-EP — DSP de punto flotante C6701 de producto mejorado SM320C6711D-EP — DSP de punto flotante C6711D de producto mejorado SM320C6712D-EP — DSP C6712D de producto mejorado SM320C6713B-EP — DSP de punto flotante C6713 de producto mejorado SM320C6727B — DSP de punto flotante C6727B de calidad militar SM320C6727B-EP — DSP de punto flotante C6727 de producto mejorado SMJ320C6201B — Procesador de señal digital de punto fijo, de calidad militar SMJ320C6203 — DSP de punto fijo de calidad militar C62x: encapsulado cerámico SMJ320C6701 — DSP de punto flotante de calidad militar C67x: encapsulado cerámico SMJ320C6701-SP — DSP de punto flotante de calidad espacial C6701: clase V tolerante a radiación con encapsulado cerám SMV320C6727B-SP — DSP de punto flotante de nivel espacial C6727B de clase V tolerante a la radiación con encapsulado c TMS320C5517 — DSP de punto fijo C55x de baja potencia y hasta 200 MHz, con USB, interfaz LCD, FFT HWA y SAR ADC TMS320C5532 — DSP de punto fijo C55x de baja potencia y hasta 100 MHz TMS320C5533 — DSP de punto fijo C55x de baja potencia y hasta 100 MHz, con USB TMS320C5534 — DSP de punto fijo C55x de baja potencia y hasta 100 MHz, con interfaz LCD TMS320C5535 — DSP de punto fijo C55x de baja potencia y hasta 100MHz, con USB, interfaz LCD, FFT HWA y SAR ADC TMS320C6202B — DSP de punto fijo C62x de hasta 300 MHz y 384 KB TMS320C6203B — DSP de punto fijo C62x de hasta 300 MHz y 896 KB TMS320C6204 — Procesador de señal digital de punto fijo TMS320C6205 — Procesador de señal digital de punto fijo TMS320C6211B — DSP de punto fijo C62x de hasta 167 MHz TMS320C6414 — DSP de punto fijo C64x de hasta 720 MHz, McBSP TMS320C6415 — DSP de punto fijo C64x de hasta 720 MHz, con McBSP y PCI TMS320C6416 — DSP de punto fijo C64x de hasta 720 MHz, con McBSP, PCI y VCP/TCP TMS320C6421Q — DSP de punto fijo C64x+ de hasta 600 MHz, EMIFA de 8 bits y DDR2 de 16 bits TMS320C6424Q — DSP de punto fijo C64x+ de hasta 600 MHz, EMIFA de 16/8 bits y DDR2 de 32/16 bits TMS320C6454 — DSP de punto fijo C64x+ de hasta 1 GHz, con EMIFA de 64 bits, DDR2 de 32/16 bits y Ethernet de 1 Gbp TMS320C6457 — Procesador de señal digital de infraestructura de comunicaciones TMS320C6701 — DSP de punto flotante C67x de hasta 167 MHz, con McBSP TMS320C6711D — DSP de punto flotante C67x de hasta 250MHz, con McBSP y EMIFA de 32 bits TMS320C6712D — DSP de punto flotante C67x de hasta 150 MHz, McBSP y EMIFA de 16 bits TMS320C6720 — DSP de punto flotante C67x de hasta 200 MHz, McASP y EMIFA de 16 bits TMS320C6722B — DSP de punto flotante C67x de hasta 250 MHz, McASP y EMIFA de 16 bits TMS320C6726B — DSP de punto flotante C67x de hasta 266 MHz, McASP y EMIFA de 16 bits TMS320C6727 — DSP de punto flotante C67x de hasta 250 MHz, McASP y EMIFA de 32 bits TMS320C6727B — DSP de punto flotante C67x de hasta 350 MHz, McASP y EMIFA de 32 bits TMS320C6743 — DSP de punto flotante C674x de 375 MHz y baja potencia TMS320C6745 — DSP de punto flotante C674x de 456 MHz y baja potencia, con QFP TMS320C6747 — DSP de punto flotante C674x de 456 MHz y baja potencia, con PBGA TMS320DM642Q — Procesador de señal digital de punto fijo de imágenes y video TMS320DM6431Q — Procesador de medios digitales de hasta 2,400 MIPS y velocidad de reloj de 300 MHz TMS320DM6435Q — Procesador de medios digitales de hasta 4.800 MIPS y velocidad de reloj de 600 MHz, 1 McASP y 1 McBS TMS320DM6437Q — Procesador de medios digitales de hasta 4800 MIPS y velocidad de reloj de 600 MHz con 1 McASP y 2 Mc TMS320DM6441 — Sistema en chip de medios digitales DaVinci TMS320DM6467T — Sistema de medios digitales en chip TMS320DM647 — Procesador de medios digitales
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SPRC264 — TMS320C5000/6000 Biblioteca de imágenes (IMGLIB)

C5000/6000 Image Processing Library (IMGLIB) is an optimized image/video processing function library for C programmers. It includes C-callable general-purpose image/video processing routines that are typically used in computationally intensive real-time applications. With these routines, higher (...)
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VOLIB — Voice library (VoLIB) for C66x, C64x+ and C55x processors

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IDE, configuración, compilador o depurador

CCSTUDIO — Code Composer Studio™ integrated development environment (IDE)

Code Composer Studio is an integrated development environment (IDE) for TI's microcontrollers and processors. It is comprised of a rich suite of tools used to build, debug, analyze and optimize embedded applications. Code Composer Studio is available across Windows®, Linux® and macOS® platforms.

(...)

Productos y hardware compatibles

Productos y hardware compatibles

Este recurso de diseño es compatible con la mayoría de los productos de estas categorías.

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Códec de software

ADT-3P-DSPVOIPCODECS — Tecnologías digitales adaptables DSP VOIP, códecs de voz y audio

Adaptive Digital is a developer of voice quality enhancement algorithms, and best-in-class acoustic echo cancellation software that work with TI DSPs. Adaptive Digital has extensive experience in the algorithm development, implementation, optimization and configuration tuning. They provide (...)
Desde: Adaptive Digital Technologies, Inc.
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Códec de software

ALGOT-3P-DSPVOIPCODECS — Códecs de audio y telecomunicaciones DSP Algotron C5000

Algotron provides C5000 DSP software modules for telecoms & audio. Examples are: modem data pumps, speech coders, signal generators & detectors for DTMF and caller ID. All modules feature simple yet flexible interfaces with full re-entrancy. They come with user's guides, example (...)
Desde: Algotron
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Códec de software

DSPI-3P-DSPVOIPCODECS — Innovaciones en DSP: Códecs VoIP DSP

DSP Innovations is a supplier of C5000TM DSP-software and engineering services. Proprietary and standard vocoders from DSPINI have superior characteristics, operate in range from 300 bps up to 64 kbps and are used in: secure voice, software defined radio, wireless, VoIP, voice storage, and more. (...)
Desde: DSP Innovations
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Códec de software

VOCAL-3P-DSPVOIPCODECS — Códecs de tecnologías vocales DSP VoIP

With over 25 years of assembly and C code development, VOCAL modular software suite is available for a wide variety of TI DSPs. Products include ATAs, VoIP servers and gateways, HPNA-based IPBXs, video surveillance, voice and video conferencing, voice and data RF devices, RoIP gateways, secure (...)
Desde: VOCAL Technologies, Ltd.
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Modelo de simulación

C5517 ZCH BSDL Model

SPRM631.ZIP (5 KB) - BSDL Model
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Modelo de simulación

C5517 ZCH IBIS Model

SPRM632.ZIP (902 KB) - IBIS Model
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Diseños de referencia

TIDEP-0083 — Diseño de referencia de activación y procesamiento de voz con conexión en la nube a IBM Watson

This reference design enables a single platform for demonstrating end-to-end voice capture, recognition and processing functionality.  It further enhances application development time by including pre-integration with the sensory keyword recognition software and the IBM Watson Cloud services. (...)
Design guide: PDF
Esquema: PDF
Diseños de referencia

TIDA-01589 — Diseño de referencia de audio bidireccional de campo cercano y alta fidelidad con reducción de ruido

Man machine interaction requires an acoustic interface for providing full duplex hands-free communication. In hands-free mode, part of the far-end or near-end audio signal from the speaker is coupled to the microphones. Furthermore, in noisy environments the microphones also capture ambient noise (...)
Design guide: PDF
Esquema: PDF
Diseños de referencia

TIDEP-0077 — Diseño de referencia del sistema de preprocesamiento de audio para aplicaciones basadas en voz

This reference design uses multiple microphones, a beamforming algorithm, and other processes to extract clear speech and audio amidst noise and other clutter.  The rapid increase in applications that are used in noise-prone environments for voice activated digital assistants creates (...)
Design guide: PDF
Esquema: PDF
Encapsulado Pines Símbolos CAD, huellas y modelos 3D
NFBGA (ZCH) 196 Ultra Librarian
Se aplican los Términos y condiciones estándar de TI para los elementos de evaluación.

Pedidos y calidad

Información incluida:
  • RoHS
  • REACH
  • Marcado del dispositivo
  • Acabado de plomo/material de la bola
  • Clasificación de nivel de sensibilidad a la humedad (MSL) / reflujo máximo
  • Estimaciones de tiempo medio entre fallas (MTBF)/fallas en el tiempo (FIT)
  • Contenido del material
  • Resumen de calificaciones
  • Monitoreo continuo de confiabilidad
Información incluida:
  • Lugar de fabricación
  • Lugar de ensamblaje

Los productos recomendados pueden tener parámetros, módulos de evaluación o diseños de referencia relacionados con este producto de TI.

Soporte y capacitación

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