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CDCBT1001

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Búfer de reloj de 1.2 V a 1.8 V y convertidor de nivel

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CDCBT1001

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Detalles del producto

Function Level translator, Single-ended Output frequency (max) (MHz) 24 Number of outputs 1 Output supply voltage (V) 1.8 Core supply voltage (V) 1.2 Features 1.2V to 1.8V Clock Buffer and Level Translator Operating temperature range (°C) -40 to 85 Rating Catalog Output type LVCMOS Input type LVCMOS
Function Level translator, Single-ended Output frequency (max) (MHz) 24 Number of outputs 1 Output supply voltage (V) 1.8 Core supply voltage (V) 1.2 Features 1.2V to 1.8V Clock Buffer and Level Translator Operating temperature range (°C) -40 to 85 Rating Catalog Output type LVCMOS Input type LVCMOS
X2SON (DPW) 5 0.64 mm² 0.8 x 0.8
  • Clock frequency range: DC to 24 MHz
  • 1.2-V to 1.8-V LVCMOS clock level translation:
    • VDD_IN = 1.2 V ± 10%
    • VDD_OUT = 1.8 V ± 10%
  • Low additive jitter and phase noise:
    • 0.8-ps maximum 12-kHz to 5-MHz additive RMS jitter (fout = 24 MHz)
    • –120-dBc/Hz maximum phase noise at 1-kHz offset (fout = 24 MHz)
    • –148-dBc/Hz maximum phase noise floor (fout = 24 MHz, foffset ≥ 1 MHz)
  • 5-ns 20% to 80% rise/fall time
  • 10-ns propagation delay
  • Low current consumption
  • –40°C to 85°C operating temperature range
  • Clock frequency range: DC to 24 MHz
  • 1.2-V to 1.8-V LVCMOS clock level translation:
    • VDD_IN = 1.2 V ± 10%
    • VDD_OUT = 1.8 V ± 10%
  • Low additive jitter and phase noise:
    • 0.8-ps maximum 12-kHz to 5-MHz additive RMS jitter (fout = 24 MHz)
    • –120-dBc/Hz maximum phase noise at 1-kHz offset (fout = 24 MHz)
    • –148-dBc/Hz maximum phase noise floor (fout = 24 MHz, foffset ≥ 1 MHz)
  • 5-ns 20% to 80% rise/fall time
  • 10-ns propagation delay
  • Low current consumption
  • –40°C to 85°C operating temperature range

The CDCBT1001 is a 1.2-V to 1.8-V clock buffer and level translator. The VDD_IN pin supply voltage defines the input LVCMOS clock level. The VDD_OUT pin supply voltage defines the output LVCMOS clock level. VDD_IN = 1.2 V ± 10%. VDD_OUT = 1.8 V ± 10%

The 12-kHz to 5-MHz additive RMS jitter at 24 MHz is less than 0.8 ps.

The CDCBT1001 is a 1.2-V to 1.8-V clock buffer and level translator. The VDD_IN pin supply voltage defines the input LVCMOS clock level. The VDD_OUT pin supply voltage defines the output LVCMOS clock level. VDD_IN = 1.2 V ± 10%. VDD_OUT = 1.8 V ± 10%

The 12-kHz to 5-MHz additive RMS jitter at 24 MHz is less than 0.8 ps.
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Documentación técnica

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Tipo Título Fecha
* Data sheet CDCBT1001 1.2-V to 1.8-V Clock Buffer and Level Translator datasheet PDF | HTML 20 may 2022
EVM User's guide CDCBT1001EVM Evaluation Instructions PDF | HTML 16 may 2022
Certificate CDCBT1001EVM EU RoHS Declaration of Conformity (DoC) 25 mar 2022

Diseño y desarrollo

Para conocer los términos adicionales o los recursos necesarios, haga clic en cualquier título de abajo para ver la página de detalles cuando esté disponible.

Modelo de simulación

CDCBT1001 IBIS model

SCEM796.ZIP (13 KB) - IBIS Model
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Herramienta de simulación

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X2SON (DPW) 5 Ultra Librarian
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Pedidos y calidad

Información incluida:
  • RoHS
  • REACH
  • Marcado del dispositivo
  • Acabado de plomo/material de la bola
  • Clasificación de nivel de sensibilidad a la humedad (MSL) / reflujo máximo
  • Estimaciones de tiempo medio entre fallas (MTBF)/fallas en el tiempo (FIT)
  • Contenido del material
  • Resumen de calificaciones
  • Monitoreo continuo de confiabilidad
Información incluida:
  • Lugar de fabricación
  • Lugar de ensamblaje

Los productos recomendados pueden tener parámetros, módulos de evaluación o diseños de referencia relacionados con este producto de TI.

Soporte y capacitación

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