DS92LV3221
- Wide Operating Range Embedded Clock SER/DES
- Up to 32-bit Parallel LVCMOS Data
- 20 to 50 MHz Parallel Clock
- Up to 1.6 Gbps Application Data Paylod
- Simplified Clocking Architecture
- No Separate Serial Clock Line
- No Reference Clock Required
- Receiver Locks to Random Data
- On-chip Signal Conditioning for Robust Serial Connectivity
- Transmit Pre-Emphasis
- Data Randomization
- DC-Balance Encoding
- Receive Channel Deskew
- Supports up to 10m CAT-5 at 1.6Gbps
- Integrated LVDS Terminations
- Built-in AT-SPEED BIST for End-To-End System Testing
- AC-Coupled Interconnect for Isolation and Fault Protection
- > 4KV HBM ESD Protection
- Space-Saving 64-pin TQFP Package
- Full Industrial Temperature Range: -40° to +85°C
All trademarks are the property of their respective owners.
The DS92LV3221 (SER) serializes a 32-bit data bus into 2 embedded clock LVDS serial channels for a data payload rate up to 1.6 Gbps over cables such as CATx, or backplanes FR-4 traces. The companion DS92LV3222 (DES) deserializes the 2 LVDS serial data channels, de-skews channel-to-channel delay variations and converts the LVDS data stream back into a 32-bit LVCMOS parallel data bus.
On-chip data Randomization/Scrambling and DC balance encoding and selectable serializer Pre-emphasis ensure a robust, low-EMI transmission over longer, lossy cables and backplanes. The Deserializer automatically locks to incoming data without an external reference clock or special sync patterns, providing an easy “plug-and-lock” operation.
By embedding the clock in the data payload and including signal conditioning functions, the Channel-Link II SerDes devices reduce trace count, eliminate skew issues, simplify design effort and lower cable/connector cost for a wide variety of video, control and imaging applications. A built-in AT-SPEED BIST feature validates link integrity and may be used for system diagnostics.
技術資料
種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
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* | データシート | DS92LV3221/3222 20-50 MHz 32-Bit Channel Link II Serializer / Deserializer データシート (Rev. C) | 2013年 4月 16日 | |||
アプリケーション・ノート | High-Speed Layout Guidelines for Reducing EMI for LVDS SerDes Designs | 2018年 11月 9日 | ||||
アプリケーション・ノート | DS15BA101 & DS15EA101 Enable Long Reach Applications for Embedded Clock SER/DES (Rev. E) | 2013年 4月 29日 | ||||
アプリケーション・ノート | Improving the Robustness of Channel Link Designs with Channel Link II Ser/Des (Rev. A) | 2013年 4月 26日 | ||||
ユーザー・ガイド | DS92LV3241/DS92LV3242 Demonstration Kit User Manual | 2012年 1月 25日 | ||||
設計ガイド | Channel Link II Design Guide | 2011年 1月 21日 |
設計および開発
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PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®
設計とシミュレーション向けの環境である PSpice for TI (...)
TINA-TI — SPICE ベースのアナログ・シミュレーション・プログラム
TINA-TI をインストールするには、約 500MB が必要です。インストールは簡単です。必要に応じてアンインストールも可能です。(そのようなことはないと思いますが)
TINA は DesignSoft (...)
パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
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TQFP (PAG) | 64 | Ultra Librarian |
購入と品質
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用原材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
- ファブの拠点
- 組み立てを実施した拠点