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LM2502

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モバイル・ピクセル・リンク (MPL) ディスプレイ・インターフェイス・シリアライザ / デシリアライザ

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製品詳細

Protocols Catalog Rating Catalog Operating temperature range (°C) -30 to 85
Protocols Catalog Rating Catalog Operating temperature range (°C) -30 to 85
WQFN (RSB) 40 25 mm² 5 x 5
  • >300 Mbps Dual Link Raw Throughput
  • MPL Physical Layer (MPL-0)
  • Pin Selectable Master / Slave Mode
  • Frequency Reference Transport
  • Complete LVCMOS / MPL Translation
  • Interface Modes:
    • 16-bit CPU, i80 or m68 Style
    • RGB565 with Glue Logic
  • −30°C to 85°C Operating Range
  • Link Power Down Mode Reduces IDDZ < 10 µA
  • Dual Display Support (CS1* & CS2*)
  • Via-less MPL Interconnect Feature
  • 3.0V Supply Voltage (VDD and VDDA)
  • Interfaces to 1.7V to 3.3V Logic (VDDIO)

All trademarks are the property of their respective owners.

  • >300 Mbps Dual Link Raw Throughput
  • MPL Physical Layer (MPL-0)
  • Pin Selectable Master / Slave Mode
  • Frequency Reference Transport
  • Complete LVCMOS / MPL Translation
  • Interface Modes:
    • 16-bit CPU, i80 or m68 Style
    • RGB565 with Glue Logic
  • −30°C to 85°C Operating Range
  • Link Power Down Mode Reduces IDDZ < 10 µA
  • Dual Display Support (CS1* & CS2*)
  • Via-less MPL Interconnect Feature
  • 3.0V Supply Voltage (VDD and VDDA)
  • Interfaces to 1.7V to 3.3V Logic (VDDIO)

All trademarks are the property of their respective owners.

The LM2502 device is a dual link display interface SERDES that adapts existing CPU / video busses to a low power current-mode serial MPL link. The chipset may also be used for a RGB565 application with glue logic. The interconnect is reduced from 22 signals to only 3 active signals with the LM2502 chipset easing flex interconnect design, size and cost.

The Master Serializer (SER) resides beside an application processor or baseband processor and translates a parallel bus from LVCMOS levels to serial MPL levels for transmission over a flex cable and PCB traces to the Slave Deserializer (DES) located near the display module.

Dual display support is provided for a primary and sub display through the use of two ChipSelect signals. A Mode pin selects either a i80 or m68 style interface.

The Power_Down (PD*) input controls the power state of the MPL interface. When PD* is asserted, the MD1/0 and MC signals are powered down to save current.

The LM2502 implements the physical layer of the MPL Standard (MPL-0). The LM2502 is offered in NOPB (Lead-free) NFBGA and WQFN packages.

The LM2502 device is a dual link display interface SERDES that adapts existing CPU / video busses to a low power current-mode serial MPL link. The chipset may also be used for a RGB565 application with glue logic. The interconnect is reduced from 22 signals to only 3 active signals with the LM2502 chipset easing flex interconnect design, size and cost.

The Master Serializer (SER) resides beside an application processor or baseband processor and translates a parallel bus from LVCMOS levels to serial MPL levels for transmission over a flex cable and PCB traces to the Slave Deserializer (DES) located near the display module.

Dual display support is provided for a primary and sub display through the use of two ChipSelect signals. A Mode pin selects either a i80 or m68 style interface.

The Power_Down (PD*) input controls the power state of the MPL interface. When PD* is asserted, the MD1/0 and MC signals are powered down to save current.

The LM2502 implements the physical layer of the MPL Standard (MPL-0). The LM2502 is offered in NOPB (Lead-free) NFBGA and WQFN packages.
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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
* データシート LM2502 Mobile Pixel Link (MPL) Display Interface Serializer and Deserializer データシート (Rev. L) 2013年 5月 2日
アプリケーション・ノート Mobile Pixel Link Level-0 2012年 3月 20日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI (...)
リクエスト
シミュレーション・ツール

TINA-TI — SPICE ベースのアナログ・シミュレーション・プログラム

TINA-TI は、DC 解析、過渡解析、周波数ドメイン解析など、SPICE の標準的な機能すべてを搭載しています。TINA には多彩な後処理機能があり、結果を必要なフォーマットにすることができます。仮想計測機能を使用すると、入力波形を選択し、回路ノードの電圧や波形を仮想的に測定することができます。TINA の回路キャプチャ機能は非常に直観的であり、「クイックスタート」を実現できます。

TINA-TI をインストールするには、約 500MB が必要です。インストールは簡単です。必要に応じてアンインストールも可能です。(そのようなことはないと思いますが)

TINA は DesignSoft (...)

ユーザー ガイド: PDF
英語版 (Rev.A): PDF
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パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
WQFN (RSB) 40 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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