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DS40MB200

アクティブ

送信プリエンファシス機能と受信イコライゼーション機能搭載、デュアル、4.0Gbps、2:1/1:2 CML マルチプレクサ / バッファ

製品詳細

Function Equalizer, Mux buffer Protocols CML, LVDS, LVPECL Number of transmitters 2, 4 Number of receivers 2, 4 Supply voltage (V) 3.3 Signaling rate (Mbps) 4000 Input signal CML Output signal CML Rating Catalog Operating temperature range (°C) 0 to 85
Function Equalizer, Mux buffer Protocols CML, LVDS, LVPECL Number of transmitters 2, 4 Number of receivers 2, 4 Supply voltage (V) 3.3 Signaling rate (Mbps) 4000 Input signal CML Output signal CML Rating Catalog Operating temperature range (°C) 0 to 85
WQFN (NJU) 48 49 mm² 7 x 7
  • 1Gbps~4Gbps の低ジッタ動作
  • 固定入力イコライゼーション
  • 出力プリエンファシスをプログラム可能
  • 独立したスイッチおよびライン側のプリエンファシス制御
  • スイッチ側ループバック モードをプログラム可能
  • オンチップ終端
  • 3.3V 電源
  • ESD 定格:6kV HBM
  • 48 リードレス WQFN パッケージ (7mm × 7mm)
  • 0℃~+85℃の動作温度範囲
  • 1Gbps~4Gbps の低ジッタ動作
  • 固定入力イコライゼーション
  • 出力プリエンファシスをプログラム可能
  • 独立したスイッチおよびライン側のプリエンファシス制御
  • スイッチ側ループバック モードをプログラム可能
  • オンチップ終端
  • 3.3V 電源
  • ESD 定格:6kV HBM
  • 48 リードレス WQFN パッケージ (7mm × 7mm)
  • 0℃~+85℃の動作温度範囲

DS40MB200 デバイスは、デュアル シグナル コンディショニング 2:1 マルチプレクサ (MUX) および 1:2 ファンアウトバッファで、バックプレーン冗長性アプリケーションで使用できるように設計されています。シグナル コンディショニング機能には、連続時間リニア イコライゼーション (CTLE) とプログラム可能な出力プリエンファシスが含まれており、FR4 バックプレーンのデータ通信を最大 4Gbps のレートまで拡張できます。各入力段には固定イコライザがあり、基板配線によるシンボル間干渉歪みを低減できます。

すべての出力ドライバには、長い FR4 バックプレーンからの伝送損失を補償し、確定的なジッタを低減するため、4 つの選択可能なプリエンファシス ステップがあります。プリエンファシス レベルは、ライン側ドライバとスイッチ側ドライバで独立して制御できます。スイッチ側入力からスイッチ側出力への内部ループバック パスにより、At-Speed システム テストが可能になります。すべてのレシーバ入力は、100Ω の差動終端抵抗で内部終端されています。すべてのドライバは、VCC に対して 50Ω で内部終端されています。

DS40MB200 デバイスは、デュアル シグナル コンディショニング 2:1 マルチプレクサ (MUX) および 1:2 ファンアウトバッファで、バックプレーン冗長性アプリケーションで使用できるように設計されています。シグナル コンディショニング機能には、連続時間リニア イコライゼーション (CTLE) とプログラム可能な出力プリエンファシスが含まれており、FR4 バックプレーンのデータ通信を最大 4Gbps のレートまで拡張できます。各入力段には固定イコライザがあり、基板配線によるシンボル間干渉歪みを低減できます。

すべての出力ドライバには、長い FR4 バックプレーンからの伝送損失を補償し、確定的なジッタを低減するため、4 つの選択可能なプリエンファシス ステップがあります。プリエンファシス レベルは、ライン側ドライバとスイッチ側ドライバで独立して制御できます。スイッチ側入力からスイッチ側出力への内部ループバック パスにより、At-Speed システム テストが可能になります。すべてのレシーバ入力は、100Ω の差動終端抵抗で内部終端されています。すべてのドライバは、VCC に対して 50Ω で内部終端されています。

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技術資料

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* データシート DS40MB200 送信プリエンファシス機能と受信イコライゼーション機能搭載、デュアル、4Gbps、2:1/1:2 CML マルチプレクサ / バッファ データシート (Rev. K 翻訳版) PDF | HTML 英語版 (Rev.K) PDF | HTML 2024年 5月 31日
アプリケーション・ノート AN-1398 Printed Circuit Board Design Techniques for DS40MB200 (Rev. A) 2013年 4月 26日
アプリケーション・ノート Driving Signals Over XAUI Backplanes Using DS42MB100, DS40MB200, or DS42BR400 (Rev. B) 2013年 4月 26日
アプリケーション・ノート Enabling Redundancy in Multi-Gigabit Links w/DS40MB200 Mux/Buffer (Rev. A) 2013年 4月 26日
アプリケーション・ノート Setting Pre-Empha Level for DS40MB200 Dual 4Gb/s Mux/Buffer (Rev. C) 2013年 4月 26日
アプリケーション・ノート Application Note 1398 Printed Circuit Board Design Techniques for DS40MB200 (jp) 最新英語版 (Rev.A) 2005年 10月 21日
アプリケーション・ノート Setting Pre-Empha Level for DS40MB200 Dual 4Gb/s Mux/Buffer (jp) 2005年 10月 21日
アプリケーション・ノート Enabling Redundancy in Multi-Gigabit Links w/DS40MB200 Mux/Buffer (jp) 最新英語版 (Rev.A) 2005年 10月 17日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション・ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル・ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

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ユーザー ガイド: PDF
英語版 (Rev.A): PDF
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
WQFN (NJU) 48 Ultra Librarian

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブの拠点
  • 組み立てを実施した拠点

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

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