DS90C241
- 5MHz~35MHzクロック組み込みおよびDC平衡化の24:1および1:24データ転送
- LVDS出力上の外付け抵抗によるユーザー定義のプリエンファシス駆動能力、最大10mのシールド・ツイストペア・ケーブルを駆動可能
- トランスミッタとレシーバの両方で、並列データのクロック・エッジをユーザーが選択可能
- 内部DC平衡化のエンコードおよびデコード(外部コーディングなしでACカップリング・インターフェイスをサポート)
- トランスミッタとレシーバの両方を個別にパワー・ダウン制御
- レシーバにクロックCDR (クロックおよびデータ回復)を内蔵し、外部基準クロック・ソース不要
- すべてのコードRDL (ランダム・データ・ロック)でライブ・プラグ可能アプリケーションをサポート
- LOCK出力フラグにより、レシーバ側でデータ整合性を保証
- レシーバ側のRCLKとRDATAとの間でTSETUPおよびTHOLDを平衡化
- PTO (段階的電源オン) LVCMOS出力によりEMIを低減しSSO効果を最小化
- すべてのLVCMOS入力および制御ピンは内部プルダウン付き
- トランスミッタとレシーバのPLL用にオンチップのフィルタを搭載
- 温度範囲: -40℃~+105℃
- 8kVを超えるHBM ESD耐圧
- AEC-Q100準拠
- 電源電圧範囲: 3.3V±10%
- 48ピンTQFPパッケージ
DS90C241およびDS90C124チップセットは、24ビットのパラレル・バスを、完全に透過的な、クロック情報が埋め込まれたデータおよび制御LVDSシリアル・ストリームに変換します。この単一のシリアル・ストリームにより、パラレル・データとクロック・パスの間でスキューの問題が排除されるため、PCB上の配線およびケーブルで24ビットのデータ・バスを簡単に転送できます。これによって、データ・パスを狭くでき、PCBレイヤ、ケーブル幅、コネクタのサイズとピン数のすべてを削減できるため、システム・コストを低減できます。
DS90C241およびDS90C124には、高速I/OのLVSD信号通知が組み込まれています。LVDSによって、低消費電力かつ低ノイズの環境により、シリアル転送パス上で確実にデータを転送できます。動作周波数範囲について、シリアライザの出力エッジ・レートを最適化することにより、さらにEMIが低減されます。
さらに、このデバイスにはプリエンファシス機能があり、損失の多いケーブル上で長距離の伝送を行えるよう信号をブーストできます。内部DC平衡化されたエンコードとデコードは、ACカップリングされた相互接続をサポートします。
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技術資料
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6 をすべて表示 種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
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* | データシート | DS90C241およびDS90C124 5MHz~35MHz DC平衡化24ビット FPD-Link IIシリアライザ/デシリアライザ データシート (Rev. M 翻訳版) | PDF | HTML | 英語版 (Rev.M) | PDF | HTML | 2017年 3月 6日 |
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設計および開発
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TINA は DesignSoft (...)
パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
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TQFP (PFB) | 48 | Ultra Librarian |
購入と品質
記載されている情報:
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用原材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
記載されている情報:
- ファブの拠点
- 組み立てを実施した拠点