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SN65HVD05

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제품 상세 정보

Number of receivers 1 Number of transmitters 1 Duplex Half Supply voltage (nom) (V) 5 Signaling rate (max) (Mbps) 40 Fault protection (V) -9 to 14 Common-mode range (V) -7 to 12 Number of nodes 64 Isolated No Supply current (max) (µA) 15000 Rating Catalog Operating temperature range (°C) -40 to 85
Number of receivers 1 Number of transmitters 1 Duplex Half Supply voltage (nom) (V) 5 Signaling rate (max) (Mbps) 40 Fault protection (V) -9 to 14 Common-mode range (V) -7 to 12 Number of nodes 64 Isolated No Supply current (max) (µA) 15000 Rating Catalog Operating temperature range (°C) -40 to 85
PDIP (P) 8 92.5083 mm² 9.81 x 9.43 SOIC (D) 8 29.4 mm² 4.9 x 6
  • Minimum differential output voltage of 2.5 V Into a 54-Ω load
  • Open-circuit, short-circuit, and idle-bus failsafe receiver
  • 1/8th Unit-load option available (Up to 256 nodes on the bus)
  • Bus-pin ESD protection exceeds 16 kV HBM
  • Driver output slew rate control options
  • Electrically compatible with ANSI TIA/EIA-485-A standard
  • Low-current standby mode: 1 µA typical
  • Glitch-free power-up and power-down protection for hot-plugging applications
  • Pin compatible with industry standard SN75176
  • Minimum differential output voltage of 2.5 V Into a 54-Ω load
  • Open-circuit, short-circuit, and idle-bus failsafe receiver
  • 1/8th Unit-load option available (Up to 256 nodes on the bus)
  • Bus-pin ESD protection exceeds 16 kV HBM
  • Driver output slew rate control options
  • Electrically compatible with ANSI TIA/EIA-485-A standard
  • Low-current standby mode: 1 µA typical
  • Glitch-free power-up and power-down protection for hot-plugging applications
  • Pin compatible with industry standard SN75176

The SN65HVD05, SN75HVD05, SN65HVD06, SN75HVD06, SN65HVD07, and SN75HVD07 combine a 3-state differential line driver and differential line receiver. They are designed for balanced data transmission and interoperate with ANSI TIA/EIA-485-A and ISO 8482E standard-compliant devices. The driver is designed to provide a differential output voltage greater than that required by these standards for increased noise margin. The drivers and receivers have active-high and active-low enables respectively, which can be externally connected together to function as direction control.

The driver differential outputs and receiver differential inputs connect internally to form a differential input/ output (I/O) bus port that is designed to offer minimum loading to the bus whenever the driver is disabled or not powered. These devices feature wide positive and negative common-mode voltage ranges, making them suitable for party-line applications.

The SN65HVD05, SN75HVD05, SN65HVD06, SN75HVD06, SN65HVD07, and SN75HVD07 combine a 3-state differential line driver and differential line receiver. They are designed for balanced data transmission and interoperate with ANSI TIA/EIA-485-A and ISO 8482E standard-compliant devices. The driver is designed to provide a differential output voltage greater than that required by these standards for increased noise margin. The drivers and receivers have active-high and active-low enables respectively, which can be externally connected together to function as direction control.

The driver differential outputs and receiver differential inputs connect internally to form a differential input/ output (I/O) bus port that is designed to offer minimum loading to the bus whenever the driver is disabled or not powered. These devices feature wide positive and negative common-mode voltage ranges, making them suitable for party-line applications.
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기술 자료

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유형 직함 날짜
* Data sheet SN65HVD0x, SN75HVD0x High Output RS-485 Transceivers datasheet (Rev. F) PDF | HTML 2023/03/11
EVM User's guide RS-485 Half-Duplex EVM User's Guide (Rev. C) PDF | HTML 2021/09/01
Application note Operating RS-485 transceivers at fast signaling rates (Rev. A) 2019/02/06
Application note The RS-485 Unit Load and Maximum Number of Bus Connections 2004/03/15

설계 및 개발

추가 조건 또는 필수 리소스는 사용 가능한 경우 아래 제목을 클릭하여 세부 정보 페이지를 확인하세요.

평가 보드

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사용 설명서: PDF | HTML
TI.com에서 구매 불가
시뮬레이션 모델

SN65HVD05, SN75HVD05 IBIS Model (Rev. B)

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패키지 핀 CAD 기호, 풋프린트 및 3D 모델
PDIP (P) 8 Ultra Librarian
SOIC (D) 8 Ultra Librarian
TI의 평가 항목에 대한 표준 약관이 적용됩니다.

주문 및 품질

포함된 정보:
  • RoHS
  • REACH
  • 디바이스 마킹
  • 납 마감/볼 재질
  • MSL 등급/피크 리플로우
  • MTBF/FIT 예측
  • 물질 성분
  • 인증 요약
  • 지속적인 신뢰성 모니터링
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