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LMK1D1208I

ACTIVO

Búfer de 1.8 V, 2.5 V y 3.3 V con salida LVDS de 8 canales e I²C

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Detalles del producto

Number of outputs 8 Additive RMS jitter (typ) (fs) 50 Core supply voltage (V) 1.8, 2.5, 3.3 Output supply voltage (V) 1.8, 2.5, 3.3 Output skew (ps) 20 Operating temperature range (°C) -40 to 105 Rating Catalog Output type LVDS Input type HCSL, LP-HCSL, LVCMOS, LVDS, LVPECL
Number of outputs 8 Additive RMS jitter (typ) (fs) 50 Core supply voltage (V) 1.8, 2.5, 3.3 Output supply voltage (V) 1.8, 2.5, 3.3 Output skew (ps) 20 Operating temperature range (°C) -40 to 105 Rating Catalog Output type LVDS Input type HCSL, LP-HCSL, LVCMOS, LVDS, LVPECL
VQFN (RHA) 40 36 mm² 6 x 6
  • High-performance LVDS clock buffer family with 2 inputs and 8 outputs
  • Output frequency up to 2 GHz
  • Supply voltage: 1.8 V / 2.5 V / 3.3 V ± 5%
  • Device configurability through I 2C programming

    • Individual input and output enable/disable

    • Individual output amplitude select (standard or boosted)

    • Bank input multiplexer

  • Four programmable I 2C addresses through IDX pins
  • Low additive jitter: < 60 fs RMS maximum in 12-kHz to 20-MHz at 156.25 MHz

    • Very low phase noise floor: -164 dBc/Hz (typical)

  • Very low propagation delay: < 575 ps maximum
  • Output skew: 20 ps maximum
  • Universal inputs accept LVDS, LVPECL, LVCMOS, HCSL and CML
  • Fail-safe inputs
  • LVDS reference voltage, V AC_REF, available for capacitive coupled inputs
  • Industrial temperature range: –40°C to 105°C
  • Packages available
    • 6-mm × 6-mm, 40-Pin VQFN (RHA)
  • High-performance LVDS clock buffer family with 2 inputs and 8 outputs
  • Output frequency up to 2 GHz
  • Supply voltage: 1.8 V / 2.5 V / 3.3 V ± 5%
  • Device configurability through I 2C programming

    • Individual input and output enable/disable

    • Individual output amplitude select (standard or boosted)

    • Bank input multiplexer

  • Four programmable I 2C addresses through IDX pins
  • Low additive jitter: < 60 fs RMS maximum in 12-kHz to 20-MHz at 156.25 MHz

    • Very low phase noise floor: -164 dBc/Hz (typical)

  • Very low propagation delay: < 575 ps maximum
  • Output skew: 20 ps maximum
  • Universal inputs accept LVDS, LVPECL, LVCMOS, HCSL and CML
  • Fail-safe inputs
  • LVDS reference voltage, V AC_REF, available for capacitive coupled inputs
  • Industrial temperature range: –40°C to 105°C
  • Packages available
    • 6-mm × 6-mm, 40-Pin VQFN (RHA)

The LMK1D1208I is an I 2C-programmable LVDS clock buffer. The device has two inputs and eight pairs of differential LVDS clock outputs (OUT0 through OUT7) with minimum skew for clock distribution. The inputs can either be LVDS, LVPECL, LVCMOS, HCSL, or CML.

The LMK1D1208I is specifically designed for driving 50-Ω transmission lines. When driving inputs in single-ended mode, apply the appropriate bias voltage to the unused negative input pin.

I 2C programming enables this device to be configured as a single bank buffer (one of the two inputs is distributed to eight output pairs) or as a dual bank buffer (each input is distributed to four outputs pairs). Each output can be configured to have either a standard (350 mV) or boosted (500 mV) swing. This device also incorporates individual output channel enable or disable through I 2C programming. The LMK1D1208I has fail-safe inputs that prevent oscillation at the outputs in the absence of an input signal and allows for input signals before VDD is supplied.

The device operates in a 1.8-V, 2.5-V, or 3.3-V supply environment and is characterized from –40°C to 105°C (ambient temperature).

The LMK1D1208I is an I 2C-programmable LVDS clock buffer. The device has two inputs and eight pairs of differential LVDS clock outputs (OUT0 through OUT7) with minimum skew for clock distribution. The inputs can either be LVDS, LVPECL, LVCMOS, HCSL, or CML.

The LMK1D1208I is specifically designed for driving 50-Ω transmission lines. When driving inputs in single-ended mode, apply the appropriate bias voltage to the unused negative input pin.

I 2C programming enables this device to be configured as a single bank buffer (one of the two inputs is distributed to eight output pairs) or as a dual bank buffer (each input is distributed to four outputs pairs). Each output can be configured to have either a standard (350 mV) or boosted (500 mV) swing. This device also incorporates individual output channel enable or disable through I 2C programming. The LMK1D1208I has fail-safe inputs that prevent oscillation at the outputs in the absence of an input signal and allows for input signals before VDD is supplied.

The device operates in a 1.8-V, 2.5-V, or 3.3-V supply environment and is characterized from –40°C to 105°C (ambient temperature).
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Documentación técnica

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Documentación principal Tipo Título Opciones de formato Fecha
* Data sheet LMK1D1208I I2C-Configurable, Low-Additive Jitter LVDS Buffer datasheet (Rev. A) PDF | HTML 14 jun 2023

Diseño y desarrollo

Para conocer los términos adicionales o los recursos necesarios, haga clic en cualquier título de abajo para ver la página de detalles cuando esté disponible.

Placa de evaluación

LMK1D1208IEVM — Módulo de evaluación LMK1D1208I para búfer LVDS de 8 canales de salida, 1.8 V, 2.5 V y 3.3 V con I²C

El módulo de evaluación (EVM) LMK1D1208I se utiliza para mostrar el rendimiento eléctrico del LMK1D1208I. LMK1D1208I es un búfer de reloj LVDS de alto rendimiento y baja fluctuación aditiva configurable por I2C con dos entradas diferenciales y ocho salidas LVDS. El LMK1D1208IEVM está equipado con (...)
Guía del usuario: PDF | HTML
No disponible en TI.com
Soporte de software

TICSPRO-SW — TICS Pro GUI and Live Programming Tool for Clocking Devices

Texas Instruments clocks and synthesizers (TICS) pro software is used to program the evaluation modules (EVMs) for product numbers with these prefixes: CDC, LMK and LMX. These products include phase-locked loops and voltage-controlled oscillators (PLL+VCO), synthesizers and clocking devices.

Productos y hardware compatibles

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Opciones de descarga
Modelo de simulación

LMK1DX IBIS Model (Rev. B)

SNAM251B.ZIP (67 KB) - IBIS Model
Descargar
Herramienta de diseño

PLLATINUMSIM-SW — PLL loop filter, phase noise, lock time, and spur simulation tool

PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.

Productos y hardware compatibles

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Opciones de descarga
Herramienta de simulación

PSPICE-FOR-TI — PSpice® para herramienta de diseño y simulación de TI

PSpice® para TI es un entorno de diseño y simulación que ayuda a evaluar la funcionalidad de los circuitos analógicos. Esta completa suite de diseño y simulación utiliza un motor de análisis analógico de Cadence®. Disponible sin ningún costo, PSpice para TI incluye una de las bibliotecas de modelos (...)
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Encapsulado Pines Símbolos CAD, huellas y modelos 3D
VQFN (RHA) 40 Ultra Librarian
Se aplican los Términos y condiciones estándar de TI para los elementos de evaluación.

Pedidos y calidad

Información incluida:
  • RoHS
  • REACH
  • Marcado del dispositivo
  • Acabado de plomo/material de la bola
  • Clasificación de nivel de sensibilidad a la humedad (MSL)/reflujo máximo
  • Estimaciones de tiempo medio entre fallas (MTBF)/fallas en el tiempo (FIT)
  • Contenido del material
  • Resumen de calificaciones
  • Monitoreo continuo de confiabilidad
Información incluida:
  • Lugar de fabricación
  • Lugar de ensamblaje

Los productos recomendados pueden tener parámetros, módulos de evaluación o diseños de referencia relacionados con este producto de TI.

Soporte y capacitación

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