TPS74201
- Input Voltage Range: 0.8 V to 5.5 V
- Soft-Start (SS) Pin Provides a Linear Start-Up With Ramp Time Set by External Capacitor
- 1% Accuracy Over Line, Load, and Temperature
- Supports Input Voltages as Low as 0.8 V With External Bias Supply
- Adjustable Output (0.8 V to 3.6 V)
- Ultra-Low Dropout: 55 mV at 1.5 A (Typical)
- Stable With Any or No Output Capacitor
- Excellent Transient Response
- Open-Drain Power-Good (VQFN)
- Active High Enable
The TPS742 series of low-dropout (LDO) linear regulators provide an easy-to-use, robust power-management solution for a wide variety of applications. User-programmable soft-start minimizes stress on the input power source by reducing capacitive inrush current on start-up. The soft-start is monotonic and well suited for powering many different types of processors and ASICs. The enable input and power-good output allow easy sequencing with external regulators. This complete flexibility permits the user to configure a solution that meets the sequencing requirements of FPGAs, DSPs, and other applications with special start-up requirements.
A precision reference and error amplifier deliver 1% accuracy over load, line, temperature, and process. Each LDO is stable with low-cost ceramic output capacitors, and the family is fully specified from –40°C to 125°C. The TPS742 devices are offered in a small 5-mm × 5-mm VQFN (RGW) and a small 3.5-mm × 3.5-mm VQFN (RGR) package, yielding a highly compact total solution size. For applications that require additional power dissipation, the DDPAK/TO-263 (KTW) package is also available.
기술 자료
유형 | 직함 | 날짜 | ||
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* | Data sheet | TPS742 1.5-A Ultra-LDO With Programmable Soft-Start datasheet (Rev. N) | PDF | HTML | 2016/11/17 |
Application note | LDO Noise Demystified (Rev. B) | PDF | HTML | 2020/08/18 | |
Application note | Using Thermal Calculation Tools for Analog Components (Rev. A) | 2019/08/30 | ||
Application note | A Topical Index of TI LDO Application Notes (Rev. F) | 2019/06/27 | ||
Application note | LDO PSRR Measurement Simplified (Rev. A) | PDF | HTML | 2017/08/09 | |
Application note | LDO Performance Near Dropout | 2010/10/08 | ||
Application note | Using New Thermal Metrics | 2009/12/15 | ||
Analog Design Journal | Q3 2007 Issue Analog Applications Journal | 2007/08/10 | ||
Analog Design Journal | Simultaneous power-down sequencing with the TPS74x01 family of linear regulators | 2007/08/10 | ||
Analog Design Journal | A 3-A, 1.2-Vout linear regulator with 80% efficiency and Plost < 1W | 2006/10/10 | ||
EVM User's guide | TPS74x01EVM-118 User's Guide | 2006/06/20 |
설계 및 개발
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ADC32RF42EVM — ADC32RF42 듀얼 채널, 14비트, 1.5GSPS, RF 샘플링 ADC 평가 모듈
ADC32RF42 평가 모듈(EVM)은 JESD204B 인터페이스를 사용하는 듀얼 1.5 GSPS 14비트 ADC(아날로그-디지털 컨버터)의 성능을 입증합니다. 이 EVM에는 ADC32RF42 장치가 포함되어 있으며, 필요한 전압을 공급하기 위해 LMK04828과 TI 전압 레귤레이터가 JESD204B 클로킹을 제공합니다.
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ADS58J64EVM은 텍사스 인스트루먼트의 ADS58J64 통합형 리시버 평가에 사용되는 평가 보드입니다. ADS58J64는 저전력 14비트, 500MSPS, 쿼드 채널 통신 리시버로 버퍼링된 아날로그 입력을 사용합니다. 이 장치는 JESD204B 인터페이스 및 최대 10Gbps의 데이터 전송률을 지원합니다. EVM에는 단일 종단 신호 및 클록 소스를 지원하고 다양한 신호 주파수를 수용할 수 있도록 변압기에 연결된 아날로그 및 클록 입력이 있습니다. 아날로그 입력에서는 더 우수한 진폭 및 위상 매칭 성능을 위해 변압기들이 앞뒤로 (...)
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TPS74201 TINA-TI Transient Reference Design
TIDA-01161 — 1GHz 신호 대역폭 RF 샘플링 리시버 레퍼런스 설계
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TIDA-00069 — 고속 LVDS 인터페이스 데이터 컨버터에 Altera FPGA를 인터페이스하는 방법에 대한 FPGA 펌웨어 예
패키지 | 핀 | CAD 기호, 풋프린트 및 3D 모델 |
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TO-263 (KTW) | 7 | Ultra Librarian |
VQFN (RGR) | 20 | Ultra Librarian |
VQFN (RGW) | 20 | Ultra Librarian |
주문 및 품질
- RoHS
- REACH
- 디바이스 마킹
- 납 마감/볼 재질
- MSL 등급/피크 리플로우
- MTBF/FIT 예측
- 물질 성분
- 인증 요약
- 지속적인 신뢰성 모니터링
- 팹 위치
- 조립 위치
권장 제품에는 본 TI 제품과 관련된 매개 변수, 평가 모듈 또는 레퍼런스 디자인이 있을 수 있습니다.