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XNOR-Gatter (Exklusives NOR)

SN74HC266

AKTIV

4-ch, 2-input, 2-V to 6-V 5.2 mA drive strength XNOR (exclusive NOR) gate with open-drain outputs

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Datenblatt

SN74HC266

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Produktdetails

Technology family HC Number of channels 4 Inputs per channel 2 IOL (max) (mA) 5.2 Input type Standard CMOS IOH (max) (mA) 0 Output type Open-drain Features High speed (tpd 10- 50ns) Data rate (max) (Mbps) 28 Rating Catalog Operating temperature range (°C) -40 to 85
Technology family HC Number of channels 4 Inputs per channel 2 IOL (max) (mA) 5.2 Input type Standard CMOS IOH (max) (mA) 0 Output type Open-drain Features High speed (tpd 10- 50ns) Data rate (max) (Mbps) 28 Rating Catalog Operating temperature range (°C) -40 to 85
PDIP (N) 14 181.42 mm² 19.3 x 9.4 SOIC (D) 14 51.9 mm² 8.65 x 6 SOP (NS) 14 79.56 mm² 10.2 x 7.8
  • Wide Operating Voltage Range: 2 V to 6 V
  • Outputs Can Drive Up To 10 LSTTL Loads
  • Low Power Consumption, 20-µA Maximum ICC
  • Typical tpd = 8 ns at 5 V
  • ±4-mA Output Drive at 5 V
  • Low Input Current of 1 µA
  • Wide Operating Voltage Range: 2 V to 6 V
  • Outputs Can Drive Up To 10 LSTTL Loads
  • Low Power Consumption, 20-µA Maximum ICC
  • Typical tpd = 8 ns at 5 V
  • ±4-mA Output Drive at 5 V
  • Low Input Current of 1 µA

This device contains four independent 2-input XNOR Gates with open-drain outputs. Each gate performs the Boolean function Y = A ⊕ B in positive logic.

This device contains four independent 2-input XNOR Gates with open-drain outputs. Each gate performs the Boolean function Y = A ⊕ B in positive logic.
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Technische Dokumentation

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Typ Titel Datum
* Data sheet SN74HC266 Quadruple 2-Input XNOR Gates with Open-Drain Outputs datasheet (Rev. G) 30 Apr 2021
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Application note Live Insertion 01 Okt 1996
Application note SN54/74HCT CMOS Logic Family Applications and Restrictions 01 Mai 1996
Application note Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 01 Apr 1996

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

14-24-LOGIC-EVM — Generisches Logikprodukt-Evaluierungsmodul für 14-polige bis 24-polige D-, DB-, DGV-, DW-, DYY-, NS-

Das 14-24-LOGIC-EVM-Evaluierungsmodul (EVM) ist für die Unterstützung aller Logikgeräte konzipiert, die sich in einem 14-Pin- bis 24-Pin-D-, DW-, DB-, NS-, PW-, DYY- oder DGV-Gehäuse befinden.

Benutzerhandbuch: PDF | HTML
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Simulationsmodell

SN74HC266 Behavioral SPICE Model

SCLM218.ZIP (6 KB) - PSpice Model
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Gehäuse Pins CAD-Symbole, Footprints und 3D-Modelle
PDIP (N) 14 Ultra Librarian
SOIC (D) 14 Ultra Librarian
SOP (NS) 14 Ultra Librarian
Es gelten die allgemeinen Geschäftsbedingungen von TI für Evaluierungsartikel.

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