The SN65LV1023A serializer and SN65LV1224B deserializer comprise a 10-bit serdes chipset designed to transmit and receive serial data over LVDS differential backplanes at equivalent parallel word rates from 10 MHz to 66 MHz. Including overhead, this translates into a serial data rate between 120-Mbps and 792-Mbps payload encoded throughput.
Upon power up, the chipset link can be initialized via a synchronization mode with internally generated SYNC patterns or the deserializer can be allowed to synchronize to random data. By using the synchronization mode, the deserializer establishes lock within specified, shorter time parameters.
The device can be entered into a power-down state when no data transfer is required. Alternatively, a mode is available to place the output pins in the high-impedance state without losing PLL lock.
The SN65LV1023A and SN65LV1224B are characterized for operation over ambient air temperature of –40°C to 85°C.
| Tipo | Título | Fecha | ||
|---|---|---|---|---|
| * | Data sheet | 10-MHz to 66-MHz, 10:1-LVDS Serializer/Deserializer datasheet (Rev. E) | 07 dic 2009 | |
| * | Errata | SN65LV1023A Sync Pattern Generation Logic Error | 26 jun 2003 | |
| Application note | Applications of Low-Voltage Differential Signaling (LVDS) in LED Walls | 29 oct 2020 | ||
| Application brief | Migrating from DS92LV1021A/1212A 10-bit SerDes to SN65LV1023A/1224B | 15 nov 2018 | ||
| User guide | 10:1 Serializer/Deserializer Evaluation Board | 20 nov 2013 |
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| Encapsulado | Pines | Símbolos CAD, huellas y modelos 3D |
|---|---|---|
| SSOP (DB) | 28 | Ultra Librarian |
| VQFN (RHB) | 32 | Ultra Librarian |
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