DAC539E4W
- クワッド・コンパレータ入力
- 10 ビットの独立コンパレータ・スレッショルド
- 1 LSB の DNL
- 1×、1.5×、2×、3×、4× のゲイン
- クワッド汎用出力 (GPO)
- ルックアップ・テーブル (LUT) に基づくコンパレータから GPO へのマッピング
- SPI および I 2C インターフェイスの自動検出
- V IH:1.62V (V DD = 5.5V の場合)
- MODE ピンにより、プログラミング・モードとスタンドアロン・モードを選択
- ユーザーがプログラム可能な不揮発性メモリ (NVM)
- リファレンス:内部、外部、VDD
- 幅広い動作範囲
- 電源:1.8V~5.5V
- 温度範囲:-40℃~+125℃
- 超小型パッケージ:
- 16 ピン DSBGA:1.72mm × 1.72mm (公称値)
DAC539E4W は、クワッド・プログラマブル・コンパレータ入力とクワッド汎用出力を備えた 10 ビット・スマート D/A コンバータ (DAC) です。ルックアップ・テーブルにより、コンパレータ入力が GPO にマッピングされます。また、 DAC539E4W は遅延をプログラム可能で、入力の遷移を安定させることもできます。これらのデバイスは、構成を保存するための NVM を提供します。このスマート DAC は、LUT と NVM を使用するプロセッサを必要とせずに動作します (プロセッサレス動作)。
このデバイスには、SPI および I 2C インターフェイスの自動検出と内部基準電圧が搭載されています。スマート DAC は、機能セット、小型パッケージ、低消費電力により、フォルト管理アプリケーションに非常に適しています。
技術資料
種類 | タイトル | 最新の英語版をダウンロード | 日付 | |||
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* | データシート | DAC539E4W LUT ベースのスタンドアロン障害管理向け、I2C または SPI 自動検出機能付き、10 ビット・スマート DAC データシート | PDF | HTML | 英語版 | PDF | HTML | 2023年 6月 30日 |
製品概要 | Smart DAC Product Selection Guide | PDF | HTML | 2024年 7月 1日 | |||
アプリケーション・ノート | 高速データ変換 | 英語版 | 2009年 12月 11日 | |||
アプリケーション・ノート | データ・コンバータのドリフトに関する設計者の必須知識: 最悪劣化度の構成要素を理解して仕様の条件を減らす | 2009年 4月 22日 |
設計および開発
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ANALOG-ENGINEER-CALC — アナログ技術者向けカリキュレータ
スタンドアロン ツールとして使用できるほか、『アナログ回路設計式一覧ポケット ガイド』で説明されているコンセプトと組み合わせることもできます。
ADC-DAC-TO-VREF-SELECT-DESIGN-TOOL — The ADC-TO-VREF-SELECT tool enables the pairing of TI ADCs, DACs, and series voltage references.
サポート対象の製品とハードウェア
製品
シリーズ電圧リファレンス
高精度 ADC
バイオセンシング AFE
統合型高精度 ADC と DAC
高速 ADC(≧10 MSPS)
高精度 DAC(≤10 MSPS)
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設計とシミュレーション向けの環境である PSpice for TI を使用すると、内蔵のライブラリを使用して、複雑なミックスド (...)
TINA-TI — SPICE ベースのアナログ・シミュレーション・プログラム
TINA-TI をインストールするには、約 500MB が必要です。インストールは簡単です。必要に応じてアンインストールも可能です。(そのようなことはないと思いますが)
TINA は DesignSoft (...)
パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
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DSBGA (YBH) | 16 | Ultra Librarian |
購入と品質
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用原材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
- ファブの拠点
- 組み立てを実施した拠点